基于Nios II的数字音频录放系统的设计

1、基于nios ii的数字音频录放系统的设计sopc( system on programmable chip)技术是soc( system on chip)技术和设计（）技术结合的产物。它可以将处理器、存储器、i/o接口、硬件协处理器和一般的用户规律等系统设计需要的功能模块都集成到一个 芯片里, 构建一个可编程的片上系统1。它还具有灵便的设计方式，可裁减、可扩充、可升级，具备系统可编程等功能，是一种优秀的系统设计技术2。本文讨论了一种基于sopc技术的嵌入式数字音频录放系统的设计计划。系统通过在fpga芯片上配置niosii软核处理器和相关的接口模块来实现嵌入式系统的主要硬件结构,并结合嵌入式

2、系统所支持的软件设计来控制音频编/解码芯片wm8731和sdram,实现了音频信号的a/d、d/a转换、存储、回放等功能。因为采纳了sopc和dma控制技术，该系统具有设计灵便、扩展性好和数据处理速度快等优点3、4。1 系统原理和结构系统结构1所示。本系统选用的fpga芯片是公司最新推出的cycloneii 系列的ep2c35。该芯片具有35000个规律单元、672个引脚、475个用户自定义i/o接口、35个嵌入式乘法器和4个锁相环，是一个集成度极高和功能强大的fpga芯片。在fpga中设计有niosii软核处理器和挂在该niosii系统的avalon上的i2c配置接口模块、串/并转换模块(s

3、/p)、并/串转换模块(p/s)、先入先出存储器模块（fifo_in、fifo_out）、sdram存储器控制接口（sdram control）、dma控制器接口（dma_in、dma_out）和用于接收按键信息的通用并行接口（pio）模块等。在fpga外有音频编/解码芯片（wm8731）、音频数据存储模块（sdram）和控制按键（keybord）等。图1 系统结构图系统的音频信号采集原理是：wm8731经过i2c配置后，将输入端加入的模拟音频信号举行a/d转换后，成为串行的数字信号。fpga内的串/并转换模块再将该信号转换成16位宽的并行数字信号。此信号从s/p的输出，并交给先入先出存储器（

4、fifo）举行缓存。当fifo的数据达到其容量的一半时向dma_in哀求一次dma传送。dma_in接受哀求后就执行一次fifo到sdram之间的挺直dma数据保存。多次重复fifo到sdram之间的dma传送，直到采集停止键被按下后，就完成了一段音频数据的采集。回放原理是：在dma_out的控制下，通过sdram控制器将sdram中保存的音频数据经fifo_out送到并/串转换模块的输入端，经过并/串转换后的串行数字信号再由wm8731举行数/模转换，就还原成为模拟的声音信号。多次重复这种dma传送操作，直到回放停止键被按下后就完成了一段音频数据的回放。2 系统硬件设计系统的硬件主要由fpg

5、a内的niosii中心处理器及接口模块和fpga外的音频编/解码芯片wm8731、存储器和控制键等部分构成。在系统的硬件设计中，fpga内部各模块的设计是本系统硬件设计的核心技术。fpga内部各模块是利用altera公司提供的ii开发软件和其中集成的sopc builder系统开发工具来设计的。sopc builder支持niosii cpu的配置，并支持设计者在该工具所提供的ip库中按照系统设计需要挑选相应的接口模块，并加入到niosii系统中。这样，在极短的时光内就可以完成一个sopc系统的设计。将这些设计在quartusii中编译并生成sof格式文件后，下载到fpga芯片中就形成了sop

6、c的嵌入式系统硬件平台。下面主要对niosii软核处理器、i2c总线控制接口、串/并转换模块等几个关键模块的设计举行介绍。2.1 niosii软核处理器本系统设计所挑选的处理器是altera公司新近推出的其次代嵌入式niosii软核处理器系列中的一个。niosii处理器系列是一个用户可配置的通用32位risc嵌入式软核处理器集合。它包括三种软核cpu：一种是高性能软核，它的处理能力超过200，需要占用1800个规律单元；一种是精简软核， 用这种软核构造一个完整的cpu系统只需要占用700个规律单元；第三种是标准软核，这种软核约占用1400个规律单元，性能也介于上两种软核之间。全部软核都是100

7、%代码兼容，设计者可按照需要对上述三种软核举行挑选来调节嵌入式系统的性能及成本。因为本设计采纳的cycloneii系列的2c35芯片具有35000个规律单元，规律资源非常丰盛，加上系统对cpu的性能要求较高的缘由，因此选用了高性能的niosii软核作为本系统的cpu。2.2 i2c总线控制接口wm8731是wolfson microelectronics公司生产的一款低功耗的高品质双声道数字信号编解码芯片。该芯片的和的采样频率为8khz"96khz可调，可转换的数据位长度为16"32位可调。wm8731的内部有11个寄存器。该芯片的初始化和内部功能设置是以i2c总线方式对其内部的这11个寄存器举行相应的配置来实现的。本设计中wm8731工作于主模式，采样频率设为