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文档简介
设计题目
序列信号发生器
实验要求1.设计一个信号发生器电路,是之在一系列CLK信号作用下能周期的输出“0010110111”的序列信号。2.用电路仿真分析软件(Multisim)在计算机上实现集成芯片74LS160、74LS151的逻辑功能;3.然后再做其余内容。要求有原理分析、设计过程和设计说明。电路图必须用仿真软件绘制,并截图粘贴到MicrosoftWord中。分析这是一个序列脉冲产生电路。需要使用74LS160,74LS151两个芯片。根据第六章所学时序逻辑电路的分析方法,逆向推导可得所求的序列脉冲电路。参考6.3.4知识。搜索资料,进行分析。参考资料1.1序列信号发生器的原理介绍在数字电路设计中,有些时候需用一组非常特殊的数字信号。一般情况下我们就将这种特殊的串行数字信号叫做序列信号。生成这样的一组特定序列信号的电路叫做序列信号发生器。序列信号发生器的设计方法有多种:(1)使用环形计数器设计“1000…0”型序列信号发生器;(2)使用扭环计数器设计“11…100…0”型序列发生器;(3)任意类型的序列发生器a.使用D触发器设计序列发生器b.使用计数器和多路复用器设计序列发生器c.用移位寄存器和反馈组合电路(分立门电路,译码器,多路复用器)设计1.2计数器介绍在设计数字电路时用的比较多时序电路可能就是计数器。它不仅可以用于对时钟脉冲计数,也可以用于分频、节拍脉冲以及脉冲序列还有就是进行数字运算。总之用法非常的广泛,计数器的种类非常繁多。计数器可以分为同步计数器和异步计数器这样2种。在同步计数器中,当时钟脉冲输入时触发器翻转是同步发生的。然而在异步计数器中,触发器的翻转有先后顺序,不是在同一时间发生的。另外计数器还有三种。随着计数脉冲的不断输入而作增加计数的叫做加法计数器,做减少计数的叫做减法计数器,可以增加也可以减少的叫做可逆计数器。(2)74151数据选择器,它的引脚排列如图2.2所示。74151芯片的真值表如表2.2所示。
表2.2
图2.2设计步骤序列长度是10,故有10个状态,状态图解如图2.4所示
图2.3状态图可作状态转换表如表2.3其中状态依次分配为“0000”~“1001”。表2.3状态转换表可作状态转换表如表2.3其中状态依次分配为“0000”~“1001”。由状态方程和输出方程做出电路
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