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精品文档-下载后可编辑PACE的SO分析口DRC功能-基础电子SSO（SimultaneouslySwitchingOutputs，同时切换输出）分析是PACE非常重要的功能。所谓SSO现象是指一串寄存器的输出，当从全“0”变到全“1”或从全“1”变到全“0”时将会对电源和地平面产生一定的影响（电源的电流发生突变），甚至影响到器件内部时钟和逻辑的正常工作。SSO现象与寄存器的输出宽度、输入／输出信号标准的选择，以及输入／输出引脚驱动电流的大小有直接关系。对高速且高性能的逻辑设计，应避免和减少SSO现象。在PACE工具中提供了不同信号标准及驱动条件下，每个Bank内多的SSO数量。当超过该数值时，设计工具将提出告警，告警的门槛可以在工具中设置。此外当输入／输出引脚位置和接口标准约束设置完成后，PACE工具可以用DRC来检查输入／输出配置的合法性。（1）选择【Tools】一【RunDesignRuleCheck（DRC）】命令，将检查时钟输入脚分配、输入／输出标准合法性、参考电压及工作电源是否兼容等项目。检查结果显示在【CheckPinAssignment】对话框中，如图1所示。

图1检查结果（2）选择【Tools】→【ssoAnalysis】命令，执行SSO的分析。例如，选择LVTTL作为输出标准、驱动电流为24mA且输出方式为快速(FAST)，那么每个Bank所允许的SSO数量为25个。当进行SS0分析后将出现告警信息，如图2所示。

图2告警信息告警信息仅为设计者提供一些辅助信息，并不影响逻辑的实现。如果设计者可以容忍SSO现象所带来的不利因素，可以忽略；如果需要避免SSO现象，可以通过改变驱动电流的大小、输出

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