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文档简介

触发器及时序逻辑电路

常见触发器1.掌握触发器和时序逻辑电路的特点。2.掌握基本RS触发器、D型触发器、JK触发器和T型触发器的逻辑功能。常见触发器

【学习目标】

【能力目标】1.能够设计常用触发器电路。2.能根据常用触发器的输入波形画出输出波形。常见触发器

时序逻辑电路是由具有记忆功能的触发器及构成组合逻辑电路的门电路构成的。时序逻辑电路的特点是：任何时刻电路的输出状态不仅与当时的输入状态有关，还与电路的前一个状态有关，即时序逻辑电路具有记忆功能。触发器是构成时序逻辑电路的基本单元。常用的时序逻辑电路有寄存器和计数器等。常见触发器

一、RS触发器（一）基本RS触发器1.电路组成与逻辑符号

常见触发器

2.工作原理(1）电路的初始状态（原态）用表示，触发后的状态（次态）用表示。(2)为置0端，为置1端，非符号表示低电平触发有效。(3),,即两输入端同时为有效信号时，Q与同时被强迫为1，出现逻辑混乱，所以这种状态应当避免。(4）选用触发器时，应了解电路结构形式和触发方式，认清置0端、置1端是低电平有效还是高电平有效。

常见触发器

3.逻辑功能逻辑功能110101保持010100置0100111置10001不定（应避免）常见触发器

（二）同步RS触发器

1.电路组成与逻辑符号

常见触发器

2.逻辑功能

当CP=0时，G3、G4处于关门状态，不论是R、S端输人信号如何，G3、G4输出都为1，触发器维持原状态。当CP=1时，G3、G4都打开，触发器的状态由R、S决定。此时触发器的真值表

表

同步RS触发器真值表CPR

S逻辑功能0××保持100保持011置1100置011不定（应避免）例13—1根据所给出的时钟脉冲CP和R、S端的输入波形，画出同步RS触发器Q和端的波形。设触发器的初始状态为“0”。解：根据同步RS触发器的真值表，确定每一个时钟脉冲高电平到来时的R、S的电平组合情况，分别画出Q端和端的输出波形。常见触发器3．集成触发器

集成触发器的触发方式触发方式时钟脉冲状态定义符号(以RS触发器为例)电平触发高电平、低电平触发器的翻转在CP的高电平或低电平期间进行同步RS触发器边沿触发上升沿触发上升沿触发器的翻转在CP的上升沿时刻进行上升沿触发RS触发器下降沿触发下降沿触发器的翻转在CP的下降沿时刻进行下升沿触RS触发器主从触发器高电平触发器内部有主、从两个触发器。主触发器的翻转在CP的高电平期间进行。从触发器的状态在CP的下降沿变为与主触发器的一样。触发器的状态为从触发器状态，整个触发器的翻转在CP的下降沿进行。主从RS触发器常见触发器二、其他类型触发器1、JK触发器

JK触发器的逻辑符号J

K逻辑功能00保持010置0101置111翻转JK触发器真值表常见触发器2、D触发器

集成D触发器符号集成D触发器功能表D逻辑功能01置0置1例13—2根据所

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