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文档简介

顺序脉冲发生器第一页，共十页，2022年，8月28日一、计数型顺序脉冲发生器(一)

由四进制计数器(JK触发器)和译码器构成Y0CP1J1KC1FF01J1KC1FF1&11RDRD1CR&&&Y1Y2Y3CPQ0Q1Y0Y1Y2Y3第二页，共十页，2022年，8月28日(二)

由D

触发器和译码器构成C11DQ0Q0RDC11DQ1Q1FF0FF1=1CPCRRD111Y0&&&&Y1Y2Y3结果与前同防止竞争冒险第三页，共十页，2022年，8月28日二、移动位型顺序脉冲发生器C11DQ0C11DQ1C11DQ2C11DQ3FF0FF1FF2FF3CPCRRRRR1状态图同环型计数器，能自启动，只有4个有效状态，但不需译码器。(一)

由环型计数器构成CPQ0Q1Q2Q3(二)

由扭环型计数器构成（略）第四页，共十页，2022年，8月28日三、用MSI构成顺序脉冲发生器D0D1D2D3LDCRCTTCTPQ0Q1Q2Q3CO74LS16374LS138STASTBSTCY0Y1Y2Y3Y4Y5Y6Y71D2D3D4D5D6D7D8DCP174LS374EN1Q2Q3Q4Q5Q6Q7Q8Q3位二进制计数译码缓冲寄存第五页，共十页，2022年，8月28日5.4.2三态逻辑和微机总线接口一、总线结构总线是多条数据线或地址线控制信号线的简称。(一)

总线表示方法公用导线设备1设备2总线设备1设备2(二)

设备性质与总线双向设备可读出,可写入输出设备只“读出”总线输入设备只“写入”第六页，共十页，2022年，8月28日(三)

常用器件与总线的连接1.两个以上TTL(CMOS)器件输出端不能与同一根总线连接;2.OC门和OD门可以输出端并联(线)后连接总线;3.三态逻辑器件的输出端可以连接同一根总线;二、三态器件和总线设计(一)

三态器件三态:高电平、低电平、高阻态三态缓冲器的逻辑符号曾用国标美国原码输出高电平使能EN1原码输出低电平使能EN1反码输出高电平使能EN1反码输出低电平使能EN1第七页，共十页，2022年，8月28日(二)

总线设计[例1]

利用译码器实现8个数据共享一根总线74LS138STASTBSTCY0Y1Y2Y3Y4Y5Y6Y7PQRSTUVWA0A1A2EN1EN1...总线000100010110001101011111100第八页，共十页，2022年，8月28日设备2设备4设备3三态锁存译码ENEN输出信号输出信号输入信号输入信号三态锁存设备选择ENEN设备1CP选通[例2]

典型微型计算机总线电路高阻态0011第九页，共十页，2022年，8月28日双向总线寄存器CC4034AEA/BA

/SP/SDSCP端口A端口BBUS1BUS2[例3]两总线间数据双向传送电路CC4034：带有总线结构的通用寄存器高阻态A组数据选通01传输

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