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文档简介

按上图选择后就可以点击 NEXT按上图选择后就可以点击 NEXT按上图选择后就可以点击 NEXT(选择 RAM 的地址深度是 1024 与数据位宽是 8)按上图选择后就可以点击 NEXT(选择读跟写拥有自己的独立时钟)按上图选择后就可以连续点击 2 次 Finsh(输出不带寄存器输出)由于 RAM 是可读写的器,所以可以建立一个 RAM 控制器,先把数据写入到 RAM,然后再读出来,读写是否正确,控制器具体代码如下:接着通过顶层调用两个模块:测试程序如下:编译整个工程由于没有输出信号,所以可以发现FPGA 的逻辑占用资源是 0的。仿真波形图:由上图可以发现,双口 RAM 的结构,是可以解决跨时钟域,在 a_clk 的时钟下,a 端口的数据不断写入,而 b_clk 的时钟下,b 端口不断把数据读出来,而且跟 a 端口写入的数据是相同的。

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