基于SOPC的通用型JTAG调试器的策划

1、基于SOPC的通用型JTAG调试器的策划SOPC技术的进展，给器指出了新的进展方向。所谓SOPC技术，就是指用可编程技术将囫囵系统放在一块硅片上。在传统设计中级互相自立的各个系统被集成到一块芯片中。 SOPC的可重用性是一种先进的设计思想。为了降低用户的负担，避开重复劳动，将一些在数字电路中常用但比较复杂的功能模块，比如SDRAM控制器等，设计成可修改参数的模块，用户在设计系统时可以挺直调用这些模块。这些特定的功能模块被称为IPcore(学问产权核)。因为IPcore通常是很成熟的，因此降低了开发风险。本文利用SOPC技术的特点，设计一种通用型调试器。按照待调试目标板的CPU型号，将相应的调试

2、IPcore和其他通用IPcore一起编译生成一个调试系统，下载到FPGA上，实现一个通用型调试器。在用法同一个硬件系统的状况下，可以挑选不同的调试IPcore来调试不同的CPU，而不同的IPcore可以便利的相互替换。该办法在设计灵便性、开发成本、开发周期、工作性能等方面都具有优越性。详细的实现采纳了Cyclone开发板和开发套件。1 JTAG调试原理目前在线仿真调试器中用法最多的调试办法都是基于JTAG标准。1986年，联合测试行动组发表了最早的边界扫描测试规范(Boundary Scan Testing)，经不断改进，1990年被批准为IEEE Std 1149.1a标准，简称JTAG标

3、准。现在大多数复杂的IC芯片都带有JTAG调试接口。本文所研究的调试办法也基于JTAG标准。下面首先容易介绍一下JTAG调试原理。JTAG调试原理的基础是边界扫描测试。它通过在芯片的每个I/0脚附加一个边界扫描单元(BoundaryScan Cell，BSC)以及一些附加的测试控制规律来实现。每个BSC有两个数据通道：一个是测试数据通道测试数据输入TDI(Test Data Input)、测试数据输出TD0(Test Data 0utput);另一个是正常数据通道正常数据输入NDI(Normal Data Input)、正常数据输出ND0(Normal Data Output)。在正常工作状态

4、，输入和输出数据可以自由通过每个BSC，正常工作数据从NDI进，从NDO出。在测试状态，可以挑选数据流淌的通道：对于输入引脚，可以挑选从NDI或从TDI输入数据;对于输出引脚，可以挑选从BSC输出数据至NDO或至TDO。芯片输入输出引脚上的边界扫描寄存器单元可以互相衔接起来，在芯片周围形成一个扫描链。利用边界扫描链就可以控制芯片的输入，观看芯片的输出。普通来说，芯片都提供了若干条扫描链来完成测试功能。例如7TDMI核提供了3条扫描链。JTAG控制器主要由3部分组成：测试端口控制器(Test Access Port，TAP)、命令寄存器和数据寄存器。其中，TAP控制器是JTAG的核心控制器，需要

5、以下5个控制信号：TCK(边界扫描时钟)、TMS(JTAG测试模式挑选)、TDI(串行边界扫描输入数据)、TDO(串行边界扫描输出数据)和TRST(JTAG测试规律复位)。正是通过TAP控制器状态的不断变幻，JTAG控制器得以控制CPU的运行。TAP控制器的状态机1所示。2 系统设计与实现2.1 硬件设计与实现本文采纳A1tera的FPGA器件实现了图2所示的硬件结构。上图列出了所需要的各类IPcore，其中大部分在Altera的开发包中可以找到，主要包括：Nios II/f CPU，50 MHz，Altera提供的免费软核CPU。Avalon，用于数据通信。Flash控制器，用于控制和操作F

6、lash芯片。Flash芯片中静态存放操作系统、1wIP协议栈及其他调试代码。本系统中用法的Flash芯片为Am29LVl60D，容量为2MB。SDRAM控制器，用于控制和操作SDRAM芯片。SDRAM芯片用于动态执行调试程序。本系统中用法的SDRAM芯片为三星公司的K4S640432，容量为8 MB。Ethernet控制器，用于控制和操作网卡芯片。仿真器用法这个以太网口与PC部分的集成开发环境通信。本系统中用法的网卡芯片为LAN91C111。ARM7TDMI JTAG IPcore，仿真调试IPcore，需要自主开发。其内部规律用语言实现，然后根据Altera IPcore的标准编写IPco

7、re描述文件，最后挂在三态总线上，完成所有调试功能。TCK发生器，TCK脉冲产生规律，需要自主开发。它利用Nios的时钟生成TCK信号，作为时钟来驱动ARM7TDMI JTAG IPcore。它被做成一个小的功能模块，通过PIO与三态总线通信。上述所介绍的IPcore用法Altera公司的开发工具 II编译，最后下载到Altera FPGA中。本系统用法的CPGA芯片是Cyclone系列的EPlCl2。该芯片包含12 060个规律单元，具有239 616位RAM，片上集成2个锁相环，最大用户I/O引脚达到249个。该硬件结构很好地体现了SOPC的概念，全部的IPcore(包括Altera公司发

8、布和自主开发的)集成在一片FPGA上。一个片上系统就基本包含了在线仿真器的绝大部分功能，任何硬件结构设计的变幻都在该片FPGA上，这使得通用在线仿真器这个概念得以实现。对其他芯片在线仿真，只需更改ARM7TDMI JTAG IPcore模块，重新下载到FPGA中，便可以对另一种处理器芯片举行在线仿真。该IPcore用Verilog语言实现，保存为armjtag.v文件。通过Quartus II里的SOPC Builder可以将该文件生成组件，再将其加入Nios系统中。器件引脚分配好后，就在Quartus II里全编译，最后生成ice.pof文件。将该文件通过编程器烧写到配置芯片EPCS4里面。

9、这样硬件系统就完成了。2.2 软件设计与实现本系统的软件部分包括2个模块：一是PC端的开发调试界面，二是调试器里面的控制程序。2个模块通过TCP/IP协议通信。PC端开发调试界面的主要功能是接收用户的调试指令，并显示调试结果。这是系统与用户举行交互的唯一方式。开发调试界面向上给用户提供统一的调试功能接口，对下给调试器提供统一的调试指令。本系统用法VisualC+开发。调试器里的控制程序主要功能是将上层用户调试指令转换成特定的JTAG命令序列，并控制IPcore将其发送出去，同时接收JTAG反馈信息并发送回用户界面。本系统用法Nios IDE来开发。在Nios IDE的工程属性中加入LwIP和C

10、/OS组件。主程序首先初始化C/0S，初始化LwIP协议栈，再启动C/OS。全部程序控制放在C/OS的OSStart()任务里。该任务首先建立一个套接字，然后在死循环中等待数据到来。当收到来自PC端的调试指令后，从数据包中分别出指令字和参数，将指令字转换成IPcore需要的调试指令，通过Avalon总线将其发送到IPcore，并等待IPcore工作完成。最后将IPcore传回的数据打包发回PC端。目前提供的通用调试指令如表1所列。在TCP/IP数据包中，有效数据为12字节。第1至4字节是指令代码，第5至8字节为指令参数1，第9到12字节为指令参数2。指令参数1和指令参数2是否有效取决于指令代码

11、。主控制程序收到数据包后，将指令代码发往JTAG IPcore的命令端口地址，并按照指令代码向参数端口地址发送指令参数1。假如该指令代码需要指令参数2，则在下一个周期发送。在SOPC的硬件系统设计中，全部的外设都是统一编址。将JTAG IPcore的命令端口地址和参数端口地址分离设置成0 x00910850和0 x00910860，端口位宽为32位。因此在程序里，往IPcore发送命令只需要往地址0 x00910850写32位数据;往IPcore发送参数只需要往地址Ox00910860写32位数据。反馈数据端口地址设置成Ox00910870，端口位宽为32位。因此在程序里，读取JTAG反馈数据

12、只需读取地址0 x00910870的32位数据。2.3 JTAG IPcore的实现JTAG IPcore是本调试器的核心，下面容易介绍一下该部分的实现。IPcore的接口3所示。该IPcore的对外接口由两部分组成：一是与Avalon总线通信的接口部分，即图中的左边部分;二是与被调试CPU通信的接口部分，即图中的右边部分。另外，在囫囵实现中，定义了一些重要的寄存器。“reg3000：Otms，tdo分离用来存放完成当前操作的tms序列和tdo序列。像拜访存储器这样的操作需要很长的tms序列和tdo序列，因此用了3001位。IPcore每次从这2个寄存器读取1位后，就向对应的引脚发送数据。td

13、i寄存器只用了134位，由于不是每个tdi输入对JTAG调试都实用。parmreg寄存器用来存放总线上传来的参数。tdidata寄存器用来存放从tdi引脚读取的有效数据，将被发送到Avalon总线。tdicolJnter寄存器用来对tdi输入数据计数。Avalon总线上来的命令发送到ins31：0端口。在调试器主程序里推断命令，做出相应的动作。当IPcore读取到某个命令后，按照指令代码查找对应的TMS指令序列，找到以后将指令序列送到tms寄存器。同时，通过parm31：O端口读取指令参数，按照指令参数生成对应的TDO序列，将其送到tdo寄存器。当两个寄存器的内容预备好后，在TCK时钟的控制下，通过TMS引脚和TD0引脚分离串行输出。在TDO引脚输出的同时检测TDI引脚，并在适当初机将TDI引脚上的数据读入IPcore，经过处理后发送回总线。因为TMS序列长度较长且其对应于各个调试指令是固定不变的，因此在本设计中，将TMS序列作成一个表，存放在IPcore里，而不是通过总线发送。需要时，按照不同的指令代码来读