静电放电(ESD)设计

1、静电放电(ESD)设计王洪博，高级工程师，副主任无线通信及安全与电磁兼容实验室工业和信息化部电信研究院Tele:2018; FAX:mail: 内容提要󰂄一、ESD问题二、ESD防护设计的通用原则三、TVS器件及使用方法四、无线便携式产品的ESD防护设计󰂄󰂄󰂄Adobe AcrobatDocumentMHTML 文档©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 2EMC设计流程 Adobe Acrobat Document EMC设

2、计审查 EMC设计审查 -Schematic -Schematic check check -Placement -Placement review review -Layout -Layout review review EMC设计验证 EMC设计验证 -In -In house house pre-scan pre-scan -EMI/ESD debug -EMI/ESD debug -Layout -Layout modify modify -Safety -Safety check check EMC验证 EMC验证 -In -In house house scan scan -3rd

3、 -3rd Lab. Lab. scan scan -EMI/ESD Verify -EMI/ESD Verify -Layout -Layout modify modify if if need need -Safety -Safety DOC DOC EMC确认 EMC确认 -EMI/ESD -EMI/ESD confirmation confirmation -EMC -EMC Certification Certification -Safety -Safety Certification Certification Regression Regression A2 A3 A4 A5

4、MP ©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳 Slide 5 ESD问题不断增加󰂄电路/系统󰂅󰂅过去-稳固的ICs 和低速信号现在-敏感的ICs 和高速信号过去-制造/ 公司现在-家庭/ 室外/ 个人󰂄环境󰂅󰂅Microsoft Word Document󰂄在ESD测试中可能会损坏一些器件ASIC󰂅无源器件󰂅半导体装置󰂅RF功放󰂅󰂄󰂄一些奇怪的失败施

5、加ESD火花引起󰂅󰂅󰂅掉话黑屏附件的一些奇怪现象󰂄在用户的口袋里、皮带卡子上会使移动台“充电”通过耳机或头戴式麦克风“放电”（耳朵里会感觉很有意思）󰂅向桌面上的物体或充电器放电󰂅在放电时的强电场作用下，移动台会功能性地失常󰂅©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 7ESD Issues for the Designer󰂅󰂅󰂅󰂅󰂅󰂅ϗ

6、173;󰂅Must meet ESD specificationsSelect ESD tolerant componentsMinimize signal degradation (from R,L & C)Board space / weight / proper designComponent costAssembly costLifetime cost (stability)Test the system©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 9无线产品ESD防护设计概述󰂄󰂄用户接

7、触的区域，如按键和I/O口易于受到ESD影响，因此需要保护。一种简单技术就是把电容放置于通信线来吸收ESD脉冲，它减低了信号速率，增加了驱动电流消耗。可以在板上采用放电器(spark gap)，放电器设计保证在ESD脉冲过程熔断，电流被分流引入大地。然而这种技术占用较大的空间面积，老化后导致ESD防护不可靠。MOV(metaloxide varistor)器件在高压时可以断开，可使用在响应时间较慢的应用中。然而，笨重与大电容使它们不适合防护信号线，另外的缺点是其老化特性。对于Zener二极管，尽管能够钳制给定电压下的大电流，但它产生有防护信号线不需要的寄生电容。相比之下，连接地和电源端的快速、

8、低容二极管是个很好的方案。它们可以处理大的峰值电流，具有很小的反向泄漏电流，可以抗多次ESD冲击而不损坏；它成功地把ESD脉冲从敏感保护器件引开，具有很长的寿命。然而，每一防护线需要一个二极管对。尽管每个器件的价格很低，总的安装成本和所需的空间使分离方案不适合。©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 13󰂄󰂄󰂄󰂄集成二极管防护网络©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 14优化ESD防护必须注意电路板的设计安装󰂄首先

9、，尽可能地减小ESD脉冲进入点与二极管保护网络之间的寄生电感，寄生电感将抗拒ESD脉冲电流的快速变化，使进入二极管网络的ESD电流流入被防护的器件。对此，设计者应该把二极管网络放置在电感与被防护器件之间，这在两个方面改善了ESD防护性能：电感抗拒了电流的快速变化，并在时间上扩展，降低了峰值电流；ESD脉冲被强制先通过二极管网络，进入后面器件的只有很少一部分脉冲。󰂄©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 15优化ESD防护必须注意电路板的设计安装󰂄󰂄󰂄󰂄其次，应避免电

10、源端上的电感。如果在网络与旁路电容之间存在大电感的话，网络将不能泄漏ESD脉冲。导致很高电压、快速上升ESD脉冲进入后面器件，采用尽量靠近二极管网络电源管脚的串联电容可以避免这个问题。通常0.1至0.2pF的电容就足够，大电容不一定提供最佳的ESD性能，特别是串联电感较高时。整个网络只要单个电容就可以。它不仅仅是限制电压，也限制流往后面的电流。如果被防护的器件对锁存现象较敏感，通过插入电阻限制输入电流，限制电流等于防护电压除以插入电阻。©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 16优化ESD防护必须注意电路板的设计安装󰂄第三，设计

11、者必须仔细考虑各种系统电源方案。在一些应用中，通信通道的一端在工作状态，而另一端在节电状态。在这种情况下，节电器件供电脚上的电压将下降到零(ground)，任何进入ESD网络的信号将使与供电脚相连的二极管正向偏置，导致电流长时间的流过二极管，引起电池泄漏或系统的损坏。在这种情况下，必须保证与电源相连的二极管在节电状态不吸收电流，这可通过放置一个外部二极管来实现。电容吸收ESD脉冲，在节电状态时，外部二极管关闭；这时，它不再吸收电流到ESD网络。整个网络只需要一个隔离二极管，所以成本增加很小。Microsoft WordDocument©CATR 王洪博：静电放电(ESD)设计；201

12、0年6月9日；深圳󰂄󰂄󰂄Microsoft Word DocumentSlide 17解决电荷注入问题的方法󰂄解决电荷注入问题的一个方法是在人体和电子器件之间放置一块绝缘屏障。只要这个屏障不被击穿，就不会发生放电。另一个方法是在人体与器件之间放置一块金属挡板。当然，这个金属挡板与器件之间必须有良好的绝缘，使它与器件之间不会发生放电。这时，静电放电事件是向金属板注入电荷，而不是器件。无论使用哪种屏障，静电场的问题都不能解决。使用金属挡板时的不同点是，当放电发生后，电场是在挡板和器件之间，而不是在人体和器件之间。要彻底解决静电场的问题

13、和电荷注入问题，必须将系统（包括电缆）完全包围起来，或者将金属挡板接地。当金属板与大地连接后，金属板上的电荷会泄放掉，从而消除静电场。将系统完全包围起来的金属壳体可以保证没有任何电场到达系统，即使壳体的外表面充满了电荷也没有关系。（这相当于系统中所有的设备都有金属外客，电缆也是屏蔽的场合）󰂄󰂄󰂄©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 18解决电荷注入问题的方法󰂄在前面的静电放电模型中，放电脉冲中的高频成分主要是由手、臂和键盘的电容产生的放电电流引起的。这些高频电流是金属板内的电荷再

14、分布电流。另外，在这个模型中，由人体对地电容形成的放电电流主要导致低频成分，并携带了大部分放电能量。这些低频电流是地通路电流。金属板上的高频再分布电流的物理路径取决于人体和金属板的位置，并呈现辐射状，如下面左图所示。人体上的低频放电电流的路径是选择一条电阻最小的路径直接到地，如下面右图所示。当然这个描述是近似的，实际情况要更复杂一些。在了解放电电流的路径和频率的基础上，可以分析它们对电子系统性能的影响。在本例中，低频电流被旁路到地，因此键盘和系统的其它部分可以免受这种高能电流的损害。对于设计而言，防止电荷注入和损坏是最基本的要求。但是，这些电流（特别是高频电流）产生的场仍然会有严重的影响。&#

15、983172;󰂄©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 19解决电荷注入问题的方法󰂄静电放电的辐射状电流󰂄流向地的静电放电电流©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 20解决电荷注入问题的方法󰂄在分析静电放电的影响时，还要记住，场不仅对系统内的电路会产生直接的影响，而且还会产生间接的影响。这是通过场在导体上感应出电流或电压，然后导体将电流或电压传导到场本身达不到的地方产生的。一个典型的例子是场在电缆屏蔽层上感应出电流。如果电缆屏蔽层

16、没有良好端接，感应电流会穿进本来屏蔽良好的机壳。这时，尽管原始的场不能穿透机壳，但通过电缆上的感应电流，场还是会对机壳内的电路造成影响。另一个需要注意的问题是共模噪声会转化为差模噪声。这一点很重要。因为如果共模噪声在整个系统中都保持共模形态，则对系统的实际影响很小。不幸的是，由于幅度、相位和频率成分的变化不同，原始的共模噪声总是会在系统的某一点变为差模噪声。例如，如果电缆中每一条线端接方式不是完全相同，电缆上的共模噪声会在电路输入端变为差模噪声。󰂄©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 21固件和软件设计󰂄

17、83172;在对付静电放电方面，除了众所周知的硬件方法以外，固件和软件也起着重要的作用。虽然固件设计不能防止系统中器件的损坏，但是能够有效地避免一些非永久性的损坏。通过适当写入的固件，不可恢复的设备故障（死锁）通常可以避免，可恢复的故障也可以减少10倍。如同硬件上的静电放电措施一样，抗静电放电的固件也是有代价的。通常，程序会更大一些，这意味着需要更长的编程时间和存储单元。权衡得失时，要将这种代价与单纯依靠硬件解决静电放电问题时的成本做对比。在许多微处理器的应用中，固件措施的成本要比硬件低。在编写静电放电抗扰性强的固件时一定要树立的的一个观念是“不确定性”。也就是，一定不能认为端口、寄存器等的状

18、态是一定的。例如，当使用一个索引寄存器时，应该问一下，如果这个索引发生错误时，会发生什么问题。如果仅是仅发生一些暂时的或无关紧要的问题，如发光二极管闪烁，则不需要什么特殊的处理。如果会发生很严重的问题，例如系统发生死锁，则必须采取措施来避免问题的发生。固件（软件）静电放电措施可以分为两类：刷新󰂅检验和重新写入󰂅󰂄󰂄󰂄©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 22刷新󰂄进行刷新时，程序员不关心过去的情况，而仅是用确定的数据来保证今后的状态。当端口用于串行

19、数据输出时，刷新停止位的电平。刷新锁存器和端口输出状态。定期读取控制和选择输入，保证系统工作在适当状态。在进行刷新时，另一个需要考虑的因素是刷新的顺序。有时，刷新的顺序十分重要。例如，在同步输入/输出中，数据线一定要在时钟线之前刷新。否则，经过刷新的时钟会使数据位丢失。如前所述，一定要考虑在错误条件下每条指令的顺序。󰂄󰂄󰂄󰂄©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 23检验和复位󰂄有时，单纯刷新还是不够的。在有些情况下，刷新甚至会掩盖一些严重的问题。在这些情况下，寄存

20、器、端口等需要通过检验来确认其状态。如果状态不对，程序应该试图对其进行更正。进行复位（或初始化）时一定要非常谨慎。虽然系统的状态可能有疑问，但是将系统彻底初始化并不是一个好方法。这会丢失所有过去的数据。应该遵守的原则是，使系统处于最可能的状态，而这个状态应该使问题的危害最小。如果有些关键的项目没有最可能的状态，则应该将其状态保留起来。这便于以后采用投票的方式来确定当前状态。通常，“3取2”的投票方式就可以了。检验函数通常可以分为3类。特别要做以下检验，如果发现错误，需要初始化。󰂄󰂄©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Sl

21、ide 24A) 检验程序流是否正确󰂄󰂄在主程序中，在子程序返回前，要定期检验子程序堆栈指针，以确认子程序在预定的范围内运行。如果不检查堆栈指针（或在检查堆栈指针的基础上），可以使用“标牌”来帮助发现程序运行中的问题。当进入一个子程序时，保存标牌，当离开子程序时，检查这个标牌。在禁用区域中安排“陷阱”码，例如编码表或无用的中断矢量。当程序要执行这些码时，就被抓住（例如在未使用的表格中安排返回指令）。为了检查程序流是否正常，在程序中还应该包含以下两个子程序：󰂅󰂅󰂄󰂄为了确认主程序运行正常，应该有一个永

22、远不会停止和失效的计时程序。主程序应定时检查上面的定时程序，确认其是否运行正常（如果微处理器没有内置的计时器，可以使用外置的硬件“看门狗”电路。当处理器没有按时将计时器复位时，外置电路会将处理器复位）。©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 25B) 检验存储的数据和信息是否正确󰂄定期对保留的项目进行表决，如果没有一致性，进行初始化。特别，状态标志（特别是使能标志）要保留有备份。除了备份以外，还可以使用纠错码。对于索引和其它一些十分重要的寄存器，在使用其所存储的数据之前，要对其数值或范围先进行检查。如果关键数据很多而不适合备份，

23、或者无法检验所有信息时，可以用检验和或周期性冗余检验（CRC）来对数据块检验。󰂄󰂄©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 26C) 对输入和输出进行检验󰂄󰂄󰂄󰂄󰂄利用各种方法，如奇偶校验、检验和等，对输入进行检验。确认输入数据的合理性，有些数据可能有明显的错误。对所有输入级电平至少取样两次以实现对噪声的“软件滤波”。通过使接收机响应输出级来进行校验输出端。接收装置应能识别所有有效的输入信号，如果接收装置不能识别，那么发送装置应具有再传

24、输能力。©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 27否则要求能自动恢复󰂄这种恢复能力通常不能与加电（或硬件）复位过程中的初始化程序不同，RAM不应清除掉。实际上，由于静电放电（ESD）而使错误程序反向复位时，执行硬件初始化程序不应妨碍处理器的工作。这通常可以通过检查执行硬件复位程序的标志寄存器的优先级来完成。如果已经设定标志，则应避免完全复位。当主程序执行时，此标将被重新设定，一般仅被处理器的实际硬件复位所清除。特别地，通常应按以下步骤来完成复位：󰂅󰂅󰂅󰂅ϗ

25、173;󰂅󰂅󰂅󰂅复位子程序堆栈指针。复位FIFO指针。复位计数器。阻止可疑码的传输。在复位完成时才允许中断，然后再重新启动计数器。复位中断不确定的标志刷新输出。如果主机系统接受复位，最好使其发磅一代码以通知复位已完成。那么，主机就可以采取措施来确保系统的所有部分都谐调一致地工作。当然，复位程序必须清除引起复位动作的具体问题。©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 28ESD的硬件解决󰂄静电放电效应划分成以下三个部分：󰂅󰂅𘀍

26、3;静电放电之前静电场的效应放电产生的电荷注入效应静电放电电流产生的场效应󰂄尽管PCB的设计会对上述三种效应都产生影响，但是主要是对第三种效应产生影响。下面的讨论将针对第三条所述的问题给出设计指南。通常，源与接收电路之间的场耦合可以通过下列方式之一减小󰂅󰂅󰂅󰂅󰂅󰂄在源端使用滤波器以衰减信号在接收端使用滤波器以衰减信号增加距离以减小耦合降低源和/或接收电路的天线效果以减小耦合采用一致的、低阻抗参考平面（如同多层PCB板所提供的）耦合信号，使它们保持共模方式©CATR 王洪博：

27、静电放电(ESD)设计；2010年6月9日；深圳Slide 29保持环路面积最小󰂅任意一个电路回路中有变化的磁通量穿过时，将会在环路内感应出电流。电流的大小与磁通量成正比。较小的环路中通过的磁通量也较少，因此感应出的电流也较小，这就说明环路面积必须最小。应用这一经验的困难之处是如何找到环路。©CATR王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 30使导线长度尽量短󰂄较长的导线将有利于接收静电放电脉冲产生的更多的频率成份；而较短的导线只能接收较少的频率成分。因此，短导线从静电放电产生的电磁场中接收并馈入电路的能量较少。使导线尽可能

28、短是一个比是环路面积尽量小更容易实现的措施。因为它不象信号环路那样不容易识别，环路面积的尽可能小不可能立即看到，而导线的长短则是很显然的。有关设计步骤如下：󰂅󰂅󰂅a) 使所有元件紧靠在一起，PCB设计人员不应将元件过于分散而占用更多的面积；b) 在相关的元件组，相互之间具有很多互连线的元件应彼此靠得很近。例如，I/O器件是与I/O连接器尽量靠得近些；c) 如有可能的话，从线路板的中心馈送电源或信号，而不要从线路板边缘馈送，如图27所示，中间的馈送信号使大多数元件的连线最短。当线路板为正方形时，这样做的效果最明显，当线路板狭长时，效果则不很明显。但

29、只要可能，还是应该尽量这样做。©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 31尽可能在PCB上使用完整的地线面󰂄󰂄建议采用多层板地线面作为一个重要的电荷源，可抵消静电放电源上的电荷，这有利于减小静电场带来的问题。PCB地线面也可作为其对面信号线的屏蔽体（当然，地线面的开口越大，其屏蔽效能就越低）。另外，如果发生放电，由于PCB板的地平面很大，电荷很容易注入到地线面中，而不是进入到信号线中。这样将有利于对元件进行保护，因为在引起元件损坏前，电荷可以泄放掉。（然而，即使泄放到地的电荷也可能损坏器件，应采取措施加以避免）&

30、#983172;󰂄©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 32加强电源线和地线之间的电容耦合󰂄电源线与地线间的耦合通过两种方式来实现。A、使电源线与地线靠得很近，或采用多层PCB板。这将在电源线和地线间产生更多的寄生电容。󰂅B、在电源线与地线之间接入高频旁路电容（电容组合方式可适用于静电放电频率较低和较高的场合）。电源线与地线间的耦合将有助于减小电荷注入问题。两个物体之间由各个物体上电荷量的差异造成的电压取决于两者（V=Q/C）间的电容。如果X库仑的电荷注入到电源线中，就会在电源线和地线间产生Y伏

31、的电压。如果电源线与地线间的电容增加一倍，X库仑的电荷将仅仅产生Y/2伏的电压。当然，这个较小的电压造成损坏的可能性也相应减小。󰂅©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 33隔离电子元件与静电放电电荷源󰂄在静电放电效应的讨论中，曾指出注入到电子仪器中的电荷可通过隔离来解决。对于PCB设计，这主要指将电子仪器与可能的电荷源隔离开，也与连接器端口或感应电流趋于集中的信号线相隔离。可采取以下两个步骤来进行隔离：A、使电子元件与PCB走线远离会暴露在静电放电中的PCB部分（例如，操作人员可直接触摸到的地方）。♧

32、73;B、使电子元件和PCB走线远离会暴露在静电放电中的任意一个金属物体（包括螺钉、机架、连接器外壳等）。后一个要求小于下面的设计规则相关联。󰂅©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 34PCB上的机壳地线的阻抗要低，隔离要好󰂄尽管PCB轨线上的阻焊层有利于隔离PCB走线，但阻焊层可能会导致插针孔发生电弧。A、隔离机壳地线的最好方法是使之远离电子仪器。另外，如果机壳地线的阻抗很低，静电放电电流易于通过，就不会发生电弧。当然，如此迅速的电荷泄放会产生更强的场，但这比电荷通过电弧直接注入到电路中好得多。𘀍

33、3;B、机壳地线的长度不能超过其宽度的四或五倍。比这个比例更宽的地线仅能使其阻抗（电感）稍微减小，但是更窄的地线却会使其阻抗大幅度增加。这个长宽比例意味着机壳地线必须很短才行，否则当地线增长时，其宽度要很宽。󰂅©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 35ESD常见问题与改进©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 36©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 37电缆上的ESD防护©CATR 王洪博：静电放电(ESD)设计；

34、2010年6月9日；深圳Slide 38键盘与控制面板的设计©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 39Adobe AcrobatDocumentAdobe AcrobatDocument瞬态干扰保护器件C:Documents andingsHB桌面TVS Adobe AcrobatDocumentMicrosoft Word Document󰂄(1) 两只对置的箝位二极管。使用2只二极管的目的是为了同时抑制正、负极性的瞬态电压。(2) 压敏电阻保护电路。压敏电阻的阻值随两端电压变化而呈非线性变化。此物理现象类似稳压管的齐纳击穿

35、现象，不同的是压敏电阻无电压极性要求。使用压敏电阻保护电路的特点是简单、经济、瞬态抑制效果好、对电路带来的负面影响甚微，且可以获得较大的保护功率。(3) 稳压管保护电路。背对背串接的稳压管对瞬态抑制电路的工作原理是显而易见的。当瞬态电压超过V1的稳压值时，V1反向击穿，V2正向导通；当瞬态电压是负极性时，V2反向击穿，V1正向导通。将这2只稳压管制作在同一硅片上就制成了稳压管对，使用更加方便。(4) TVS二极管。这是最近发展起来的一种固态二极管，专门用于ESD保护。一般选择工作电压大于或等于电路正常工作电压的器件。TVS二极管是和被保护电路并联的，当瞬态电压超过电路的正常工作电压时，二极管发

36、生雪崩，为瞬态电流提供通路，使内部电路免遭超额电压的击穿或超额电流的过热烧毁。由于TVS二极管的结面积较大，使得它具有泄放瞬态大电流的优点，具有理想的保护作用。但同时必须注意，结面积大造成结电容增大，因而不适合高频信号电路的保护。©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 43󰂄󰂄󰂄Coils󰂄Higher inductance possible thanwith ferrite beadsHigh Q factor possible for use in RF designLarge

37、r devices used in switched mode power supplies or even as common mode chokes for low frequenciesImmune to ESDDC current limit󰂄󰂄󰂄󰂄Vendor Examples: Coilcraft©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 48Varistors Varistor is a bipolar component that is used for ESD and

38、 voltage surge suppression. In 1999 they are made in size 0402 and bigger. Varistors have capacitance ranging from 3pF up to 47nF. You can use this capacitance as part of RF filter. 0402, 14V/120pF Printed Electrode of the multilayer structure Zinc oxide Microvaristor V 3,5 V i 100 uA Intergranular

39、boundary Printed Electrode of the multilayer structure Vendor Examples: AVX, EPCOS Slide 53 ©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳 Integrated Passives, ExistingMurata ferrite bead/capacitor T-filters,capacitor could be made of varistormaterial as well.Very small models are not yetavailable.ST-Micro

40、electronics and Philips makequad zeners(also bi-polar).Capacitance may be high for fastsignals.May demodulate audio.©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 56ESD Protection Techniques󰂄Clamp diodes in IC󰂅Not sufficient protectionLow effectivenessCan degrade signal; many component

41、s; large board area Low cost; low stability; large board areaHigh capacitance, many components; large board areaLow capacitance; many components; large board area 󰂄Shielding 󰂅󰂄Bypass capacitor or series resistor/inductor󰂅󰂄Spark gap󰂅󰂄Discrete Ze

42、nerdiodes󰂅󰂄󰂄Discrete PN diodes󰂅Integrated PN diodes©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 57Integrated Diode Networks󰂄Superior downstream ESD protectionHigh speed response󰂅ESD current steered to GND or VCC󰂅󰂄󰂄󰂄ϗ

43、172;󰂄Minimum Signal Degradation (Low C)Minimal board space, weightLow assembly/manufacturing costsMinimal Design-In TimeLong-term reliability©CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 58Choosing an ESD Diode Network󰂄󰂄󰂄󰂄How many lines are needed? How much cap

44、acitance? (e.g. < 5 pF)What is the HBM rating? (e.g. ±15 kV)What is the downstream clamp voltage?(e.g. 13 V 15 kV HBM pulse)What is the contact discharge rating?(e.g. ±8 kV)What is the air discharge rating? (e.g.±15 kV)What package? (e.g. 24-pin QSOP)󰂄󰂄󰂄

45、9;CATR 王洪博：静电放电(ESD)设计；2010年6月9日；深圳Slide 59Component and System Specifications󰂄There is no simple formula to translate systemspecifications into component specifications󰂅󰂅󰂅󰂅󰂅IEC 1000-4-2 Specification is more severe than HBMLine capacitance and inductance shape the ESD pulse, reducin