FPGA应用开发智慧树知到课后章节答案2023年下上海电力大学

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第一章测试

VerilogHDL的抽象分层建模方式可划分为系统级和算法级建模方式、寄存器级建模方式、逻辑门级建模方式和晶体管开关级建模方式。（）

A:错B:对

答案:对

VerilogHDL是唯一一种硬件描述语言。（）

A:错B:对

答案:错

以下哪些属于可编程逻辑器件（）

A:PAL

B:GAL

C:CPLD

D:FPGA

答案:PAL

;GAL

;CPLD

;FPGA

以下哪些是FPGA和CPLD的相似点（）

A:可采用VerilogHDL进行电路设计

B:器件密度可达到上千万门

C:可编程逻辑器件

D:采用SRAM工艺

答案:可采用VerilogHDL进行电路设计

;可编程逻辑器件

以下哪些是SOPC的基本特征（）

A:单芯片

B:低功耗

C:至少包含一个嵌入式处理器内核

D:可能包含部分模拟电路

答案:单芯片

;低功耗

;至少包含一个嵌入式处理器内核

;可能包含部分模拟电路

第二章测试

如果线网类型变量说明后未赋值，起始缺省值是()

A:1

B:x

C:z

D:0

答案:z

reg[7:0]mema[255:0]正确的赋值是()

A:mema[5]=3’d0,

B:8’d0;

C:4’bxx11

D:4’bzz11

答案:mema[5]=3’d0,

“a=4`b11001,b=4’bx110”选择正确的运算结果（）

A:b&&a=x

B:b&a=x

C:a&b=0

D:a&&b=1;

答案:a&&b=1;

下列标识符中，（）是合法的标识符。

A:$finish

B:8_sum

C:adder8#

D:_date

答案:_date

下列语句中，不属于并行语句的是（）。

A:case语句

B:assign语句

C:元件例化语句

D:过程语句

答案:case语句

第三章测试

阻塞性赋值符号为＜=，非阻塞性赋值符号为=。()

A:错B:对

答案:错

某一纯组合电路输入为in1,in2和in3,输出为out,则该电路描述中always的事件表达式应写为always@(in1,in2,in3);（）

A:对B:错

答案:对

若某一时序电路由时钟clk信号上升沿触发,同步高电平复位信号rst清零,该电路描述中always的事件表达是应该写为always@(posedgeclkorrst)。()

A:错B:对

答案:错

VerilogHDL中内置了12种类型的基本门级元件模型。（）

A:错B:对

答案:对

bufif0是VerilogHDL中内置的基本门级元件：控制信号高电平有效的三态缓冲器。（）

A:错B:对

答案:错

第四章测试

状态机常用状态编码有顺序编码、格雷码和独热码三种。（）

A:对B:错

答案:对

电路输出与电路输入有关的有限状态机电路被称为moore机。（）

A:对B:错

答案:错

采用有限状态机设计，易于构成性能良好的同步时序逻辑，有利于消除大规模逻辑电路中常见的竞争冒险现象。（）

A:对B:错

答案:对

有限状态机的代码可采用一段式、二段式和三段式描述方法。（）

A:对B:错

答案:对

有限状态机的三段式描述指包含三个always模块。（）

A:错B:对

答案:错

第五章测试

评价Verilog代码的优劣不在于代码段的整洁简短，而在于代码是否能由综合工具流畅合理地转换成速度快和面积小的硬件形式。（）

A:对B:错

答案:对

异步设计非常容易产生毛刺现象和亚稳态。（）

A:对B:错

答案:对

使用双斜杠进行的注释行以分号结束；使用/**/进行的注释，/*和*/各占用一行，并且顶头。（）

A:错B:对

答案:对

相同功能的电路采用的代码风格不同，最终综合后的RTL电路结构依然是相同的。（）

A:对B:错

答案:错

以下信号名中，最具可读性的是（）

A:add1

B:addr_count

C:addr11

D:addr_1

答案:addr_count

第六章测试

Testbench的主要功能是（）

A:为设计电路提供激励信号；

B:将仿真数据显示在终端或存为文件，也可以显示在波形窗口中以供分析检查；

C:复杂设计可以使用EDA工具，或者通过用户接口自动比较仿真结果与理想值，实现结果的自动检查。

D:正确例化设计电路；

答案:为设计电路提供激励信号；

;将仿真数据显示在终端或存为文件，也可以显示在波形窗口中以供分析检查；

;复杂设计可以使用EDA工具，或者通过用户接口自动比较仿真结果与理想值，实现结果的自动检查。

;正确例化设计电路；

以下哪些系统任务实现文本输出（）

A:$monitor。

B:$strobe；

C:$write；

D:$display；

答案:$monitor。

;$strobe；

;$write；

;$display；

以下哪些系统函数实现读取当前仿真时间（）

A:$htime。

B:$stime；

C:$time；

D:$realtime；

答案:$stime；

;$time；

;$realtime；

系统函数和任务一般以符号#开头。（）

A:对B:错

答案:错

$write与$display相同，不同的是不会自动换行.（）

A:对B:错

答案:对

第七章测试

Altera公司的QuartusII和公司的ModelSim是两种目前世界上比较流行和实用的EDA工具软件。（）

A:对B:错

答案:对

QuartusII可以采用文本输入法和图形输入法进行电路设计。（）

A:对B:错

答案:对

根据下面的程序，

always@(posedgeclk)

begin

q0＜=~q2;

q1＜=q0;

q2＜=q1;

end画出综合出来的电路图如图所示。

（）

A:对B:错

答案:对

分析下列程序，得到10时刻执行结果a=1，15时刻b=1，20时刻c=1。

initial

fork

#10a=1;

#15b=1;

begin

#20c=1

#10d=1;

end

#25e=1;

Join

（）

A:错B:对

答案:对

选择下面两段代码正确的一个。（）

A:

moduleexample(o1,o2,a,b,c,d);

inputa,b,c,d;

outputo1,o2;

regc,d,o2;

andu1(o2,c,d);

always@(aorb)

if(a)o1=b;elseo1=0;

endmodule

B:

moduleexample(o1,o2,a,b,c,d);

inputa,b,c,d;

outputo1,o2;

rego1;

andu1(o2,c,d);

always@(aorb)

if(a)o1=b;elseo1=0;

endmodu