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文档简介

XilinxXilinx1、打开Vivado2015.4,“CreateNewProject”,3“Next”,“Create4“Next”,“RTLProject”5“Next”7“Next”Summary8“Finish”9“FlowNavigator”“ProjectManager”“AddSources”,在弹出的窗口中选择“Addorcreatedesignsources”。10“Next”,“CreateFile”,“counter”11“OK”,“Finish”12“OK”,“Yes”13“Sources”“DesignSources”“counter.v”16“FlowNavigator”“ProjectManager”“AddSources”,在弹出的窗口中选择“Addorcreatesimulationsources”,点击“Next”。17“CreateFile”,18“OK”,“Finish”19“OK”,“Yes”20“Sources”“SimulationSources”,21“FlowNavigator”“Simulation”“RunSimulation”,247ms“Break”“ZoomFit”,将6ms“OK”,关闭仿真界面。25“FlowNavigator”“Synthesis”“RunSynthesis”。右上角的进度条“Runningsynth_design”指示正在对工程进行综合。26“OpenSynthesizedDesign”,“OK”,打27“I/OPorts”“I/OStd”一栏通过下拉按钮选择“LVCOMS33”,3.3V。28“Site”FPGA30“FileName”“flash_led_top”,31“OK”“SynthesizedDesign”32、在“Sources”窗口中的“Constraints/constrs_1”下双击“flash_led_top.xdc”,打开33“SynthesisOut-of-date提示需要重新进行综合。在“FlowNavigator”一栏中的“Synthesis”下点击“RunSynthesis”。34“RunImplementation”,“OK”,进入实“Cancel”“FlowNavigator”“Implementation”下点击“RunImplementation”。bit35“GenerateBitstream”,“OK”。这一过FPGA。“Cancel”“FlowNavigator”“ProgramandDebug”下点击“GenerateBitstream”。36“OpenHardwareManager”“OK”37MicroUSBJTAG“HardwareManager”界面点击“Opentarget”,选择“AutoConnec

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