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文档简介

2023/5/24计算机接口技术1第13章基于FPGA的接口电路设计本章主要内容

接口电路实现的技术趋势

FPGA设计基础

用VerilogHDL进行电路设计

并行接口8255A的FPGA设计13.1接口电路实现的技术趋势

●传统接口设计:专用接口芯片(8251,8255,

USB,PCI等)●现在接口设计:FPGA●基于FPGA接口设计的优点2023/5/24计算机接口技术2灵活性大通用性强功耗低、速度快、集成度高13.2FPGA设计基础

13.2.1FPGA的工作原理●FPGA利用一种称为查找表(LUT)的结构实现反复烧写●用户通过原理图或HDL语言描述逻辑电路,FPGA会自动计算逻辑电路的结果,把结果存入LUT中。●输入逻辑信号时就相当于输入一个地址在LUT中查找,找出结果。2023/5/24计算机接口技术34输入“与”门的实例2023/5/24计算机接口技术4图13.1输入“与”门实例对图13.1的几点说明

●LUT的值存入SRAM中或Flash中。●利用地址作为索引,在LUT中查找值。●完成的功能与实际电路等价,具有更快的执行速度、更大的规模。●Xilinx和Altera公司的FPGA是基于SRAM的,掉电后内部逻辑消失,用户需要添加一个外存储器来存储程序。2023/5/24计算机接口技术513.2.2FPGA的设计流程FPGA的设计流程如图13.2所示。

2023/5/24计算机接口技术6电路功能设计设计输入功能仿真综合优化综合后仿真实现与布线时序仿真板级仿真芯片编程与调试图13.2FPGA的设计流程13.2.3FPGA的开发工具●Xilinx的ISE:ISE是Xilinx公司的FPGA/CPLD综合集成设计平台,界面友好,操作简单。ISE提供了包括代码编写、库管理、HDL综合、仿真、下载等几乎所有FPGA开发所需的工具。

●Xilinx的Vivado:Vivado是全新的另一个XilinxFPGA开发工具,是为高端FPGA专门开发的一款开发工具。

2023/5/24计算机接口技术7ViVado相比ISE,有着显著的进步,主要表现在以下几方面。

2023/5/24计算机接口技术8强调以IP为中心的系统设计思想。允许设计者在多个方案中探索最优的实现方法。提供了更高效的时序收敛能力。提供设计者对FPGA时序、布局布线的高效控制能力。提供了高级综合工具VivadoHIS,用户可以用高级语言对FPGA建模。13.3采用VerilogHDL进行电路设计13.1HDL简介HDL语言用文本形式来描述电子系统硬件电路的行为、结构、数据流,数字电路的设计者可以从顶层到底层描述自己的设计思想。主要特征:

2023/5/24计算机接口技术9兼具一些高级语言的结构形式和硬件线路的具体结构。HDL语言是并行处理的。使用结构级行为描述,可以在不同的抽象层次描述设计。具有时序的概念。学习HDL时需要注意的地方

2023/5/24计算机接口技术10了解HDL的可综合性问题。用硬件电路设计思想来编写HDL。语法掌握贵在精,不在多。13.3.2VHDL与VerilogHDL的比较●相同点

2023/5/24计算机接口技术11都能形式化的抽象表示电路的行为和结构。支持逻辑设计中层次与范围的描述。可以简化电路行为的描述。具有电路仿真与验证机制。便于管理和设计重用。2023/5/24计算机接口技术12与VHDL相比,VerilogHDL最大的优势在于它非常容易掌握,只要有C语言的编程基础,就很快能够掌握;VHDL不是很直观,需要有Ada的编程基础,一般需要半年以上的专业培训才能掌握。一般认为VerilogHDL在系统级抽象方面比VHDL略差些;在门级开关电路描述方面VerilogHDL要强的多。

VHDL适合特大型的系统设计;VerilogHDL较为适合系统级、算法级、寄存器传输级、逻辑级、门级和开关级的电路设计。●不同点13.3.3基于HDL的电路设计方法●传统上使用自底向上的设计方法,即:器件选择模块设计模块间综合系统仿真。这样只有在后期才能发现系统设计的问题,导致修改麻烦。●利用HDL进行电路设计采用自顶向下的设计方法,对系统不断划分成小模块,直到可用EDA元件实现为止。利用硬件描述语言对设计的模块进行描述和定义,结合多层仿真技术,在确保设计可行性的条件下完成系统的设计。这种设计方法的好处是在每一层都进行仿真,能够及时发现设计错误,减轻设计成本。

2023/5/24计算机接口技术1313.3.4VerilogHDL的模块结构例13.1二路选择器的Verilog实现,如图13.3所示。

2023/5/24计算机接口技术14as1bout图13.3二路选择器13.3.4VerilogHDL的模块结构模块和说明

2023/5/24计算机接口技术15modulemux21(out,a,b,s1)inputa,b,s1;outputout;regout;always@(s1oraorb)if(!s1)out=a;elseout=b;endmodule●输入端口:a,b,s1,默认1位,wire数据类型;●输出端口:out,默认1位,reg数据类型;●模块定义包括:端口定义、IO说明、内部信号说明和功能定义。

13魔.3较.5Ve么ri易lo搅gHD轨L语言敌的描植述方令法●结构猫化描肠述是通搭过元他件实肉例进词行描硬述的渐方法翼,就蛮像在浆电路盘图输元入方村式下虎调入愤库元晴件一构样,叉键入张元件诞的名咬称和秋相连笛的引弯脚即劲可。●例化日语句:使吓得一弓个模慌块能丙够在丢另外焦一个吐模块懂中被适引用睬。其宋格式奴是:模块滔名办实例获名(殊端口电关联叨);●端口指关联至:指明凤了模泽块和做外部糕端口繁信号,模块绿和模越块之哄间的替连接丙。其资格式粪是:连接佛信号铜名//通过橡位置.端口违名(六连接桌信号爪名)//通过沾名称20阻23慨/5兰/1狗8计算壤机接纪口技毕术16例13攻.2三路厕选择纹器的倦例化东设计三路汤选择设器如字图1炎3.早4所荣示。20络23袋/5踪蝶/1转8计算帖机接屈口技历术17abs1ou绍tabs1ou陕tU1U2ya2a3s0s1a1tm凡p图13小.4三路锐选择耳器模块压定义其和说抢明20傲23锤/5狐/1残8计算接机接狐口技甜术18mo污du宵le掠m慨ux趟31(y,a1,a2,a3吵,s芽0,毛s1)in构pu什t作a观1,剑a酬2,a3驾,s挨0,季s1希;ou愈tp魂ut凤y;re曾gy;wi贤retm饭p;mu秀x2晋1桥U衫1(tm捏p,a2穗,a督3,厅s0替);mu布x2腥1缴U卸2(.o舅ut洒(y彻),.a司(a概1)指,.b猾(tm身p),.s非1(蜡s1返));en币dm吩od执ul士e●实例毛化U1采用浑的是星位置住关联宣。●实例拒化U2采用花的是匠名称倚关联。13臣.3芒.5Ve紧ri门lo广gHD纠L语言梁的描组述方前法数据太流描速述形耀式就是严用as赏si役gn连续狸赋值今语句咬描述豆电路茶或系航统中景信号擦的传括递关下系。as谱si款gn语句践是并烛行语乏句。连续邪赋值妖语句私将值摆赋给捕线网阁。格式:as答si集gnLH短S_锋ta禁rg象et=RH扛S_呀ex认pr呢es擦si球on右边厨的值援受监蜻控,宁一有兔变化协就重班新计土算,剪结果枝值有傍变化展,就荐赋给禽左边并。例如:wi伙re谷[灾3:没0]如Z揭,活Pr烧es昼et号,谈Cl益ea牵r;as慎si曾gn歼Z那=兼P案re估se涛t盆&糕Cl庙ea纲r,在没有捷定义棵时延余的情岔况下村右边买的值栽立即寺赋给柜左边唇。20铺23膨/5宗/1盛8计算病机接隔口技犯术19数据桨流描帐述形籍式显式套定义卡时延着的例缎子例如:as渗si提gn似#释6送As殃k玻=妈Qu沃ie眠t||La鲁te续;表示单计算虾结果孝后经宴过6个时造间单爆位之事后进搂行赋触值。如图13慌.5所示温,时雁刻5横La汉te发生浴变化党,时冲刻11赋值汤给As杂k。20着23垄/5稀/1墙8计算窜机接与口技黎术20图13叶.5连续植赋值房诚语句耕中的隔时延●定义泳时延接的语席法可以逃定义际三类注时延扩值:上升猪时延山,下跳降时拒延,锹关闭弊时延犹。语涛法如忽下:●如何坊灵活烈利用貌时延20舌23栏/5日/1蛛8计算旋机接哨口技喘术21as聚si工gn封#挂(购ri跃se滋,哪fa良ll夕,谨tu回rn话-o唱ff容)LH拜S_估ta迟rg岩et=RH薪S_叨ex父pr圣es膊si凉on;as翼si烦gn陆#渴4系As乌k喜=矩Qu沙ie坝t拔||窃L使at成e;as准si顺gn欧#休(堆4,坊8)辜A底sk须=荐Q酱ui祥ck年;as塑si慨gn狗#私(扫4,余8,驳6)Ar兔b=皆&Da慕ta腿Bu铜s;as炎si档gn庙B圆us思=Me扮mA什dd呜r[7惕:4挣];例13祝.33-碎8译码贯器的槽电路围设计3-叫8译码如器的践代码宇模块饮如下叠:20充23泪/5无/1骆8计算校机接库口技但术22mo颤du璃le堆d望ec绢od高er割3x榨8(a,辽b,嚷c,航en乱,z);in从pu伏ta,滨b,弯c,柜en;ou腾tp少ut誉[洗0:仇7]飘z点;wi故reno持ta猪,n鹿ot性b,剩no雾tc;as互si项gn前#唇1枣n相ot赠a达=号~a谱;as音si剑gn沙#邪1no袭tb=踪蝶~b增;as狐si骄gn封#宏1no卖tc=元~c惠;as贸si宏gn至#虎2吨z绣[0仁]牵=度no崭ta茅&no顶tb&no准tc&僻en队;as帮si宾gn袋#汪2休z怜[1渐]糊=攻a鹅&no杯tb&no营tc&杠en芒;as化si焰gn艇#听2提z窃[2扬]误=欠no竭ta桐&捞b幅&no休tc&盒en画;as吊si只gn种#壤2顾z食[3至]吴=翁a敏&指b唯&no司tc&拉en卵;as惰si保gn余#幻玉2平z渡[4透]鉴=开no辫ta取&no春tb&挨c敌&复en纺;as爹si沿gn躺#快2治z还[5钳]名=从a院&no地tb&赚c充&鱼en疤;as极si忍gn鸟#谊2妈z肾[6恢]架=撇no划ta沈&住b颈&肚c跪&笔e拘n;as冠si路gn奴#芝2碗z虏[7缝]霸=绝a云&猜b烂&匠c春&也en夹;en猎dm冤od首ul膏e行为想描述魄形式●行为允描述翅形式就是萌使用in碑it盖ia却l和al絮wa乳ys语句驶来设懒计行衬为建悼模。●in掠it穷ia有l语句便:只执射行一口次,炊在时送刻0开始倒执行惕,若伴有两报个in控it杆ia技l语句岭,则樱在时睛刻0并行比执行深。●in蓄it倚ia神l语句柳的格北式:20镇23遣/5津/1集8计算查机接千口技仪术23in坚it暂ia辱l脊b直eg馋in歉/f虹or肝k块内历变量哈说明时序词控制1行为伞语句1;时序肝控制2行为布语句2;……时序址控制n行为权语句n;//可以励是时裳延控签制或售事件穴控制en辞d/浙jo屋in例13海.4带有卧顺序纵过程惜的in旨it伸ia犁l语句例子长程序目和运座行时po锯rt宋_A值的谱变化兽情况槽如图13蛙.6所示轿。20顾23盖/5陡/1修8计算跪机接悄口技稿术24pa街ra切me乌te滋r存AP守PL粮Y_伏DE揭LA塑Y诵=端5;re游g[歌0:手7]睬po纯rt拖_A节;.运.栽.in钢it谱ia处lbe娘gi头nPo掉rt踢_A='短h2常0;#A少PP悄LY病_D邮EL购AYPo巩rt夸_A=检'h压F2验;#A寒PP邀LY验_D此EL滔AYPo畅rt尖_A=铜'h氧41陷;#A孕PP拥LY趟_D蛮EL形AYPo搬rt四_A=收'h苹0A跟;en躁d图13焰.6使用in届it按ia亭l语句块产生拦的波米形al岭wa察ys语句纵(可莲以循匠环执序行)●格式●几点残说明20哪23终/5纪/1宜8计算红机接悟口技盈术25al陈wa早ys拨@(敏绣感事晌件列甩表)be荡gi悲n/镇fo辆rk块内教变量弹说明时序逮控制1行为灰语句1;时序裳控制2行为集语句2;……时序答控制n行为削语句n;en般d/泥jo气in1.敏感幼事件仗是可悲选项聚,目必的是哈为了赴触发al霸wa照ys语句声的执姥行。2.敏感迷事件动表由抛一个苏或多倚个事紧件表丸达式蜂构成替。3.过程撞语句剪、时戒延控眨制与in绘it皂ia训l语句扶大致碧相同骄。4.弟a猫lw侨ay组s过程炉块主查要对竖硬件俯功能花行为怀进行身描述斥,可经实现原锁存打器和艇触发钉器,肉也可酸用来震实现茫组合吊逻辑漏。例13瓦.5in带it幻玉ia柱l和al咐wa歪ys语句赏的综临合使急用20潜23夸/5浇/1胶8计算派机接舰口技如术26mo这du城leTe苏st伏Xo虏rB重eh喷av您io摆r;re傍gSa释,Sb,伏Ze拆us话;in节it库ia馆lbe锄gi窄nSa璃=符0极;Sb=毯0;#5Sb=约1;#5盯S糠a宾=绑1;#5Sb=伍0;en钻dal水wa倒ys黄@皱(行Sa步o沿rSb)践Ze孙us嗽=问S魄a己^Sb;al稳wa度ys代@渣(懂Ze抹us芹)$d纵is嗽pl春ay丛(绳"A成t押ti摇me豪%垒t,析S扛a途=蚂%d岗,Sb=偏%d骂,里Ze筹us只=烧%砖b"括,$t缩慧im运e,形S袭a,Sb,守Ze遣us少)en帆dm夹od政ul秃e时序匙控制●延迟称控制教:通过佣表达畏式定牺义开赶始遇尝到这钳条语那句和真懒正执批行这丢条语劝句之摩间的蔬延迟冒时间携。●事件耻控制苍:通过惧表达弊式定躲义开致始遇存到这搬条语供句和乐真正自执行期这条警语句挣之间巡寿的延豆迟时愚间。●边沿猴触发漆事件版控制蹦:指信凝号的区边沿匠跳变宋时发忠生指销定的孙行为睬。有茄上升稼沿控忆制(po恋se复dg般e描述紫)和孩下降缘瑞沿控子制(ne穿ge凯dg洁e描述彼)。20唐23钟/5拾/1螺8计算章机接钻口技改术27语句岔间时筒延:Su坟m=坚(A^盐B)任^C锹in;#4止T俊1=A&混Ci魔n;丝式/委/即第浴一条瘦语句兔执行类后四笔个时荣间单旨位执染行第世二条若语句妹。语句难内时篇延:Su困m=促#3姥(A^环B)残^C松in;截//计算傻好右进边值星得等3个时芽间单荣位后斥赋值塔给左处边。例13跨.6边沿步触发培事件桃计数失器如果cl梯k信号炒上有贺上升童沿,僚那么cn兔t信号曾就会加1,实向现计裕数功饱能。边沿泽触发短事件逆控制残,指慎信号贫的电斩平发俩生变巴化使企发生赏指定谁的行敞为。20煤23冠/5均/1熔8计算熔机接支口技抽术28re涛g[灿4:村0]cn汇t;al洒wa碧ys屠@蒙(po贞se扎dg剖ecl漆k)苍b袄eg魂inif通(r骂es田et)cn外t=0芽;el准secn怜t=c全nt粒+1颠;en瓶d例13眉.7电平微触发战计数敬器只要a、b、c信号芒的电火平有弟变化疑,cn饮t的值左就会将加1。‘20崭23烫/5鸣/1阻8计算恶机接用口技瓶术29re午g[围4:水0]cn寺t;al婆wa思ys笔@监(a狱o羡r途b将or葡c厕)皆b就eg忆inif忧(r令es客et)cn薯t=0佣;el怖secn池t=c福nt酷+1冤;en帖d13孟.4并行甩接口82烘55逝A的FP录GA设计13们.4熊.1模块勤划分用自烧顶向眯下的臣设计皮方法蒜,从的芯片奴结构指入手升,将榴要设炮计的业芯片谨分成慕几个舰子模比块,族逐一塌设计伪调试瞎。各宅个模舱块相道互独授立,菠利于律错误蚂定位喂和修夺改。20鸡23风/5旱/1折8计算闪机接早口技温术30外围发逻辑8位数脱据传谣输控群制模票块(IO薯B)1位数扔据传圈输控斜制模僚块(IO埋B1)82往55内核82削55幅A芯片20两23驴/5偶/1栋8计算微机接存口技卵术3182此55理A的FP松GA总体劫设计燃框图魂,如雀图13创.7所示汤。图13钥.7详8院25母5A桂F像PG剃A总体速设计杀框图20抬23画/5纷/1晋8计算箱机接膛口技暑术32//实例心化语功句,域信号勿端口啦通过触位置佣关联T8浙25雷5AT(拼re忽se时t,剃nC誓S,取nR切D,绞nW拢R,思A,拦Di泳n,袍PA郑in慕,P候Bi流n,猛PC套in贡,D课En垦,P少AE拒n,洁PB巨En衣,P绞CE饥n,睁Do具ut形,P偿Ao猴ut深,P桨Bo鸡ut却,P衫Co破ut);些/篮/内核括模块IO致BBD师(D语ou胜t,喉Di大n,水De驰n,敬D);深//内部梳数据大总线妄的传镇输方肥向控窑制模你块IO睁BBA价(P外Ao历ut,PA干in绩,P咸AE贯n,看PA);幼//句A口的际传输克方向券控制鸣模块IO嘱BBB白(P践Bo在ut,PB勇in妈,P捐BE蓬n,痛PB);肥/林/权B口的粮传输他方向俗控制螺模块IO鞠B1BC别(P签Co灯ut,PC决in范,P嘱CE丽n,拌PC);从/薄/旬C口的揭传输培方向夺控制都模块13衬.4裹.2顶层耗主模葬块设底计●主模冬块定蝇义了营芯片名的外蚀部接夫口,锣同时冷还定澡义了怒若干范内部蕉连线乘,用鹊于连阻接内梳核模流块和腰其他万外围横模块添。●采用康元件堡例化酿语句饶,将82请55租A内核从设计销和外恩围逻颗辑设爬计组语装起武来,逼形成凤完整医的82黎55俘A功能裁。主皮要代碧码如忠下:20努23熊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