2023年版图设计实验报告

实验报告册课程名称:集成电路版图设计教程姓名:学号：院系：专业：ﻩ 教师:202３年5月15日实验一：ＯP电路搭建实验目的：1．搭建实体电路。2.为画版图提供参考。3.方便导入网表。4.熟悉使用cadencｅ。二、实验原理和内容:根据所用到的mn管分析各部分的使用方法，简化为几个小模块,其中有两个差分对管。合理运用匹配规则,不同的MＯS管可以通过打孔O来实现互相的连接。三、实验环节:1.新建设计库。在ｆiｌe→neｗ→liｂｒａry;在naｍe输入自己的学号;右边选择:attchtｏ……;选择sto2→OK。然后在tools→librａrymanager下就可看到自己建的库。２.新建ＣellView。在ｆilｅ→neｗ→CellＶｉｅw;cell栏输入ＯＰ，type→选择layｏut。3.加器件。进入自己建好的电路图，选择快捷键I进行调用器件。ＭOS管,在bｒowse下查找sto2，然后调用出自己需要的器件。4.连线。注意：若线的终点没有别的电极或者连线,则要双击左键才干终止画线。一个节点只能引出3根线。无论线的起点或是终点,光标都应进入红色电极接电。5．加电源,和地符号。电源Vdｄ和地Vｓｓ的符号在ａnaｌoglｉb库中选择和调用，然后再进行连线。(可以通过Q键来编辑器件属性，把实验规定的MＯS管的wiｄth和lｅｎgth数据输入，这样就可以在电路图的器件符号中显示出来)6.检查和保存。命令是cheｃkandsave。（检查重要针对电路的连接关系：连线或管脚浮空,总线与单线连接错误等）假如有错和警告,在‘scｈｅmatｉccｈeck’中会显示犯错的因素,可以点击查看纠正。(画完后查看完整电路按快捷键Ｆ，连线一定要尽量节约空间,简化电路）四、实验数据和结果：导出电路网表的方法:新建文献ＯP,ｆｉｌe→Export→OＰ（librarybrowser选NＡND２)，NAND．cdl,Analoｇ√由于电路图老师已经给了我们,所以直接调用即可:调用的电路图如下所示:接着进入下一步:直接进入导入网表环节：五、实验总结:1．在老师讲解后,基本掌握了电路的基本画法，知道如何建立一个库，并调用库里面的器件,然后进行连接。ﻫ２.通过老师的讲解,深刻体会到了本课程在集成电路设计制作中的重要性，画版图是最基础但也是最重要的工作。3.画版图时，由于模块很多,经常容易画错,这就规定我们对实验电路自身有足够的理解，以及要有清楚的思绪和极大的耐心，在本课程学习之后这些方面都有了一定限度的提高。4.在学习画版图的过程中，经常会有一些疑问以及错误，自己也很难找出来,但是在老师和同学的帮助下,仍然可以完毕,因此在之后的生活工作中一定要继续保持这种多思考、多提问、团结协作的精神劲头。实验二：ＯP的版图设计实验目的：1.掌握版图设计的整体流程。2.掌握版图设计相关工具的使用。3.掌握版图设计的技巧和方法。4．熟悉DRC进行检查和改错。５.学会运用LVS来检查和纠正错误。二、实验原理和内容：相同的MOS管可以通过找公用端(节省面积）,并且将其合并,孔要完全重合。实验中要合理运用电流镜和差分对管，先画单个模块,然后再运用匹配将可以结合的单个的ＭOS管相匹配。三、实验环节:模块一:在图中可以发现两个明显的学过的MOS管,他们名为电流镜:电流镜作用是:用于分压的电阻，用于电流比例设定的电阻;调出相相应的各个器件,然后按照布局规则画出来的版图相应如下:模块二:为一组差对分管完全匹配的一对同种MOS晶体管，他们具有相同的电学参数和几何参数,电路上构成共源结构：电路图如下参照老师所讲的相关匹配规则合理连接,然后画出来的版图如下:模块三:下图为一些电容和电阻构成整个电路,合理的分工很重要，下图就是ＯP所需要的一些器件;画出来相应的版图如下：电阻:接着是电容的版图:模块四：一些其他的电路部位，汇总下后画完剩下的部位：对画好的各个部件进行连接、排版，最终得出来的总版图如下:四、实验据和结果:DRC环节及报错结果：（1)选择cａlｉｂrｅ里的第一个ruｎＤRＣ,如图所示。然后在弹出的对话框（2)在弹出的界面里，运营DRＣ环节应当按照如下进行:第一步:在DRCRunＤｉrectory相应的右边选择DRC，然后选择OK第二步:在弹出的窗口中点击RUNDＲC,等一会儿就会出现结果运营DRC得到如下截图：通过DRC运营结果可以得出如下结论:版图布局较好，各部分器件连接较为准确。运营结果无错。LVＳ报错结果如下图所示：实验总结：1.

通过这次集成电路版图设计课程的学习，我已经初步的掌握了Ｃadｅncｅ软件基本操作方法，并可以独立的运用该软件设计版图，灵活的根据规定绘制版图,我想这对我此后学习或者工作大有裨益，此后，我要更多的运用该软件，达成纯熟掌握的目的，在我们锻炼动手能力的同时,学到更多的有关专业知识。2.这次版图设计我做的是OP电路的搭建。在我做集成电路版图设计过程中的困难之一是分不清楚集成器件的工艺层次结构。第一次使用Ｃａｄence软件设计版图设计的过程中，对于我来说工艺部分的尺寸调节以及各个部分的排版搭建这个环节是我碰到的最大困难。但是在后来的摸索中我熟悉使用了它的一些调节规则。让我在之后的画图中更加游刃有余。3.在做集成电路版图设计的过程中，我觉得先熟悉整个电路的连接以及提前设计好画图的过程环节可以提高版图制作效率。在设计出电路的前提下，熟悉设计规则后,在编辑界面上先依据设计规则大约绘制出版图结构，进行ＤRC仿真后再依次改正错误。我觉得这个调节对于整个版图的最终完毕会有事半功倍的效果。

4.在整个版图的制作过程中，。有很多常用的基础知识需