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山西大学计算机与信息技术学院实验报告姓名学号专业班级2011级计算机科学与技术课程名称计算机组成原理课程设计实验日期成绩指导教师批改日期实验名称实验六.具有DMA控制功能的总线接口实验、实验目的:掌握DMA控制信号线的功能和应用。掌握在系统总线上设计DMA控制信号线的方法。、实验内容:1、实验原理:有一类外设在使用时需要占用总线,其典型代表是DMA控制机。在使用这类外设时,总线的控制权要在CPU和外设之间进行切换,这就需要总线具有相应的信号来实现这种切换,避免总线竞争,使CPU和外设能够正常工作。下面以DMA操作为例,设计相应的总线控制信号线。实验原理图如图6-1所示。进行DMA操作时,外设向DMAC(DMA控制机)发出DMA传送请求,DMAC通过总线上的HOLD信号向CPU提出DMA请求。CPU在完成当前总线周期后对DMA请求做出响应。CPU的响应包括两个方面,一方面让出总线控制权,一方面将有效的HALD信号加到DMAC上,通知DMAC可以使用总线进行数据传输。此时DMAC进行DMA传输,传输完成后,停止向CPU发HOLD信号,撤消总线请求,交还总线控制权。CPU在收到无效的HOLD信号后,一方面使HALD无效,另一方面又重新开始控制总线,实现正常的运行。如图6-1所示,在每个机器周期的T4时刻根HOLD信号来判断是否有DMA请求,如果有,则产生有效的HALD信号,HALD信号一方面锁死CPU的时钟信号,使CPU保持当前状态,等待DMA操作的结束。另一方面使控制缓冲、数据缓冲、地址缓冲都处于高阻状态,隔断CPU与外总线的联系,将外总线交由DMAC控制。当DMA操作结束后,DMAC将HOLD信号置为无效,DMA控制逻辑在T4时刻将HALD信号置为无效,HALD信号一方面打开CPU的时钟信号,使CPU开始正常运行。另一方面把控制缓冲、数据缓冲和地址缓冲交由CPU控制,恢复CPU对总线的控制权。在本实验中,控制缓冲由写在16V8芯片中的组合逻辑实现,数据缓冲和地址缓冲由数据总线和地址总线左侧的74LS245实现。以存储器读信号为例,体现HALD信号对控制总线的控制。首先模拟CPU给出存储器读信号(置WR、RD、IOM分别为0、1、0),当HALD信号无效时,总线上输出的存储器读信号XMRD为有效态“0”当HALD信号有效时,总线上输出的存储器读信号XMRD为高阻态。可以自行设计其余的控制信号验证实验。2、实验步骤:按照图6-2实验接线图进行连线。图6-2实验接线图」(2)具体操作步骤如下:将时序与操作台单元的开关KK1、KK3置为‘运行’档,开关KK2置为‘单拍’档,按动CON单元的总清按钮CLR,将CON单元的WR、RD、IOM分别置为“0“1、0,此时XMRD为低,相应的指示灯E0灭。使用电压表测量数据总线和地址总线左侧的芯片74LS245的使能控制信号(第19脚)发现电压为低,说明数据总线和地址总线与CPU连通。然后将CON单元的K7置为1,连续按动时序与操作台单元的开关ST,T4时刻控制总线的指示灯HALD为亮,继续按动开关ST,发现控制总线单元的时钟信号指示灯T1——T4保持不变,说明CPU的时钟被锁死。此时XMRD为高阻态,相应的指示灯E0亮。使用万用表测量数据总线和地址总线左侧的芯片74LS245的使能控制信号(第19脚)发现电压为高,说明总线和CPU的连接被阻断。将CON单元的K7置为0,按动时序与操作台单元的开关ST,当时序信号走到T4时刻时,控制总线的指示灯HALD为灭,继续按动开关ST,发现控制总线单元的时钟信号指示灯T1——T4开始变化,说明CPU的时钟被接通。此时XMRD受CPU控制,恢复有效为低,相应的指示灯E0灭使用万用表测量数据总线和地址总线左侧的芯片74LS245的使能控制信号第19脚)发现电压为低,说明总线和CPU恢复连通。3、实验结果:步骤一(V)步骤二(V)步骤三(V)74LS245(数据总线边上)-0.264.13-0.2674LS245(地址总线边上)-0.102.65-0.10三、实验总结:1.CPU的响应包括两方面:(1)让出总线控制权(2)将有效的HALD信号加到DMAC上,通知DMAC可以使用总线进行数据传输。CPU在收到无效的HOLD信号时,一方面使HALD无效,另一方面,重新开始控制总线,实现正常运行。在每个机器周期的T4时刻根据,HOLD信号来判断是否有DMA请求,如果有,则产生有效的HALD信号。HALD信号一方面锁死CPU的时钟信号,使CPU保持当前状态,等待DMA操作的结束。另一方面使控制缓冲、数据缓冲、地址缓冲都处于高阻状态,隔断CPU与外总线的联系,将外总线交由DMAC控制。4当HALD信号无效时,总线上输出的存储器读信号XMRD为有效态“0”当HALD信号有效时,总线上输出的存储器读信号XMRD为高阻态。5、XMRD为低时,相应的指示灯E0灭。使用电压表测量数据总线和地址总线左侧的芯片74LS24
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