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文档简介
第四 集成触发(1)特性表(CP=0时,保持;CP=1时如下表)(2)D000010101111(3)该电路为锁存器(时钟型D触发器)。CP=0D的数据;CP=1(1)、C=0时该电路属于组合电路;C=1、C=0时Q=AB C=1时Qn+1=BQnQ、输Q QQn1 Qn1=Qn Qn1=Qn 1 Q1、CP作用下的输出 Q2和Z的波形如下图;1 QZZZ由Qn1DJQnKQnJQnKQn得D触发器转换为J-K触发器的逻辑J-KD触发器的逻辑图如下面的右图JK QJK QQK C1、5552、uc,uo1uo2 tt13、uo110.745
316
uo2455554Vuo11
232H图(a)5552tw=1.1RC=10ms(C13、uc和uo55 25 45 tt4ui15mstw不变,可加入微由555定时器构成的触发器如图(a)所2、uo3ui55554555737脚与电源之间接10.715
10kH
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