![《数字逻辑》期末考试A卷参考答案_第1页](http://file4.renrendoc.com/view/aa6e9437a99f0470d53c36a39e860b0f/aa6e9437a99f0470d53c36a39e860b0f1.gif)
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![《数字逻辑》期末考试A卷参考答案_第4页](http://file4.renrendoc.com/view/aa6e9437a99f0470d53c36a39e860b0f/aa6e9437a99f0470d53c36a39e860b0f4.gif)
![《数字逻辑》期末考试A卷参考答案_第5页](http://file4.renrendoc.com/view/aa6e9437a99f0470d53c36a39e860b0f/aa6e9437a99f0470d53c36a39e860b0f5.gif)
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文档简介
A卷参考四、填空题(每空1分,共20分)__1__发器串接起来,可表示__3__位二进制数。__4__个触发器。3、寄存器中,与触发器相配合的控制电路通常由门电路(选择提示:门电路、触发器、晶体二极管)构成。4、一个五位的二进制加法计数器,由00000状态开始问经过75个输入脉冲后,此计数器的状态为__01011_。5、四位移位寄存器可以寄存四位数码,若将这些数码全部从串行输出端输出,需经过__3__个时钟周期。6、_RS_触发器存在输入约束条件,_主从JK_触发器会出现一次翻转现象。7、负跳沿触发翻转的主从JK触发器的输入信号应该在CP为低电平CP为高电平时输入信号要求稳定不变。8、正跳沿触发翻转的D触发器的输入信号在CP上升沿前一瞬间加入。9、由与非门组成的基本RS触发器当输入R=0,S=0时,同向输出端Q=__1__,反向输出端=__1__,当、S同时由0变1_时,输出10T触发器是由_JK_触发器的数据输入端短接而成。、触发器的脉冲工作特性是指对_时钟脉冲_和输入信号的时间关系的要求。五、用CMOS电路实现下面的逻辑函数,画出其内部电路图(用场效应管作为基本单元)10分,每小题5分)1、L=2、L=AB的表决电路,当多数人赞成时,投票通过。投赞成票约定为,投票通过约定为,只限用与非门电路,要求写出设计过程(10分)解:1、依题意可得下面的真值表,L=1代表投票通过;A00001B00110C01010L000101110111011112、由上面的真值表可得逻辑表达式为:L=AB+BC+CA+ABC=AB+BC+CA3、将其划简为与非表达式为:L=ABBCCA4、依上式画出逻辑电路图如下:设每个门的时延均为t竞争冒险。八、解:(1)按题意要求的状态转换表整理后可得出各驱动信号的真值表如下QQQJKJKJnn323233221QQKn11100000X0X1X00010X1XX001111XX00X01010XX0X11000X10X0X1010X00XX11111X0X01X1110X0X1X0(2)根据上表画出、、、、、的卡诺图0111001000100111JKJKJK332211如
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