高级技师(数时序)_4

1、第六章第六章 时序逻辑电路时序逻辑电路 6.2 6.2 时序逻辑电路的一般分析方法时序逻辑电路的一般分析方法6.3 6.3 计数器计数器6.4 6.4 数码寄存器与移位寄存器数码寄存器与移位寄存器6.5 6.5 时序逻辑电路的设计方法时序逻辑电路的设计方法6.1 6.1 时序逻辑电路的基本概念时序逻辑电路的基本概念6.1 6.1 时序逻辑电路的基本概念时序逻辑电路的基本概念组组合合电电路路触触发发器器电电路路X1XiZ1ZjQ1QmD1Dm输入信号信号输出触发器触发器输入信号输出信号CP一、一、 时序逻辑电路的结构及特点时序逻辑电路的结构及特点 时序逻辑电路时序逻辑电路任何一个时刻的输出状态不

2、仅取决于当时的任何一个时刻的输出状态不仅取决于当时的输入信号，还与电路的原状态有关输入信号，还与电路的原状态有关。 时序电路的特点：（时序电路的特点：（1 1）含有记忆元件（最常用的是触发器）。）含有记忆元件（最常用的是触发器）。 （2 2）具有反馈通道。具有反馈通道。一、分析时序逻辑电路的一般步骤一、分析时序逻辑电路的一般步骤 1 1由逻辑图写出下列各逻辑方程式：由逻辑图写出下列各逻辑方程式： （1 1）各触发器的时钟方程。）各触发器的时钟方程。 （2 2）时序电路的输出方程。）时序电路的输出方程。 （3 3）各触发器的驱动方程。）各触发器的驱动方程。 2 2将驱动方程代入相应触发器的特性方

3、程，求得时序逻辑电路将驱动方程代入相应触发器的特性方程，求得时序逻辑电路的状态方程。的状态方程。 3 3根据状态方程和输出方程，列出该时序电路的状态表，画出根据状态方程和输出方程，列出该时序电路的状态表，画出状态图或时序图。状态图或时序图。 4根据电路的状态表或状态图说明给定时序逻辑电路的逻辑功根据电路的状态表或状态图说明给定时序逻辑电路的逻辑功能。能。6.2 6.2 时序逻辑电路的一般分析方法时序逻辑电路的一般分析方法计数器计数器用以统计输入脉冲用以统计输入脉冲CPCP个数的电路。个数的电路。 6.3 6.3 计数器计数器计数器的分类：计数器的分类：（2 2）按数字的增减趋势可分为加法计数器

4、、减）按数字的增减趋势可分为加法计数器、减法计数器和可逆计数器。法计数器和可逆计数器。（1 1）按计数进制可分为二进制计数器和非二进）按计数进制可分为二进制计数器和非二进制计数器。制计数器。非二进制计数器中最典型的是十进制计数器。非二进制计数器中最典型的是十进制计数器。（3 3）按计数器中触发器翻转是否与计数脉冲同）按计数器中触发器翻转是否与计数脉冲同步分为同步计数器和异步计数器。步分为同步计数器和异步计数器。 3 3集成二进制计数器举例集成二进制计数器举例 （1 1）4 4位二进制同步加法计数器位二进制同步加法计数器7416174161RC1&Q1J1K&13Q&Q&

5、amp;RC11J1K&12Q&Q&RC11J1K&11Q&Q&RC11J1K&10Q0D1&1EPET11D2D3DCPLDRDRCO 异步清零。异步清零。7416174161具有以下功能：具有以下功能： 计数。计数。 同步并行预置数。同步并行预置数。RCO为进位输出端。为进位输出端。 保持。保持。01111RD清零清零0111LD预置预置 0 01 1EP ET使能使能CP时钟时钟 d3 d2 d1 d0 D3 D2 D1 D0预置数据输入预置数据输入0 0 0 0d3 d2 d1 d0保保 持持保保 持持计计 数数Q3 Q2

6、 Q1 Q0输出输出工作模式工作模式异步清零异步清零同步置数同步置数数据保持数据保持数据保持数据保持加法计数加法计数7416174161的功能表的功能表41235671516CPD0D1D2GNDQ3Q2Q1Vcc74161891011121413RD3DDLEPETQ0RCOQCPQ0Q21Q3LDRDDD0D21D3EPETRCO121314150120清零异步同步置数加法计数保持（2）4位二进制同步可逆计数器位二进制同步可逆计数器741910111LD预置预置100EN使能使能01D/ U加加/减控制减控制CP时钟时钟d3 d2 d1 d0 D3 D2 D1 D0预置数据输入预置数据输入

7、d3 d2 d1 d0保保 持持计计 数数计计 数数Q3 Q2 Q1 Q0输输 出出工作模式工作模式异步置数异步置数数据保持数据保持加法计数加法计数减法计数减法计数74191的功能表的功能表LD3Q2QD/UENCP0D1D2D3DRCOMAX/MIN1Q0Q7419141235671516Vcc741918910111214133D0Q1GNDD1EN D/UQ3Q2QD2LDMAX/MINRCOCP0D二、非二进制计数器二、非二进制计数器N进制计数器又称模进制计数器又称模N计数器。计数器。当当N=2n时，就是前面讨论的时，就是前面讨论的n位二进制计数器；位二进制计数器；当当N2n时，为非二

8、进制计数器。非二进制计数时，为非二进制计数器。非二进制计数器中最常用的是十进制计数器。器中最常用的是十进制计数器。3 3集成十进制计数器举例集成十进制计数器举例（1 1）84218421BCD码同步加法计数器码同步加法计数器741607416001111RD清零清零0111LD预置预置 0 01 1EP ET使能使能CP时钟时钟 d3 d2 d1 d0 D3 D2 D1 D0预置数据输入预置数据输入0 0 0 0d3 d2 d1 d0保保 持持保保 持持十进制计十进制计 数数Q3 Q2 Q1 Q0输出输出工作模式工作模式异步清零异步清零同步置数同步置数数据保持数据保持数据保持数据保持加法计数加

9、法计数7416074160的功能表的功能表3Q2QETCP0D1D2D3DRCO1Q0Q74160EPRDDL41235671516CPD0D1D2GNDQ3Q2Q1Vcc74160891011121413RD3DDLEPETQ0RCO（2 2）二）二五五十进制异步加法计数器十进制异步加法计数器7429074290二进制计数器的时钟输入端为二进制计数器的时钟输入端为CP1 1，输出端为，输出端为Q0 0；五进制计数器的时钟输入端为五进制计数器的时钟输入端为CP2 2，输出端为，输出端为Q1 1、Q2 2、Q3 3。7429074290包含一个独立的包含一个独立的1 1位二进制计数器和一个独立的

10、五进制计数器。位二进制计数器和一个独立的五进制计数器。 如果将如果将Q0 0与与CP2 2相连，相连，CP1 1作时钟输入端，作时钟输入端，Q0 0Q3 3作输出端，则为作输出端，则为84218421BCD码十进制计数器。码十进制计数器。如果将如果将Q3与与CP0相连，相连，CP2作时钟输入端，从高作时钟输入端，从高位到低位的输出为位到低位的输出为Q0 Q3 Q2 Q1 时，则构成时，则构成5421BCD码十进制计数器。码十进制计数器。RQC1C1RQC11KCPR1K1J1J1J1J1KQ1KRC1QSS&3Q0Q1QQ220(1)R0(2)R9(1)R9(2)1CPR11&

11、 7429074290的功能：的功能： 异步清零。异步清零。 计数。计数。 异步置数（置异步置数（置9 9）。）。 复位输入复位输入置位输入置位输入时时 钟钟输输 出出工作模式工作模式R0（1） R0（2）R9（1） R9（2）CPQ3 Q2 Q1 Q01 11 10 00 0 0 00 0 0 0异步清零异步清零0 01 11 11 0 0 11 0 0 1异步置数异步置数0 0 0 00 00 0计计 数数计计 数数计计 数数计计 数数加法计数加法计数4123567891011121314GNDVcc74LS2909(1)NC9(2)NC0(1)0(2)21Q3Q0Q1Q2CPCPRRRR

12、三、集成计数器的应用三、集成计数器的应用（1 1）同步级联。）同步级联。例：用两片例：用两片4 4位二进制加法计数器位二进制加法计数器7416174161采用同步级联方式构成的采用同步级联方式构成的8 8位位二进制同步加法计数器，模为二进制同步加法计数器，模为161616=25616=256。1 1计数器的级联计数器的级联3Q2QETCP0D1D2D3DRCO1Q0Q74161(1)EPRDDLD13DD3DCPQ Q00RCO74161(2)L21ETQDQR2DEP111计数脉冲清零脉冲0132Q Q Q Q4576Q Q Q Q（2 2）异步级联）异步级联 例：用两片例：用两片74191

13、采用异步级联方式构成采用异步级联方式构成8位二进制位二进制异步可逆计数器。异步可逆计数器。LD3Q2QD/UENCP0D1D2D3DRCOMAX/MIN1Q0Q74191(2)LD3Q2QD/UENCP0D1D2D3DRCOMAX/MIN1Q0Q74191(1)计数脉冲D/UENL0132Q Q Q QQ6Q7Q4Q5D（3）用计数器的输出端作进位）用计数器的输出端作进位/借位端借位端有的集成计数器没有进位有的集成计数器没有进位/借位输出端，这时可根据具体情况，借位输出端，这时可根据具体情况，用计数器的输出信号用计数器的输出信号Q3、Q2、Q1、Q0产生一个进位产生一个进位/借位。借位。例：用

14、两片例：用两片74290采用异步级联方式组成的二位采用异步级联方式组成的二位8421BCD码十进制码十进制加法计数器。加法计数器。 模为模为1010=1003Q2Q1Q0Q74290(1)CP1CP2R0(2)R0(1)R9(1)9(2)RQ0Q12QQ374290(2)CP1CP20(2)RR0(1)9(1)RR9(2)计数脉冲置数脉冲清零脉冲个位输出十位输出01Q2QQ3Q01Q2QQ3Q2 2组成任意进制计数器组成任意进制计数器（1）异步清零法）异步清零法适用于具有异步清零端的集成计数器。适用于具有异步清零端的集成计数器。例：用集成计数器例：用集成计数器74160和与非门组成的和与非门组

15、成的6进制计数器。进制计数器。Q2EPD2CPETQ计数脉冲DR1RCO0QQQ11DQLD7416123110D3D0QQ32310QQQ Q0000100001000011000100101001010101100111&（2）同步清零法）同步清零法同步清零法适用于具有同步清零端的集成计数器。同步清零法适用于具有同步清零端的集成计数器。例：用集成计数器例：用集成计数器74163和与非门组成的和与非门组成的6进制计数器。进制计数器。QDRETEP74163DRCO33QD211QL010QDCPDD1计数脉冲2&0132Q Q Q Q3Q0010000000011Q0001Q

16、1Q010020101（4）同步预置数法）同步预置数法同步预置数法适用于具有同步预置端的集成计数器。同步预置数法适用于具有同步预置端的集成计数器。例：用集成计数器例：用集成计数器74160和与非门组成的和与非门组成的7进制计数器。进制计数器。QDRETEP74160DRCO33QD211QL010QDCPDD1计数脉冲200111Q30QQ21Q3Q0101000110111Q0100Q1Q1000210010110例例6.3.16.3.1 用用7416074160组成组成4848进制计数器。进制计数器。先将两芯片采用同步级联方式连接成先将两芯片采用同步级联方式连接成100100进制计数器，进

17、制计数器， 然后再用异步清零法组成了然后再用异步清零法组成了4848进制计数器。进制计数器。解：解：因为因为N4848，而，而7416074160为模为模1010计数器，所以要用两片计数器，所以要用两片7416074160构成构成. .。3Q2QETCP0D1D2D3DRCO1Q0Q74160(1)EPRDDLD13DD3DCPQ Q00RCO74160(2)L21ETQDQR2DEP1计数脉冲&116.4 6.4 数码寄存器与移位寄存器数码寄存器与移位寄存器集成数码寄存器集成数码寄存器74LSl75 ：一、一、 数码寄存器数码寄存器数码寄存器数码寄存器存储二进制数码的时序电路组件存储

18、二进制数码的时序电路组件1DRC1QQR1DC1QRC11D1FFQ11Q2FFQ22Q3FFQ33Q1DD32D1DRC1R0101DQQFF0DQ0CP7474LS175175的功能的功能: :RD是异步清零控制端。是异步清零控制端。D0D3是并行数据输入端，是并行数据输入端，CP为时钟脉冲端。为时钟脉冲端。Q0Q3是并行数据输出端。是并行数据输出端。0111RD清零清零10CP时钟时钟 d0 d1 d2 d3 D0 D1 D2 D3输输 入入0 0 0 0d0 d1 d2 d3保保 持持保保 持持Q0 Q1 Q2 Q3输输 出出工作模式工作模式异步清零异步清零数码寄存数码寄存数据保持数据

19、保持数据保持数据保持7474LS175175的功能表的功能表二二、移位寄存器、移位寄存器 移位寄存器移位寄存器不但可以寄存数码，而且在移位脉冲作用不但可以寄存数码，而且在移位脉冲作用下，寄存器中的数码可根据需要向左或向右移动下，寄存器中的数码可根据需要向左或向右移动1 1位。位。1 1单向移位寄存器单向移位寄存器 （1 1）右移寄存器（）右移寄存器（D触发器组成的触发器组成的4 4位右移寄存器）位右移寄存器）右移寄存器的结构特点：右移寄存器的结构特点：左边触发器的输出端接右邻触发器的输入端。左边触发器的输出端接右邻触发器的输入端。QRC11D1DC1RQ1DC1RQ1DQRC1Q0Q1Q2Q3

20、CPCRID串行输入串行输出D0D1D20FF1FF2FF3FF并 行 输 出D3移位脉冲移位脉冲输入数码输入数码输输 出出CPDIQ0 Q1 Q2 Q300 0 0 0 设移位寄存器的初始状态为设移位寄存器的初始状态为0000，串行输入数码，串行输入数码DI=1101，从高，从高位到低位依次输入。其位到低位依次输入。其状态表如下：状态表如下：QRC11D1DC1RQ1DC1RQ1DQRC1Q0Q1Q2Q3CPCRID串行输入串行输出D0D1D20FF1FF2FF3FF并 行 输 出D3111 0 0 01 1 0 012030 1 1 0141 0 1 1右移寄存器的时序图：右移寄存器的时序

21、图： 由于右移寄存器移位的方向由于右移寄存器移位的方向为为DIQ0 0Q1 1Q2 2Q3 3，所以，所以又称又称上移寄存器上移寄存器。 在在4 4个个CPCP作用下，输入的作用下，输入的4 4位位串行数码串行数码11011101全部存入了寄存器全部存入了寄存器中。中。这种方式称为这种方式称为串行输入方式串行输入方式。619273584CP1D1I01203Q1QQQ移位脉冲移位脉冲输入数码输入数码输输 出出CPDIQ0 Q1 Q2 Q30123411010 0 0 01 0 0 01 1 0 00 1 1 01 0 1 1（2 2）左移寄存器）左移寄存器 2 2 双向移位寄存器双向移位寄存器

22、 将右移寄存器和左移寄存器组合起来，并引入一控制端将右移寄存器和左移寄存器组合起来，并引入一控制端S便构成便构成既可左移又可右移的双向移位寄存器。既可左移又可右移的双向移位寄存器。左移寄存器的结构特点：左移寄存器的结构特点：右边触发器的输出端接左邻触发器的输入端。右边触发器的输出端接左邻触发器的输入端。1DC1RQ1DQRC1Q1D1DC1C1RQRCPCRD01DFF0FF1FF23FF20并 行 输 出3QQ1QQID串行输入串行输出2D3D当当S=1时，时，D0=DSR、D1=Q0、D2=Q1、D3=Q2，实现右移操作；，实现右移操作；其中，其中，DSR为右移串行输入端，为右移串行输入端

23、，DSL为左移串行输入端。为左移串行输入端。当当S=0时，时，D0=Q1、D1=Q2、D2=Q3、D3=DSL，实现左移操作。，实现左移操作。RFF1DC13Q&1R1DC12FFQ&1R1DC11FFQ&1FF&C1R01DQ1111QQQQ1302CPCR串行输入SLD（左移）串行输入DSR（右移）串行输出DOR（右移）串行输出DOL（左移）移位控制SS=1：右移S=0：左移并 行 输 出 D D触发器组成的双向移位寄存器：触发器组成的双向移位寄存器：三、集成移位寄存器三、集成移位寄存器741947419474194为四位双向移位寄存器为四位双向移位寄存器。

24、 Q0和和Q3分别是左移和右移时的串行输出端，分别是左移和右移时的串行输出端，Q0、Q1、Q2和和Q3为为并行输出端。并行输出端。 DSL 和和DSR分别是左移和右移串行输入。分别是左移和右移串行输入。D0、D1、D2 2和和D3是并行输是并行输入端。入端。0Q1QS3D2D1D0D2Q3Q7419441235671516D0D1D2GNDQ3Q2Q1Vcc74194891011121413RD3D0SQ0SRDCPSLSR01SRSLS1CPDDDD74194的功能表的功能表输输 入入输输 出出工作模式工作模式清零清零控控 制制串行输入串行输入时钟时钟并行输入并行输入RDS1 S0DSL DSRCPD0 D1 D2 D3Q0 Q1 Q2 Q30 0 0 0 0异步清零异步清零10 0 Q0n Q1n Q2n Q3n保保 持持110 10 1 1 0 1 Q0n Q1n Q2n0 Q0n Q1n Q2n右右 移移111 01 01 0 Q1n Q2n Q3n 1Q1n Q2n Q3n 0左左 移移11 1 D0 D1 D2 D3D0 D1 D2 D3并行置数并行置数利用逻辑分析的方法画出电路完整的状态图。利用逻辑分析的方法画出电路完整的状态图。本章小结本章