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文档简介

实验二 组合逻辑电路设计实验目的1. 掌握组合逻辑电路的设计方法 2. 掌握全加器的逻辑功能3. 掌握数据选择器的逻辑功能及用数据选择器实现逻辑函数的方法 实验内容1. 用逻辑门电路库中的独立门电路设计一个全加器电路，写出各输出端的逻辑表达式，给出电路图并验证其逻辑功能填入表2.1中。表2.1 全加器逻辑功能表 2. 用数据选择器74151和适当的门电路实现全加器的逻辑功能，写出各输出端的逻辑表达式，给出电路图并验证其逻辑功能与表2.1比较结果是否一致。 3. 用逻辑门电路库中的独立门电路设计一个十六进制共阴极7段显示译码器，其译码输出真值表如表3.7所示，写出各输出端的逻辑表达式，给出其电路图，并用EWB仿真验证其功能。表2.2 十六进制7段显示译码器输出真值

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