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文档简介

1、FPGA实验报告姓名 朱聪聪 学号39 姓名武帅学号课 题 名 称8选1数据选择器设计实 验 目 的1、理解数据选择器功能。2、掌握VHDL并行语句中条件信号赋值的格式和用法。设 计 要 求设计一个8选1数据选择器使其满足如下真值表：8选1数据选择器真值表地址码（选择信号）输出QA0A1A2000D0001D1010D2011D3100D4101D5110D6111D7表一1. 利用条件信号赋值语句实现8选1数据选择器器功能。2. 完成设计的仿真，并记录、分析仿真波形。设 计 思 路条件信号赋值语句也是一种并行信号赋值语句。条件信号赋值语句可以根 据不同的条件将不同的表达式赋值给目标信号，格式

2、如下：信号 <=表达式1WHEN武值条件1ELSE表达式2WHEN武值条件2ELSE表达式n ；设计原理图及源程序LIBRAR Y IEEE;USE IEEE.STD_LOGIC_1164.ALL;ENTITY MUX8 ISP0RT(D:IN STD_L0GIC_VECT0R(7 DOWNTO 0);A:IN STD_LOGIC_VECTOR(2 DOWNTO 0);Q:OUT STD_LOGIC);END ENTIT Y MUX8;ARCHITECTURE one OF MUX8 ISBEGIN Q<=D(0) WHEN A="000" ELSED(1) W

3、HEN A="001" ELSED(2) WHEN A="010" ELSED(3) WHEN A="011" ELSED(4) WHEN A="100" ELSED(5) WHEN A="101" ELSED(6) WHEN A="110" ELSED(7) WHEN A="111" ELSE'Z：END one;仿直/、波形图实 验 总 结 及 个 人 心通过本次实验，复习了之前学习的条件信号赋值语句。 条件信号赋值语句 在执行时，首先要进行条件判断，然后再进行信号赋值操作。同

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