数字电路大作业交流PPT学习教案

1、会计学1 数字电路大作业交流数字电路大作业交流 第1页/共25页 项目第一阶段 项目第二阶段 Part 1.1Part 1.2Part 1.3 Part 2.1Part 2.2Part 2.3 综合 第2页/共25页 阶段1 阶段2 阶段3 阶段4 会造成一些人力资源的浪 费。尤其是在每个人的能 力相差不多的情况下 第3页/共25页 整体设计上采用并行方式，模块实现时辅以串行方式。 项目第1阶段 Part 1.1 Part 1.1.1 Part 1.1.2 Part 1.2 第4页/共25页 Entity 功能 管脚 输入类型输出类型 第5页/共25页 第6页/共25页 第7页/共25页 第8

2、页/共25页 第9页/共25页 Total logic cells required: 69 第10页/共25页 Total logic cells required: 34 第11页/共25页 第12页/共25页 这样会导致逻辑器件的浪费， 尤其是在很复 杂的时候（如嵌套），即 使进行自动优 化也无法消除。 第13页/共25页 第14页/共25页 在中就是电路图中的连线 模块 模块 第15页/共25页 第16页/共25页 第17页/共25页 第18页/共25页 第19页/共25页 Fast：系统在综合时，将会按芯片运行的最快速度优化用户 设计，而不是占用芯片资源情况。 Normal：系统综合

3、时尽量利用芯片的可用资源。 WYSIWYG：保持用户所设计的各种逻辑关系，对于一些不 必要的逻辑内容也予保留。 Optimize：用于可以调节滑块，以自定义自己的要求。 area：优先资源占用；speed：优先运行速度。 第20页/共25页 第21页/共25页 Slow slew rate：减缓信号的跳变速度，当许多输出信号同 时发生变化时，选择此项将会缓解由于跳变引起的噪声。 XOR synthesis：系统会自动创建一些异或门来化简逻辑。 第22页/共25页 谢谢大家 祝大家考试顺利 第23页/共25页 x(u$rZoWkThPeMbJ7G4D1z-w&t!qYmVjSgOdL9I6F3B

4、0y)v%s#oXlUiQfNcK8H5D2A+x*u$rZnWkShPeMaJ7G4C1z)w&t!pYmVjRgOcL9I6E3B0y(v%s#oXlTiQfNbK8H5D2A-x*u$qZnWkShPdMaJ7F4C1z)w&s!pYmUjRgOcL9H6E3B+y(v%r#oWlTiQeNbK8G5D1A-x*t$qZnVkShPdMaI7F4C0z)w&s!pXmUjRfOcL9H6E2B+y(u%r#oWlThQeNbJ8G5D1A- w*t$qYnVkSgPdLaI7F3C0z)v&s#pXmUiRfOcK9H5E2B+x(u%rZoWlThQeMbJ8G4D1A-w*t!qYn

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