山大工程学院2013年数字电路试题(太原大学生网)_第1页
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文档简介

1、一、单向选择题(18分,每小题2分)1.函数F =AB +C,使F=1的输入ABC组合为( )。A. ABC=000 B. ABC=010 C. ABC=101 D. ABC=1002. 逻辑函数式Y=EF+ 的逻辑值为( )。AEF B C 0 D 13. “异或”门的逻辑式为( )。A. FAB+AB B. F+ABC. F D. 以上各项都不是 4. 一位8421BCD码译码器的数据输入线与译码输出线的组合是( C )。 A4:6 B. 1:10 C. 4:10 D. 2:45. 用4选1数据选择器实现函数,应使 。A. D1=D2=0,D0=D3=1 B. D0=D2=1,D1=D3=

2、0C. D0=D2=0,D1=D3=1 D. D0=D1=1,D2=D3=06. 如果对45个符号进行二进制编码,则至少需要 位二进制数。A. 4 B. 5 C. 6 D. 77. 在下列逻辑部件中,不属于组合逻辑电路的是( B )。A.全加器B. 计数器 C. 数据分配器 D.编码器8.用n个触发器构成的计数器,可得到最大计数长度(进制)是( D )。 A. n B. 2n C . 2n-1 D. 2n 9.异步时序电路和同步时序电路比较,其差异在于( B )。 A. 没有触发器 B. 没有统一的时钟脉冲控制 C. 没有稳定状态 D. 输出只与内部状态有关 二、填空题(每题2分,共16分)1

3、.(529)10若编成8421BCD码为(_)8421BCD,2. 4个变量可构成 个最小项,全体最小项之和为 。3.函数,其反函数=_ 4.在逻辑电路中,三极管通常工作在 和 状态。5. TTL集成JK触发器正常工作时,其和端应接 电平。6.TTL电路的电源电压为 V, CMOS电路的电源电压为 V 。7. , 8.要构成6进制计数器,至少需要 个触发器,其无效状态有 个。三、图1、2中电路由TTL门电路构成,试分别写出F1、F2的表达式。(10分) 四、按要求完成下列各题(16分)1.用卡诺图化简逻辑函数,必须在卡诺图上画出卡诺圈(6分) 2.利用代数法化简逻辑函数,必须写出化简过程(5分

4、)3. 已知电路及输入波形如图所示,其中FF1是边沿D触发器,根据CP和D的输入波形画出Q1输出波形。设触发器的初始状态均为0。 (5分)3.请指出下列555电路的名称。(5分)五、 设计题(20分)1.设计一多数表决电路。要求A、B、C三人中只要有两人以上(包括两人)同意,则决议就能通过,但A还有决定权,即只要A同意,即使其他人不同意也能通过。(15分)(1)用与非门实现,画出逻辑电路图。(2)用38线译码器74LS138加必要的门电路实现,画出逻辑电路图。译码器74LS138的功能如下A2、A1、A0为二进制译码输入端,A2为最高位,依次为(A1、A0),为译码输出端(低电平有效),S1、为选通(使能)控制端。当S11、+=0时,译码器处于工作状态;当S10、+=1时,译码器处于禁止状态,即所有输出均为1。2.中规模同步四位二进制计数器74LS161的功能表见附表所示;请用LD同步预置法设计一个七进制加法计数器。(5分)74LS161为四位2进制计数器,Q3为最高位,依次为(Q2、Q1、Q0)功能表见下表输 入输 出 ET EP CP D3 D2 D1 D0Q3 Q2 Q1 Q00 1 0 d3 d2 d1 d01 1 1 1 1 1 0 1 1 0 0 0 0 0d3 d2 d1 d0 计 数保 持 保 持 六、(20分)分析如图所示同步计数电路(设触发器

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