数字抢答器课程设计

1、数字抢答器 摘 要当今的社会竞争日益激烈，选拔人才，评选优胜，知识竞赛之类的活动愈加频繁，那么也就必然离不开抢答器。因此抢答器是机关学校、电视台等单位开展智力竞赛活动必不可少的设备，通过抢答者的按键、数码显示等能准确、公正、直观地判断出优先抢答者。本产品采用了数字显示器直接指示，自动锁存显示结果，并自动复位的设计思想，由数字电路以及外围电路组成，分为八路抢答；在抢答同时附有声音输出接口，提示主持人此时已完成这次的抢答。不仅如此，为了方便不同场合的智力竞赛活动，为需要定时答题者提供可调计时器，无需人工参与。与其他抢答器电路相比较有分辨时间极短、结构清晰、成本低、易操作、制作方便等优点。关键词：竞

2、赛活动、抢答、锁存、复位、可调倒计时目 录1 引 言32 设 计 目 的33 设计指标及要求34 总体框图设计与论证45 功能模块设计及系统工作分析55.1 功能模块设计.55.2 系统工作原理分析.65.3 主要元器件功能介绍.75.3.1 锁存器（74hc573）75.3.2 优先编码器（74ls147）85.3.3 计数器 （74ls192）95.3.4 显示译码器（cd4511、74ls48）106 实验器材清单137 设计步骤及各功能电路调试14 7.1 仿真.157.2调试锁存器电路.15 7.3调试编码与译码显示电路.167.4 调试控制电路.167.5 秒脉冲.167.6 调时

3、电路.178 心 得 体 会17谢 辞19参 考 文 献20附录a：21附录b：22数字竞赛器1 引 言在科技高速发展的21世纪，人才成为最重要的社会资源之一。竞争日益激烈，人才选拔，评选择优的活动越加频繁，而在这些活动当中，往往分为几组选手参加，针对主持人提出的问题，如果用举手的方式抢答，往往会因主持人判断的误差，造成比赛的不公平性。本着公平公正的原则，就需要有一种稳定、准确的工具，因此数字竞赛器应运而生，由于其准确性高、实用性强，所以得到迅速推广，从最初的益智类节目，广泛应用到各类活动、娱乐节目中。早期的竞赛器只由几个过三极管、可控硅、发光二极管等组成，能通过发光二极管的指示辨认出选手号码

4、，现在大多数竞赛器单片机或数字集成电路组成。2 设 计 目 的通过课题设计一个八路抢答器与可调定时器，运用所学数字电子电路的知识进行理论设计、安装调试、后期制作、分析总结等环节，以提高在电子技术方面的实践技能和科学作风，学习掌握工程设计的方法和组织实践的基本技能。3 设 计 指 标 及 要 求3.1 设计一个可供8名选手参加比赛的8路数字显示抢答器。他们的编号分别为1、 2、 38各用一个抢答按钮，编号与参赛者的号码一一对应，此外还有一个按钮给主持人用来清零。3.2 抢答器具有数据锁存功能，并将锁存的数据用led数码管显示出来。在主持人将系统清零后，若有参赛者按动按钮，数码管立即显示出最先动作

5、的选手的编号，（也可同时用蜂鸣器发出间歇声响，并保持到主持人清零以后。3.3 抢答器对抢答选手动作的先后有很强的分辨能力，即使他们的动作仅相差几毫秒，也能分辨出抢答者的先后来。即不显示后动作的选手编号。3.4 主持人有控制开关，可以手动清零复位3.5 竞赛器具有可调倒计时的功能，且倒计时的时间由主持人设定（如30秒）。当主持人启动“开始”键后，定时器进行倒计，也可根据比赛的实际情况设计答题倒计时的时间。4 总 体 框 图 设 计 与 论 证 图1-1 设计原理方框图如图所示为总体方框图。其工作原理为：1.接通电源后，主持人将开关拨到“清除”状态，抢答器处于静止状态，编号显示器和指示灯灭，等主持

6、人将开关置“开始”位置后，抢答器处于等候状态，此时可以进行抢答。2.抢答器完成，优先判断抢答的组号，并将编号进行锁存，然后通过译码器将编号显示在七段数码管上，并且扬声器提示。3.如果再次抢答必须由主持人操作“清除”和“开始”状态的开关，即需要主持人清零。4.选手答题时可以通过可调计时器设定时间。5 功 能 模 块 设 计 及 系 统 工 作 分 析5.1 功能模块设计图1-2-1抢答器电路原理图数字竞赛器的电路原理图如图1-2-1，该竞赛器电路由复位电路、抢答触发控制电路、 led 数码显示电路、计时电路等组成。复位电路由复位按钮、限流电阻、两输入与非门74ls00、八输入与非门74ls30以

7、及d锁存器74ls573的两个使能控制端锁存允许端le端（高电平有效）和三态允许控制端oe端（低电平有效）等组成。抢答触发控制电路由抢答按钮 -、限流电阻 -以及74ls573的八个输入端等组成。 led 数码显示电路由10线-4线的编码器74ls147、七段译码器cd4511、七段共阴数码管等组成。可调计时器的原理图如图1-2-2，该电路主要由555提供计数脉冲，经过74ls192组成的计数电路，由4511与74ls48译码，再由数码管显示所构成。其中主要由74ls00与非门构成的二选一数据选择器和rc去抖动电 路实现该电路的可调性。5.2 系统工作原理分析图1-2-2可调计时器电路原理图数

8、字竞赛器的电路原理图如图1-2，该电路采用6个数字集成电路，其中74ls573为d锁存器，74ls30为8输入的与非门，74ls00为两输入与非门，74ls147为10线-4线的编码器、cd4511为七段译码器、以及七段共阴数码管等组成。为了使译码后数码管能显示数字，该电路将译码器的d端输入接74ls573的锁存控制输入端，数字被锁存时，该端为低电平，数码管为正常显示数字；允许数据输入时，74ls573的11脚为高电平，经过译码后数码管不显示，这样正好满足了电路的要求。比赛时，、由参赛选手控制，由主持人控制。该键在主持人喊“开始”前按下，开始后当任意一个选手抢先按下按钮时，74ls30的输出将

9、跳变为低电平，这个低电平使74ls573处于锁存状态，那么其他选手再按抢答按钮就无效了。此时它的输出、.被锁存，随即编码器进行编码。74ls147为10线到4线的编码器，输入端为低电平有效，输出为反码。编码完毕经cd4511译码后通过七段共阴数码管将相应抢答选手编号显示出来。同时74ls30的这个低电平使二极管vd导通，驱动蜂鸣器bl发出“嘀”声。一轮抢答结束，由主持人按动清除复位按钮，对d锁存器进行解锁。又进行下一轮抢答。当允许数据输入时，74ls573的11脚为高电平，经过译码后数码管不显示。同时bl不发音。5.3 主 要 元 器 件 功 能 介 绍5.3.1 锁存器（74hc573）锁存

10、器74hc573的输出端为 可直接与总线相连。当三态允许控制端 oe 为低电平时， 为正常逻辑状态，可用来驱动负载或总线。当oe 为高电平时， 呈高阻态，即不驱动总线，也不为总线的负载，但锁存器内部的逻辑操作不受影响。当锁存允许端 le 为高电平时，q 随数据d 而变。当le 为低电平时，o 被锁存在已建立的数据电平。 输出能直接接到cmos，nmos 和ttl 接口上。 操作电压范围：2.0v6.0v 低输入电流：1.0ua cmos 器件的高噪声抵抗特性 引出端符号： 数据输入端 oe 三态允许控制端（低电平有效） le 锁存允许端 输出端 74ls573外部管脚图如图1-3： 图1-3

11、74ls573引脚图 真值表如表1-1所示： 表1-15.3.2 优先编码器（74ls147）优先编码器是当多个输入端同时有信号时,电路只对其中优先级别最高的输入信号进行编码。10线-4线8421 bcd码优先编码器74ls147的引脚图如图3.4所示，其中第9脚nc为空。74ls147优先编码器有9个输入端和4个输出端。某个输入端为0，代表输入某一个十进制数。当9个输入端全为1时，代表输入的是十进制数0。4个输出端反映输入十进制数的bcd码编码输出。 图1-5 74ls147引脚图5.3.3 计数器 （74ls192）192 的清除端是异步的。当清除端（mr）为高电平时， 不管时钟端（cpd

12、、cpu）状态如何，即可完成清除功能。192 的预置是异步的。当置入控制端（）为低电平时， 不管时钟cp的状态如何，输出端（q0q3）即可预置成与数据输入端（p0p3）相一致的状态。 192 的计数是同步的，靠cpd、cpu同时加在4 个触发器上而实现。在cpd、cpu上升沿作用下q0q3 同时变化，从而消除了异步计数器中出现的计数尖峰。当进行加计数或减计数时可分别利用cpd或cpu，此时另一个时钟应为高电平。当计数上溢出时，进位输出端（）输出一个低电平脉冲，其宽度为cpu低电平部分的低电平脉冲；当计数下溢出时， 错位输出端（）输出一个低电平脉冲，其宽度为cpd低电平部分的低电平脉冲。功能表如

13、表1-2：表1-25.3.4 显示译码器（cd4511、74ls48）cd4511、74ls48是用于驱动共阴极 led （数码管）显示器的 bcd 码七段码译码器，特点：具有bcd转换、消隐和锁存控制、七段译码及驱动功能的cmos电路能提供较大的拉电流。可直接驱动led显示器。引脚排列如图 3.5 所示。其中a b c d 为 bcd 码输入，a为最低位。lt为灯测试端，加高电平时，显示器正常显示，加低电平时，显示器一直显示数码“8”，各笔段都被点亮，以检查显示器是否有故障。bi为消隐功能端，低电平时使所有笔段均消隐，正常显示时， b1端应加高电平。另外 cd4511有拒绝伪码的特点，当输入

14、数据越过十进制数9(1001)时，显示字形也自行消隐。le是锁存控制端，高电平时锁存，低电平时传输数据。ag是 7 段输出，可驱动共阴led数码管。另外，cd4511显示数“6”时，a段消隐；显示数“9”时，d段消隐，所以显示6、9这两个数时，字形不太美观。 图1.6 cd4511引脚图bi：4脚是消隐输入控制端，当bi=0 时，不管其它输入端状态如何，七段数码管均处于熄灭（消隐）状态，不显示数字。 lt：3脚是测试输入端，当bi=1，lt=0 时，译码输出全为1，不管输入 dcba 状态如何，七段均发亮，显示“8”。它主要用来检测数码管是否损坏。le：锁定控制端，当le=0时，允许译码输出。

15、 le=1时译码器是锁定保持状态，译码器输出被保持在le=0时的数值。a1、a2、a3、a4、为8421bcd码输入端。a、b、c、d、e、f、g：为译码输出端，输出为高电平1有效。图1.7 74ls48引脚图 输出端（yayg）为高电平有效，可驱动灯缓冲器或共阴极vled。当要求输出 015 时，消隐输入（）应为高电平或开路，对于输出为0 时还要求脉冲消隐输入（）为高电平或者开路。当为低电平时，不管其它输入端状态如何，yayg均为低电平。当rbi和地址端（a0a3）均为低电平，并且灯测试输入端（）为高电平时， ya yg为低电平，脉冲消隐输出（）也变为低电平。当为高电平或开路时，为低电平可使

16、yayg均为高电平。48 与248 的引出端排列、功能和电特性均相同，差别仅在显示6 和9,248 所显示的6 和9 比48 多出上杠和下杠。引出端符号 a0a3 译码地址输入端/消隐输入（低电平有效）/脉冲消隐输出（低电平有效） 灯测试输入端（低电平有效） 脉冲消隐输入端（低电平有效） yayg 段输出5.3.4 控制电路(74ls00和74ls30)74ls30 74ls00的引脚图真值表下（图1-8和图1-9）：图1-8 74ls30的引脚图及真值表图1-9 74ls00的引脚图及真值表6 实 验 器 材 清 单表1-2数字竞赛器元器件清单表种类数目1k电阻210k电位器1110电阻23

17、620电阻447k电阻274hc573174ls00274ls30174ls1471cd4511274ls481cd401922ne5551数码管3蜂鸣器10.01uf电容110uf电容147nf电容31.5伏电池3触发开关12其中：j0-j9为触发型开关74ls573为8d锁存器 74ls30为8输入与非门74ls00为2输入与非门 74ls147为10-4线的编码器 cd4511 、74ls48为七段译码器ne555为脉冲信号发生器cd40192为同步十进制计数器 7 设 计 步 骤 及 各 功 能 电 路 调 试7.1 仿真首先是查资料设计出图1-2-1与1-2-2电路，然后用multi

18、sim仿真。仿真的时候我是一级一级进行仿真，最后把每级都连进来再仿真。仿真成功后我就去实验室在实验板上搭电路。在搭电路之前先测试各元器件及各逻辑门的逻辑功能。然后在实验板上搭接组装电路。搭接的原则跟仿真的一样，按模块调试。7.2 调试锁存器电路。图1-10 锁存电路如果不能锁存，或是锁存不了1和7，则问题在锁存电路，应该从原理上进行分析。锁存电路的设计原理是：启用cd4511的锁存功能端le，高电平有效，即输入高电平时执行锁存功能。锁存器应能锁定第一个抢答信号，并拒绝后面抢答信号的干扰。如何设计呢，我们对09十个数字的显示笔段进行分析，只有0数字的d笔段亮与g笔段灭，其它数字至少有一点不成立。

19、由此可以区分0与其它数字。我们将led管的a笔段与g笔段的输入信号反馈到锁存电路，通过锁存电路控制锁存端le输入为0或1（锁存与否）。当led显示器显示为0时，le=0，cd4511译码芯片不锁存；当led显示器显示其它数字时， le=1，芯片锁存。这样只要显示器上显示为0，cd4511译码芯片才不锁定，显示其它数字均锁存。所以只要有选手按了按键，显示器上一定是显示18的数字，le=1芯片锁存，之后任何其他选手再按下按键均不起作用。例如键先按下，显示器上显示1，le=1芯片锁存，其他选手再按，显示器上仍显示1，按下之后的任一按键信号均不显示。直到主持人按清零键，显示器上又显示0，le=0，锁存

20、功能解除，又开始新一轮的抢答。若所有的数字都不能锁存，说明不管led显示什么数字，cd4511管脚的5脚输入为低电平，可能是5脚与地短接或者是锁存电路的两个二极管vd13和vd14断开等故障；若只有1和7两个数字不显示则可以分析一下其原因：显示1和7数字时g段不亮，cd4511的g输出端为低电平，vd14截止，而b段亮d段不亮本应该三极管vt截止而使vt13导通，产生高电平（锁存信号）给le，现在不能锁存说明vd13截止，推断是三极管击穿损坏。7.3 调试编码与译码显示电路显示器上不显示数字，我们从后级往前级进行测试，首先用1.52v的电压作用各个笔段,看对应各笔段是否亮,判断是否完好。若完好

21、则继续检测cd4511芯片是否完好。在cd4511的a、b、c、d四个输入端随意输入一组二进制数码，看是否能显示数字。无显示的故障一般问题出在这两个环节。若显示器上显示的是不符合要求的数字，在设计原理正确的前提下，首先通过测试判断cd4511的输出ag与led管的ag笔段是否连接有错。其方法是cd4511的输出ag分别按规律输入高低电平，观察led管是否显示相应的数字。如果这个环节正常，则问题在二极管编码电路，再逐一进行检查。图1-11 编码与译码显示电路7.4 调试控制电路在测试的过程中一定要注意，高低电平的测试电压数值要针对不同的电路而选取不同的数值。比如，针对led管，高电平只能用1.5

22、2v,而在cd4511的输入端高电平要用到8v以上的电源电压。选高了，会烧管子；选低了，会看不到效果，甚至产生误判断。 进行整体电路调试，观察抢答器工作情况，并记录结果。7.5 秒脉冲 由集成电路定时器555与rc组成的多谐振荡器，产生1hz的脉冲信号。图1-12 秒脉冲产生电路7.6 调时电路 当要为选手给定答题时间时，可以通过调整十位和个位得到所要的时间。由于开关闭合和断开是能会产生抖动，为防止这一情况的发生我们接入一个rc组成的防抖动电路来控制。图1-13 调时电路8 心 得 体 会这次课程设计充分的把我所学的知识用到实践中，并且使我初步掌握了电路设计的基本方法。我们要先设计总体框架，然

23、后把框架进行分解、分析。我们只有把每个小模块都设计好了才能设计成大电路。在搭接电路时更应该如此，我们搭完每个小模块时就要开始对它进行调试，调试成功以后再把模块一个一个连接起来并且每接入一个模块就要进行调试。所以调试是一个很艰难的阶段，我们必须做到细心、耐心、恒心；否则电路很难会成功。此次课程设计我选择的课题是数字竞赛器，我之所以选这个课题是因为它比较实用，而且它要用到锁存器、优先编码器、译码器、计数器、与非门、ne555等芯片，芯片种类比较多，这可以让我更加深入的掌握这些常用芯片。通过查资料我初步设计了两种方案：一个主要采用集成组合逻辑电路，方案二主要采用的是集成时序逻辑电路。具体方案如下：方

24、案一：该方案核心元件是一个8d锁存器74hc573实现抢答与锁存功能。它的8个输入分别由限流电阻接到抢答按钮处由选手控制。主持人控制清零复位按钮。74hc573的8个输入接到8输入与非门与非后的结果再与电阻r9与非后接到74hc573的所存允许控制端le端。如此一来，在主持人按下清零按钮后，只要有一个选手按下抢答按钮，则经过一系列与非le就跳变高电平，使得74hc573处于锁存状态。那么其他选手再按抢答按钮就无效了。同时74hc573的 8个输出接到编码器的输入端，编码后再由译码器译码后由七段共阴数码管显示出来。为了使译码后数码管能显示数字，该电路将译码器的d端输入接74hc573的锁存控制输

25、入端，数字被锁存时，该端为低电平，数码管为正常显示数字；允许数据输入时，74hc573的11脚为高电平，经过译码后数码管不显示。音频电路可以用二极管的开关特性来控制。方案二：该电路采用的主要是一个8d触发器集成电路74ls273，接通电源后，复位电路产生复位电压并加至 ic1 的cr端，使 ic1 清零复位。 在未按动抢答按钮 s1-s8 时 ,ic1 的八个输入端 (d1 d8 )和八个输出端 (q1 q8) 均为低电平，晶闸管 vt 处于截止状态，led 数码显示器无显示，扬声器 bl 无声音。当按动抢答按钮 s1-s8 中某支开关时，与该开关相接的隔离二极管将导通，使 vt 导通，其阴极

26、变为高电平；一方面通过c2触发音乐集成电路 ic3 , 使其工作，驱动扬声器 bl 发出 “叮、咚 ”声；另一方面使 ic1 的 ck 端由低电平变为高电平，使 ic1 内相应的触发器动作，相应的输出端输出高电平并被锁存。此高电平经ic2译码处理后，驱动 led 数码显示器显示相应的数字( 若按动按钮s8，则 ic1 的d8和q8端均变为高电平，led 数码显示器显示数字“8”) 。一旦电路被触发工作后，再按其他各抢答开关时，均元法使 ic1 的输出数据再发生改变，led 数码显示器中显示的数字也不会变化，扬声器 bl 也不会发声，从而实现了优先抢答。只有在主持人按动一下复位按钮 so 后，电路将自动复位，led 数