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文档简介
第5章例题讲解【例5.7-1】图所示为用于驱动7段显示器的有限状态机,状态机的输出信号为A、B、C、D、E、F、G,当输出信号为高电平时,对应的段码点亮。7段显示器循环显示0→1→2→3,显示段码如图所示。用D触发器和组合逻辑电路实现状态机。解:根据题意,状态机的真值表如表所示。Q1nQ0nQ1n+1Q0n+1GFEDCBA00010111111011000001101011101101111001001111第5章例题讲解第5章例题讲解012301第5章例题讲解【例5.7-2】设计串行数据检测有限状态机。X为串行输入数据,Y为串行输出数据,该有限状态机用于检测1101。X:0011101010101101101……Y:0000001000000001001……怎么判断米里型状态机还是摩尔型状态机?解:(1)状态定义S0:接收到一个0;S1:接收到一个1;S2:连续接收到11;S3:连续接收到110;S4:连续接收到1101。第5章例题讲解现态X=0X=1S0S0S1S1S0S2S2S3S2S3S0S4S4S0S2S1和S4两个状态等价,因此可以把S4的状态删掉。第5章例题讲解状态编码:S0:00,S1:01,S2:10,S3:11第5章例题讲解,,,用JK触发器实现第5章例题讲解电路仿真结果:11101思考:如何用VerilogHDL描述该数据检测状态机?第5章例题讲解【例5.7-3】设计一个摩尔型状态机,控制A/D和D/A转换器工作,A/D转换器连续采集正弦信号,并通过D/A转换器回放波形。示意图如图所示。每一次转换分为三个步骤第5章例题讲解第5章例题讲解采用Gray码对状态编码S0:00;S1:01;S2:11;S3:10第5章例题讲解
第5章例题讲解
第5章例题讲解
顶层原理图第5章例题讲解
示波器实测波形A/D输入信号D/A回放信号第5章例题讲解
moduleMOORE(INT,CP,ADWR,ADRD,DAWR);inputINT,CP; outputADWR,ADRD,DAWR;regADWR,ADRD,DAWR;reg[1:0]CURRENT_STATE;reg[1:0]NEXT_STATE;parameterS0=2'b00;parameterS1=2'b01;parameterS2=2'b11;parameterS3=2'b10;状态机的VerilogHDL描述第5章例题讲解
always@(CURRENT_STATEorINT)begincase(CURRENT_STATE)S0:beginADWR<=1'b1;ADRD<=1'b1;DAWR<=1'b1;NEXT_STATE<=S1;endS1:beginADWR<=1'b0;ADRD<=1'b1;DAWR<=1'b1;NEXT_STATE<=S2;end第5章例题讲解
S2:beginADWR<=1'b1;ADRD<=1'b1;DAWR<=1'b1;if(INT==1'b0)NEXT_STATE<=S3;elseNEXT_STATE<=S2;endS3:beginADWR<=1'b1;ADRD<=1'b0;DAWR<=1'b0;NEXT_STATE<=S0;endendcaseendalways@(posedgeCP)begin
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