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文档简介

Lecture6:Multi-CycleandMicroprogrammedMulti-CycleMulti-CycleMulti-CycleMulti-CycleMicroarchitecture依序进行状态间变换来状态之间的转换行为，决定下一个状态以及对应的Controlstore保存了与每个可能状态相应的控制信号（保存了整个状态机的Microinstructions）组LC-3b35MAR<!MAR<!PCPC<!PC+MDR<! IR<!BEN<!IR[11]&N+IR[10]&Z+IR[9]&[IR[15DR<!SR1+OP2*setDR<!SR1&OP2*setPC<!DR<!SR1XORsetPC<!MAR<!LSHF(ZEXT[IR[701MDR<!M[MAR]R7<! PC<!R7<!PC<!R7<!PC<!DR<!set DR<!PC+LSHF(off9,setMAR<!MAR<!B+LSHF(off6,1)MAR<!MAR<!MDR<!M[MAR[15MDR<!MDR<!MDR<!SR[7RRsetRDR<!setRM[MAR]<!M[MAR]<!

LC-3b控制信号（26个）决定了一个时钟周期内数据通路LC-3bMicroinstructioncontrolstore（一个特殊的存RR6926x(J,COND,不定延时35的转换（ R66AddressofNext的ISA翻译成microcode（microinstructions序列Microcode使最精简的数据通路能够运行microcode的Lecture7:Pipelining:Pipelinepipelinepipeline不出处理资源对于结构使用多个接解决方式2：检测到资源，暂停相互竞争的阶段的其5antidependency和outputdependency情况下 DependenceHandlingDataconsumerproducer指令将数据写到寄存器中producer的数据有效，紧接着就将数据提供给好处：一旦提供了数据，consumerpipeline中向后对于一个给定的pipeline，两个数据有依赖性的指令出现潜在的条件writeA（writeread，AW（writeafterwrite） dist(X,Y)—>Unsafetokeepjmoving >dist(X,Y)—>SafeRAW指令IAIB（IA在IB之前）RAWdist(IA,IB)dist(ID,WB)=PCIR的锁存；保证停滞的指令停留在它所处阶段如果在译码阶段的指令IB在EX，MEM或者WB阶段Control

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