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文档简介

本次课程讲述内容译码器的应用，重点是用译码器实现组合逻辑函数。变量译码器输出端表示一项最小项

——组合逻辑电路设计的基础数据选择器与多路分配器，数据选择的扩展方法。例：用4-10译码器（8421BCD码译码器）实现单“1”检测电路译码器及其应用&例：译码器组成电路如图所示，试写出函数表达式并作出对应函数的卡诺图&&译码器的输出均对应一个最小项，且一般以低电平表示有信号译码器及其应用00011110001101111101ABCD译码器及其应用0001111000111101111111110111ABCD译码器及其应用（5）数字显示译码器七段数码管八段数码管译码器及其应用h半导体发光二极管译码器及其应用&共阳极共阴极译码器及其应用××液晶显示器件显示译码器译码器及其应用译码器及其应用十进制数LTRBIBIDCBAabcdefg0123456789x011111111111xx01xxxxxxxxx0111111111111xxxxxxxx000000000001001000110100010101100111100010011010101111001101111011111111111000000011111110000001100111100100100000110100110001001001100000000111100000000001100111001011001101011100011010011100001111111共阳数码管数据选择器与多路分配器数据选择器与多路分配器数据选择器（MUX）数据输入端地址变量禁止端输出端数据选择器（MUX）四选一数据选择器功能表地址选通数据输出A1A0EDFXX1X0

000D0~D3D0

010D0~D3D1

100D0~D3D2

110D0~D3D3数据选择器（MUX）常用的集成数据选择器

双四选1MUX：74LS153

四二选1MUX：74LS158

八选1MUX：74LS151

十六选1MUX：74LS150扩展方法利用使能端不用使能端数据选择器（MUX）扩展方法A2A1A0F000001010011100101110111D0D1D2D3D4D5D6D7用使能端例：四选一扩大为八选一数据选择器（MUX）扩展方法A2A1A0F000001010011100101110111D0D1D2D3D4D5D6D7用使能端例：四选一扩大为八选一数据选择器（MUX）数据选择器（MUX）数据选择器（MUX）≥11：已知逻辑函数试用一片3-8译码器和一块与非门实现F1；一片3-8译码器和一块与门实现F2。作业：

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