


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
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文档简介
OrCADCaptureHomWo
OCT.22/031OrCADCaptureOrCADCapture
1OrCADCapture软件简介ConceptofCapture2电路图设计绘制NewProjectDesign3电路图的后处理ProjectPostProcessing4元器件图形符号库ComponentLibrary
5Q&A2OrCADCapture1OrCADCapture1OrCADCapture软件简介1.1OrCADCapture软件构成
1.2OrCADCapture功能特点1.3OrCADCapture文档类型31OrCADCapture软件简介31.1OrCADCapture软件构成
设计项目管理模块
ProjectManager
建库模块元器件库
PartEditorLibrary
电路图绘制模块
CIS(ICA)PageEditor
后处理工具
电练接网络表文件生成统计报表输出
41.1OrCADCapture软件构成1.2OrCADCapture功能特点
CaptureCIS运行的环境是Windows图形界面,在屏幕上可以打开多个窗口,显示电路图中的不同部分的内容。Capture和其他Layout软件可以实现更新的前向传递(ForwardAnnotating)、反向(BackAnnotating)和信息的参照显示(Cross-Probing)。电路图中可以绘制多种几何图形,添加文字字符,插入Bitmap格式图形。可以为元器件添加用户自定义属性参数。………51.2OrCADCapture功能特点Capture1.3OrCADCapture文档类型²
*.opj—专案管理文件²
*.dsn—电路图文件²
*.olb—图形符号库文件²
*.log—记录说明文件
²
*.net—网络表文件²
*.drc—DesignRuleCheck文件²
*.bom—BOM表
61.3OrCADCapture文档类型²
*2电路图设计绘制2.1Capture设计过程设计环境NewProject绘制电路图电路图后处理72电路图设计绘制2.1Capture设计过程设计环2.2Capture操作环境Capture主要有三个主要的工作窗口专案管理视窗(Projectmanager):管理与原理图相关的一系列文件,相当于资源管理器。
Schematic视窗:原理图窗口,相当于一张图纸。资讯查看视窗(SessionLog):用于显示相关操作的提示和出错资讯。82.2Capture操作环境Capture主要有三个主要ProjectManagerSessionLogSchematic窗口99ProjectManagerSessionLogSche2.3Capture设计参数设置Colors/Print:colorsettingGridDisplay:setgriddisplaymodePanandZoom:设置放大缩小的倍数Select:selectmodesettingMiscellaneous:otherssettingsuchasLineStyleTextEditor:setsomethingabouttexteditorBoardSimulation:providesamethodforyoutosimulateyourPCBdesigns(whichmayincludeFPGAdesigns,ascomponents).环境参数包括:系统属性及设计模板。系统属性包括(Options>Preferences)102.3Capture设计参数设置Colors/Print系统设计模板参数包括(Options>DesignTemplate)Fonts:setallkindsoffontTitleBlock:标题栏内容的设定PageSize:绘制图纸大小的设定GridReference:边框设定与显示Hierarchy:设置阶层的属性SDTCompatibility:与SDT文件相容性的测试11系统设计模板参数包括Fonts:setallkinds2.4CreateanewdesignprojectCapture的Project使用来管理相关文件及属性的。新建Project的同时,会自动生成相关的DSN,OPJ文件等。根据不同后续处理的要求,新建Project时必须选择相应的类型。Capture支援四种不同的Project类型。File>New>ProjectAnalogorMixed-signalCircuit
数字/模拟混合仿真PCBoardWizard
设计PCB板ProgrammableLogicWizard
设计可编程器件Schematic
电路原理图设计Name:Thenameoftheproject
Location:Thesavepathofproject122.4Createanewdesignprojec2.5绘制电路图
新建Project之后,进入Schematic窗口,则在右边窗口会出现下图的工具栏:PlacePartPlaceWirePlaceNetNamePlaceBusPlaceJunctionPlacePower放置阶层放置埠放置分页纸间的介面PlaceGND放置阶层引脚绘制无电气特性之符号添加文字指示管脚NC放置总线引出管脚132.5绘制电路图新建Project之后,进入Schema1)PlacePart
点击PlacePart快捷按钮和点击Place>Part,出现如下对话框:要选择的器件当前使用库中的元器件当前使用的库添加新的库文件删除当前选中的库显示当前选中元器件的外形搜索元器件141)PlacePart要选择的器件当前使用库点选PartSearch…按钮后,出现如下对话框:搜索的内容,支持*号统配符搜索的结果搜索的目标路径,即只搜索该目录下的库文件中的元器件15点选PartSearch…按钮后,出现如下对话框:搜2)Placewireandbus点击PlaceWire(PlaceBus)按钮进入连线(放置总线)状态,鼠标会变成十字形。移动鼠标点击左键就可以开始连线(连接总线)。连线的时候在交叉地方出现的小红点(Junction);或者可以点击Placejunction,再把鼠标移到交叉点并点击即可。放置总线后,点击placebusentry按钮放置总线引出管脚,管脚的一段要放在总线上。162)Placewireandbus点击Plac3)Placenetname
点击placenetalias按钮,调出placenetalias对话方块,在alias对话框中输入需要定义的名字,然后点击OK退出对话框,移到需命名的net上,点击左键即可。注意:总线与总线引出线一定要定义netname。173)Placenetname点击placenet4)PlacepowerorGND
点击Placepower(PlaceGND)Power以及GND的种类原理图上power或GND的网络名称184)PlacepowerorGND点击Place5)放置埠和分页纸间的介面点击PlaceHierarchicalPort(PlaceOffconnector)当前使用库中的元器件电路图上的名称195)放置埠和分页纸间的介面点击Plac
不同埠的区别在于器类型的不同,它的类型可以从它的Type属性中得知,双击埠或者选其EditProperties:20不同埠的区别在于器类型的不同,它的类型可以从它的T6)放置无电气特性之符号点击相应的符号按钮添加一些没有电器特性的图形和文字,在Place菜单下有七条绘制命令:放置文本字符(Text);绘制直线(Line);折线(Polyline);矩形(Rectangle);椭圆(Ellipse);弧形(Arc)。216)放置无电气特性之符号点击相应的符号7)PlaceText点击PlaceText按钮如果文本文件需要换行,按Ctrl+Enter更改文本字体及颜色文本内容227)PlaceText点击Place电路图的后处理原理图绘制结束之后,接下来就是对电路图进行DRC检测,生成网络表(NetList)和材料清单(BOM)。3.1DRC(DesignRuleCheck)3.2Annotate3.3CreateNetlist3.4BillofMaterials23电路图的后处理原理图绘制结束之后,接下来就是对 电路设计
第一阶段元器件编号(Annotate)
设计规则检查(DRC:DesignRulesCheck)
元器件信息统计(CrossReference)
第二阶段
元器件属性参数更新(Update/Export/ImportProperties)
第三阶段第四阶段网络表生成(Netlist)统计报表生成(BOM)24 电路设计
243.1DRC(DesignRuleCheck)
点击按钮或(Tools>Design>DesignRuleCheck):253.1DRC(DesignRuleCheck) Scope:
Checkentiredesign:DRC检查整个原理图
Checkselection:DRC只检查你选择的部分Mode:
Useinstances(preferred):使用当前属性(建议)Action:
Checkdesignrules:进行DRC检测
DeleteexistingDRCmarks:删除DRC检测标志26Scope:26
Report:CreateDRCmarkersforwarnings:Warning也放置DRC错误标示Checkhierarchicalportconnections:
检验分层式结构电路图中,上一层次电路图中子电路框图引出端与代表该框图结构的下一层次电路图中的端口是否匹配一致.如果在上下层之间,端口和引出线的类型不匹配或名称不完全相同,将出现出错信息.Checkunconnectednets:
检查是否有与一个节点连线少于两根的情况Checkoffconnectorconnections:
检验不同页面电路图之间的offconnector的名称是否一致CheckSDTcompatibility:
检验电路中是否存在不符合SDT格式要求的情况Reportidenticalpartreferences:
检验是否存在不同元器件具有相同元器件符号的情况Reportoff-gridobjects:
检查电路图中是否存在元器件的引出端口未位于电路图网格点的情况Reportinvalidpackaging:
检验是否存在元器件与设置的封装类型,编号不匹配的情况Reportallnetnames:
在输出文件中,列出电路中所有的结点名,包括用户设置的结点名以及capture确定的结点名Reporthierarchicalportsandoffconnectors:
在输出文件中列出电路中所有的子电路端口和端口连接符ViewOutput:
在完成DRC检查后,即自动调用文本编辑输出文件的内容.27Report:27ERCMatrixTabSettherulesusedbytheDesignRulesCheckwhentestingconnectionsbetweenpins,hierarchicalblocks,andhierarchicalports.28ERCMatrixTabSettherule3.2Annotate
点击(Tools>Annotate),调用自动排序功能Scope:Updateentiredesign:更新整个设计Updateselection:更新选择部分Action:
Incrementalreferenceupdate:
在现有的基础上进行增加排序
Unconditionalreferenceupdate:
无条件进行排序
Resetpartreferenceto“?”:把所有的洗好都变成“?
AddIntersheetReferences:
在分页图纸间的埠的序号加上图纸编号
DeleteIntersheetReferences:
删除分页图纸间的埠的序号上的图纸编号Combinedproperty:
把对话方块中的属性相结合Resetreferencenumberstobeginat1eachpage:
编号时每张图纸都从1开始Donotchangethepagenumber:不要改变图纸的编号293.2Annotate 点击(Tools>An3.3CreateNetlist
点击(Tools>CreateNetlist),调用网络表生成功能303.3CreateNetlist 点击(To3.4BillofMaterials
点击(Tools>BillofMaterials…),产生材料清单:定义材料清单的内容BOM表上每个器件占一行在BOM表中加入其他文件313.4BillofMaterials 点击4元器件图形符号库
新建图形符号,先新建图形符号库,在功能表中选择File>new>library,然后ProjectManager中选中库,点击右键,选择Newpart:324元器件图形符号库新建图形符号,先新建图形符号库,器件的名称器件编号的首字母相应器件的封装一个器件包含多少个部分器件不同部分之间的区分(数字/字母)Pin脚序号是否可见器件的名称封装中器件的类型(相同/不同)33器件的名称器件编号的首字母相应器件的封装一个器件包含多少个部PartEditor34PartEditor345Q&AQuestion355Q&AQuestion35OrCADCaptureHomWo
OCT.22/0336OrCADCaptureOrCADCapture
1OrCADCapture软件简介ConceptofCapture2电路图设计绘制NewProjectDesign3电路图的后处理ProjectPostProcessing4元器件图形符号库ComponentLibrary
5Q&A37OrCADCapture1OrCADCapture1OrCADCapture软件简介1.1OrCADCapture软件构成
1.2OrCADCapture功能特点1.3OrCADCapture文档类型381OrCADCapture软件简介31.1OrCADCapture软件构成
设计项目管理模块
ProjectManager
建库模块元器件库
PartEditorLibrary
电路图绘制模块
CIS(ICA)PageEditor
后处理工具
电练接网络表文件生成统计报表输出
391.1OrCADCapture软件构成1.2OrCADCapture功能特点
CaptureCIS运行的环境是Windows图形界面,在屏幕上可以打开多个窗口,显示电路图中的不同部分的内容。Capture和其他Layout软件可以实现更新的前向传递(ForwardAnnotating)、反向(BackAnnotating)和信息的参照显示(Cross-Probing)。电路图中可以绘制多种几何图形,添加文字字符,插入Bitmap格式图形。可以为元器件添加用户自定义属性参数。………401.2OrCADCapture功能特点Capture1.3OrCADCapture文档类型²
*.opj—专案管理文件²
*.dsn—电路图文件²
*.olb—图形符号库文件²
*.log—记录说明文件
²
*.net—网络表文件²
*.drc—DesignRuleCheck文件²
*.bom—BOM表
411.3OrCADCapture文档类型²
*2电路图设计绘制2.1Capture设计过程设计环境NewProject绘制电路图电路图后处理422电路图设计绘制2.1Capture设计过程设计环2.2Capture操作环境Capture主要有三个主要的工作窗口专案管理视窗(Projectmanager):管理与原理图相关的一系列文件,相当于资源管理器。
Schematic视窗:原理图窗口,相当于一张图纸。资讯查看视窗(SessionLog):用于显示相关操作的提示和出错资讯。432.2Capture操作环境Capture主要有三个主要ProjectManagerSessionLogSchematic窗口944ProjectManagerSessionLogSche2.3Capture设计参数设置Colors/Print:colorsettingGridDisplay:setgriddisplaymodePanandZoom:设置放大缩小的倍数Select:selectmodesettingMiscellaneous:otherssettingsuchasLineStyleTextEditor:setsomethingabouttexteditorBoardSimulation:providesamethodforyoutosimulateyourPCBdesigns(whichmayincludeFPGAdesigns,ascomponents).环境参数包括:系统属性及设计模板。系统属性包括(Options>Preferences)452.3Capture设计参数设置Colors/Print系统设计模板参数包括(Options>DesignTemplate)Fonts:setallkindsoffontTitleBlock:标题栏内容的设定PageSize:绘制图纸大小的设定GridReference:边框设定与显示Hierarchy:设置阶层的属性SDTCompatibility:与SDT文件相容性的测试46系统设计模板参数包括Fonts:setallkinds2.4CreateanewdesignprojectCapture的Project使用来管理相关文件及属性的。新建Project的同时,会自动生成相关的DSN,OPJ文件等。根据不同后续处理的要求,新建Project时必须选择相应的类型。Capture支援四种不同的Project类型。File>New>ProjectAnalogorMixed-signalCircuit
数字/模拟混合仿真PCBoardWizard
设计PCB板ProgrammableLogicWizard
设计可编程器件Schematic
电路原理图设计Name:Thenameoftheproject
Location:Thesavepathofproject472.4Createanewdesignprojec2.5绘制电路图
新建Project之后,进入Schematic窗口,则在右边窗口会出现下图的工具栏:PlacePartPlaceWirePlaceNetNamePlaceBusPlaceJunctionPlacePower放置阶层放置埠放置分页纸间的介面PlaceGND放置阶层引脚绘制无电气特性之符号添加文字指示管脚NC放置总线引出管脚482.5绘制电路图新建Project之后,进入Schema1)PlacePart
点击PlacePart快捷按钮和点击Place>Part,出现如下对话框:要选择的器件当前使用库中的元器件当前使用的库添加新的库文件删除当前选中的库显示当前选中元器件的外形搜索元器件491)PlacePart要选择的器件当前使用库点选PartSearch…按钮后,出现如下对话框:搜索的内容,支持*号统配符搜索的结果搜索的目标路径,即只搜索该目录下的库文件中的元器件50点选PartSearch…按钮后,出现如下对话框:搜2)Placewireandbus点击PlaceWire(PlaceBus)按钮进入连线(放置总线)状态,鼠标会变成十字形。移动鼠标点击左键就可以开始连线(连接总线)。连线的时候在交叉地方出现的小红点(Junction);或者可以点击Placejunction,再把鼠标移到交叉点并点击即可。放置总线后,点击placebusentry按钮放置总线引出管脚,管脚的一段要放在总线上。512)Placewireandbus点击Plac3)Placenetname
点击placenetalias按钮,调出placenetalias对话方块,在alias对话框中输入需要定义的名字,然后点击OK退出对话框,移到需命名的net上,点击左键即可。注意:总线与总线引出线一定要定义netname。523)Placenetname点击placenet4)PlacepowerorGND
点击Placepower(PlaceGND)Power以及GND的种类原理图上power或GND的网络名称534)PlacepowerorGND点击Place5)放置埠和分页纸间的介面点击PlaceHierarchicalPort(PlaceOffconnector)当前使用库中的元器件电路图上的名称545)放置埠和分页纸间的介面点击Plac
不同埠的区别在于器类型的不同,它的类型可以从它的Type属性中得知,双击埠或者选其EditProperties:55不同埠的区别在于器类型的不同,它的类型可以从它的T6)放置无电气特性之符号点击相应的符号按钮添加一些没有电器特性的图形和文字,在Place菜单下有七条绘制命令:放置文本字符(Text);绘制直线(Line);折线(Polyline);矩形(Rectangle);椭圆(Ellipse);弧形(Arc)。566)放置无电气特性之符号点击相应的符号7)PlaceText点击PlaceText按钮如果文本文件需要换行,按Ctrl+Enter更改文本字体及颜色文本内容577)PlaceText点击Place电路图的后处理原理图绘制结束之后,接下来就是对电路图进行DRC检测,生成网络表(NetList)和材料清单(BOM)。3.1DRC(DesignRuleCheck)3.2Annotate3.3CreateNetlist3.4BillofMaterials58电路图的后处理原理图绘制结束之后,接下来就是对 电路设计
第一阶段元器件编号(Annotate)
设计规则检查(DRC:DesignRulesCheck)
元器件信息统计(CrossReference)
第二阶段
元器件属性参数更新(Update/Export/ImportProperties)
第三阶段第四阶段网络表生成(Netlist)统计报表生成(BOM)59 电路设计
243.1DRC(DesignRuleCheck)
点击按钮或(Tools>Design>DesignRuleCheck):603.1DRC(DesignRuleCheck) Scope:
Checkentiredesign:DRC检查整个原理图
Checkselection:DRC只检查你选择的部分Mode:
Useinstances(preferred):使用当前属性(建议)Action:
Checkdesignrules:进行DRC检测
DeleteexistingDRCmarks:删除DRC检测标志61Scope:26
Report:CreateDRCmarkersforwarnings:Warning也放置DRC错误标示Checkhierarchicalportconnections:
检验分层式结构电路图中,上一层次电路图中子电路框图引出端与代表该框图结构的下一层次电路图中的端口是否匹配一致.如果在上下层之间,端口和引出线的类型不匹配或名称不完全相同,将出现出错信息.Checkunconnectednets:
检查是否有与一个节点连线少于两根的情况Checkoffconnectorconnections:
检验不同页面电路图之间的offconnector的名称是否一致CheckSDTcompatibility:
检验电路中是否存在不符合SDT格式要求的情况Reportidenticalpartreferences:
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