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文档简介

1、明德扬科技教育改错 1 练习官网：淘宝：群目录1_r 模块3明德扬科技公司主要是以 FPGA 为，专业从事 FPGA 配套开发板、FPGA 培训班或其他培训、研发 FPGA 技术开发、承接 FPGA 项目开发。欢迎加入明德扬 FPGA 和 ASIC97925396。明德扬以 PDF 格式提供源代码，是为了鼓励大家多思考，不要拿来就用，否则是学不好 FPGA 的。本代码对应的设计思路，请参考明德扬课程。1_r 模块moduleclk rst_n1(,/其他信号,举例 dout dout);/参数定义parameterDATA_W =3;/输入信号定义 inputinputclkrst_n;/输出

2、信号定义outputDATA_W-1:0dout;/输出信号 reg 定义regDATA_W-1:0dout;/中间信号定义regflag;/时序逻辑写法always(edge clk or negedge rst_n)beginif(rst_n=1b0)begin flag = 1b0;endelse if(flag=1b0 & dout=5) | (flag=1b1 & dout=7) begin flag = flag;endendalways(edge clk or negedge rst_n)beginif(rst_n=1b0)begin dout = 0;endelse if(flag=1b0)begin if(dout=5)begindout = 0;endelse begindout = dout + 1;endendelse beginif(dout=7)begin dout = 0;endelse be

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