FPGA数据采集

1、基于CPLD/FPGA高速数据采集系统的设计作者：时间：2009-07-02来源:0引言传统的数据采集系统一般采用单片机，系统大多通过PCI总线完成数据的传输。其缺点是数学运算能力差；受限于计算机插槽数量和中断资源；不便于连接与安装；易受机箱内电磁环境的影响。这些问题遏制了基于PCI总线的数据采集系统的进一步开发和应用。因此，需要一种更为简便通用的方式完成采集系统和计算机数据的交互。数据采集系统性能的好坏，主要取决于它的精度和速度。在保证精度的条件下应尽可能地提高采样速度，以满足实时采集、实时处理和实时控制的要求。实践表明，采用ARM32位嵌入式微处理器作为控制器，用USB（通用串行总线）和上

2、位机连接构成的数据采集系统能大大提高系统数据处理的能力，降低对PC机和接口速度的依赖。1系统硬件设计实现系统功能的基本思路是：以CPLD/FPGA实现仪器的数字平台，和ARM嵌入式处理器及单片机一起实现对整机的智能控制和高速的数据处理。11系统框图系统原理方框图如图1所示，该系统主要由微处理器、数字逻辑平台、输入控制、A，B通道输入处理、C通道输入处理、整形、A/D转换、采样时序控制、键盘液晶显示、存储器扩展等模块构成。丁通逍输入处理微处览器F输入拧制探样时学押制:PLL率合成斟输人避理v数字A,旦血逍输入处肆A/D转换F卜平114協盘液晶梶示图1承統框图1.2系统结构图系统硬件如图2所示,利

3、用一片规模较小的CPLD和一片规模较大的FPGA组合构成系统的数字逻辑平台。CPLD主要用作输入控制，FPGA则连接了系统的其他各个部分。CPLD/FPGA可实现现场编程，使用CPLD/FPGA可使设计方便，利用它灵活、校验快以及设计可随意改变的特点，可大大缩短研制时间。A,B输入nrr11昶-1d-w产A.BATOSBJFLFOA,&SCLKAf牛SCLKB+一一；一II；WCLKB11iriL上三CPL.0EPMniBATClJCiqARMLPC71讯srv2k伯比储圧-FPGA*EPIC6J2JO46泄品“班4圈饥槪0EFCSI-ADSlltl切油LPB9C5IRD2USpcIn2数提采

4、集系统结枸1.3主要部分功能1.3.1微处理器系统采用由Philips公司生产的ARM32位微处理器LPC2105作为主CPU,进行高速的数据处理，用8位单片机P89C51RD2作为辅CPU，进行速度较慢的数据处理，控制其他外围芯片和模块实现A，B通道模拟带宽100MHz、峰值电压100V和C通道二极管通断、电压、电流、电阻值的数据采集功能。132A，B通道部分通过自动增益电路(AGC)即程序控制放大器，将被测模拟信号调理到适合ADC芯片(AD9288)采样的范围。根据频率的大小和触发方式，运用实时采样或等效采样对调理后的模拟信号进行采样(A/D转换)。利用高速FIFO存贮器(IDT72V26

5、1LAI0A)存储采样后得到的数据。结合键盘操作和系统设置，对采样后的数据进行数学运算，将还原后的波形数据和参数送液晶显示器显示或存入闪存里面或通过USB接口传送给PC机，从而实现了A，B通道高速数据采集的功能。133C通道部分C输入通道为多功能输入通道，系统通过控制继电器矩阵来选择不同的模块测量电压、电流或二极管的通断和电阻。被测元件参数或电压、电流经过多功能转换电路处理后，其信号送24b的A/D转换器ADS1211采样后送单片机P89C51RD2,分析被测元件或电压、电流的参数值，从而实现了C通道高精度数据采集的功能。134键盘、液晶显示接口电路本系统采用4x8的键盘和320 x240不带

6、驱动器的液晶显示模块，驱动器和显存设计在FPGA内。以上系统通过USB接口与PC机通信，在上位机的控制下，实现可视化人机交互界面。同时系统也保留了传统的RS232接口，但只是用于ARM和单片机的编程下载。2软件设计流程LPC2105芯片作为系统主控制中心及数据处理中心，整个系统的运转受到它的控制，例如响应用户的按键操作，发出通道控制，A/D采样时钟控制，FIFO写时钟的选择，菜单及系统状态显示，FIFO数据的处理，信号或参数的自动测试等。数据采集卡的软件程序结构如图3所示，可分为系统初始化模块、键语分析模块、系统核心控制模块、通道控制模块、触发控制模块、A/D采样控制模块、FIFO读写控制模块

7、、读取频率字模块、参数测试模块、状态显示模块、波形显示模块、存储控制模块、其他功能模块。图3软件程序結枸系统的初始化模块包括开机自检、硬件参数初始化、系统状态初始化(如通道的波形显示状态初始化)等。键语分析模块对面板上的用户输入进行分析处理，通过核心控制模块调用相应的功能处理模块，通过对通道控制模块、触发控制模块、A/D采样控制模块、FIFO读写控制模块、读取频率字模块、参数测试模块、状态显示模块、波形显示模块、存储控制模块、其他功能模块的函数调用来实现对来自键语分析的处理功能。状态显示模块显示程序运行时的各种状态，如当前数据采集的扫描速率、通道的垂直灵敏度等。波形显示模块显示采集的波形。整个

8、系统的程序又可分成底层驱动和上层软件。底层驱动指对本系统其他外设或器件直接控制或访问的程序部分，包括LPC2105和单片机的初始化(即对片内各核心寄存器的操作赋值、对片上外设的初始化赋值、对片内各外设中断及外部中断的控制操作)。上层软件主要指：菜单的设计及显示、数据的处理、波形的恢复及平滑等。3系统性能指标3.1A,B通道的性能指标(1)模拟信号带宽：100MHz(40dB)；(2)最高实时采样率：100.MS/s；(3)最高等效采样率：5GSs；(4)垂直分辨率：8b；垂直灵敏度：5mV/div25V/diV；水平扫描：5ns/div10s/diV；最大输入电压：(AC+DC)100Vpp；

9、输入RC：1MQ1.5%/20pF3pF；耦合方式：直流、交流、接地；触发模式：交流、直流、高频抑制、低频抑制；触发源：A，B；存储深度：16K/通道；显示模式：A，-A，B，-B，A-B，A+B；测量信号参数：周期、频率、平均值、有效值、峰值、均方根值、最小值、最大值、上升时间、下降时、正频宽、负频宽、占空比；测量精度：5%；校准信号：1kHz/3.3V。2C通道性能指标测量电阻：100Q，1kQ，10kQ，100kQ，1MQ；测量电压：10mV，30mV，1V，3V，lOV，V：测量电流：200mA，1A；(4)二极管：通断测量；(5)测量精度：3。4结论本系统采用ARM+单片机+CPLD/FPGA的设计方案，其高速数据处理的任务可以由下位机独立完成，并且系统