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文档简介

1、组合电路的设计方法n数字电路的设计包括两个阶段：由逻辑功能的文字描述到某种形式 的逻辑描述之间的变换和各种逻辑描述之间的变换。i.由真值表、逻辑方程到门级实现图i 一种组合电路的设计过程例1算术逻辑运算单元（ALU的设计。算术逻辑运算单元是许多数字系统的主要部件，其框图如下:Cl = 1表21 ALU的功能表2.功能分析和函数分解例2设计如下图所示的并行补码变换器图2 1位ALUALU的功能表如下:F=A加E加1F = A>BF-XjOB m I44几,可控反相皆4位并行 加法渊并行补码 交换需变换器的输入是原码|S是符号位B = B3B2B1B0为数值位输出为相应的补码F= F3F2F

2、1F0图3并行补码变换器例3设计如下图所示的二进制加/减运算电路操作数A原=A3A2A1A0,B原=B3B2B1B0,是无符号二进制原码。结果用原码表示，F = F3F2F1F0为数值位,S为符号位,M为加/减控制信号FRF3 品打正冰电除 WVX符母付中成H世加法=1反国龙鹿1月/，岛id)图4无符号二进制加/减运算电路3 .改进原电路，实现逻辑功能图5力口/减运算电路之一4 .积木块化设计例4设计如图所示的8位算术比较器，该比较器接受两个无符号二进制数 A = a7a6a5a4a3a2a1a0和 B = b7b6b5b4b3b2b1bQ 当 A>B时，输出Z = 1 ;否则Z

3、 = 0。表4比较器积木块功能表图6比较器积木块如图6所示，用8个这样的积木块级联可以构成所需要的 8位数值比较器。|例6设计如图7所示的4位并行乘法器两个4位二进制数相乘的过程如下:A3A2AlAoB3B2BlBOA3 BO A2B0 A1B0 AOBOA1B1 A0B1A0B2A3B1 A2B1A3B2 A2B2 A1R2A3B3 A2B3 A1B3 A0B3图74位乘法器的一种电路图8用积木块构成的乘法器5 .逻辑验证和逻辑模拟要使设计结果必须符合设计要求，必须对设计结果进行检查和核对, 这就是逻辑验证。基于表格的事件驱动法，用若干张表格来描述逻辑图。图9 2选1MU龙辑图弓僮号由何姓累去阿姓P起蜡电平值1外人1Gt12府人1113外辖人G0415G日 "J06G1一：二G外救出I(«)兀杵号人用级号| 出引线号G八45G2、36我24Gi5 s7(b)表5引线表和元件表(«) Q) ® (dj (c)图10队列变化tfmL. <ob10如30501ii1 1 111120na j

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