《电子技术》实验课教学指导书

1、电子技术实验课教学指导书、八 、，刖言电子技术是本专业的学科基础选修课，主要讲授一般电路 的分析与设计。通过本课程的学习，使学生掌握半导体技术的基本 理论，能够利用所学知识进行常用电子线路的分析设计，为学习后 续课程打下基础。本课程的教学采用理论和实验相结合。通过实验, 不仅使学生掌握常用电子仪器和工具的使用方法以及电子线路的调 试方法，还可培养学生解决实际问题的能力。本课程开设的目的是要求学生熟悉数字电路的基本分析和设计 方法，为后续课程微机原理、组成原理和模拟电路做理论上的准备。本实验手册是我校电子技术实验指导的主要依据。根据实验大 纲要求，共包含6个实验。目录实验一仪器使用 门电路逻辑功

2、能测试 1实验目的 1实验原理及相关理论 1实验内容 3实验步骤 3注意事项 5实验二组合逻辑电路的设计与测试 6实验目的 6实验原理 6实验内容 7注意事项 7实验三 编码-译码-显示电路 8实验目的 8实验原理及相关理论 8实验内容 11注意事项 11实验四 触发器的测试及研究 12实验目的 12实验原理及相关理论 12实验内容 16注意事项 16实验五 时序电路的测试与研究 17实验目的 17实验原理及相关理论 17实验内容 19注意事项 19实验六555时基电路研究及应用 20实验目的 20实验原理及相关理论 20实验内容 21注意事项 22附录一实验要求 23附录二实验成绩的考核与评

3、定办法 24附录三实验项目设置与内容25实验一仪器使用门电路逻辑功能测试实验目的1 掌握实验装置和仪器的使用方法2 熟悉门电路的逻辑功能实验原理及相关理论1 各种门电路的逻辑功能ABY000001001g1与门真信表AY0110非门真值表ABYD00011i011!1或门事值表ABYD01011G11JU与mtn真值表A.耳Y001gi0i00i%Q或日日真值表ABY000I110I10异或n真值表2 从制作、组成上分为分立元件门电路、集成门电路(1) 分立元件门电路：是由一些独立的二极管、三极管、电阻、导线等器 件连接而成的线路，能实验一定的功能。(这种电路体积大)特点是电路中的各 元件都是

4、独立封装的。（2）集成门电路（半导体）：把各元器件利用半导体工艺制作在一片小小 的硅片上的电子线路。体积小，也就是芯片。整个电路封装在一个外壳中。（3） 集成电路有半导体集成电路、膜集成电路、混合集成电路。（从制作 工艺上分）膜集成电路可分为厚膜集成电路和薄膜集成电路两种。在绝缘基片上，由 薄膜工艺形成有源元件、无源元件和互连线而构成的电路称为薄膜集成电路。 在陶瓷等绝缘基片上，用厚膜工艺制作厚膜无源网络，然后装接二极管、三极 管或半导体集成电路芯片，构成有一定功能的电路就是厚膜集成电路。膜集成 电路由于制作工艺烦琐，成本较高，因而它的应用范围远不如半导体集成电路。混合集成电路是在基片上用成膜

5、方法制作厚膜或薄膜元件及其互连线，并 在同一基片上将分立的半导体芯片、单片集成电路或微型元件混合组装，再外 加封装而成。与分立元件电路相比， 混合集成电路具有组装密度大、 可靠性高、 电性能好。（4） 集成电路分为小、中、大、超大规模集成电路。（从规模上分）勿、规模：含有逻辑门数为110门；?中规模：含有逻辑门数为1099门；?大规模：含有逻辑门数为100999门；?超大规模：含有逻辑门数为1000门以上。?实验中用到的一些芯片是小规模的集成电路。（5）TTL电路（双极型）和CMOS电路（单极型）（从导电类型上分）TTL电路特点：驱动能力强，功耗大，工作电源为 5V;当输入端悬空时， 输入为”

6、态。（当输入端是高电平时可以悬空处理， 仅适用于小规模集成电路， 大规模集成电路输入端悬空时易受到干扰。）COMS电路特点：功耗小，驱动能力较小，工作电源为 318V，输入端不 允许悬空。我们实验中用到的芯片是 TTL和COMS电路，用5V的工作电源都可以满 足。（6）集成电路（芯片）的一些常识封装形式（管脚对外的样子）。常见的封装形式DIP，PGA, BGA。DIP双列直插式，适用于中小规模集成电路， PCB印刷电路板上常见；PGA插针网格阵列，我们的电脑中 CPU能看到这种封装形式；BGA球形阵列，表面安装，提高了组装的密度。随着芯片集成度提高，封 装技术也在不断改进。芯片管脚号码排列：芯

7、片型号上的字头朝上，一般左边有个半圆形的缺口，缺口下面的管脚为1号管脚，沿着逆时针方向，依次为 2、3、4如果是14 管脚的芯片，下面一排管脚依次为 17号（从左往右），上面一排依次为8 14号（从右往左），如图1-1所示。JU Fl冋同冋阖)SN74LS08NLU UJ kJ LK UJ kJ U图：1-1芯片管脚图型号命名规则（国内外常采用的）例如，SN74LS08NSN公司的字头（SN美国得克萨斯公司，MC美国摩托罗拉公司，DM 美国国家半导体公司，HD日本日立公司。）74工作温度范围（74民用0+70C，54军用-55+120C）LS系列（LS低功耗肖特基系列，是TTL电路，HC高速C

8、OMS电路, 空白为标准系列）08品种代号（08表示两输入的与门）N封装形式（N塑料双列直插，P黑瓷双列直插，J陶瓷双列直插）实验内容1 熟悉实验装置组成、各部分功用及其使用的注意事项2 集成门电路逻辑功能的测试。（1）74LS08（与门）（2）74LS32（或门）（3）74LS04（非门）（4）74LS00 （与非门）（5）74LS02 （或非门）（6）74LS86 （异或门）实验步骤1 演示、讲解实验装置组成及其功用（1）实验台上有左右两种实验装置，左边是数字电路实验装置（实验用数 电部分），右边是模拟电路实验装置。（2）空气开关（实验台的左侧面），有两个主要功能，短路保护（电源的 火线和

9、零线短接或是和地线短接时，空气开关跳开)；过载保护(流过的电流超 过了额定值时，空气开关跳开)。(3) 实验装置面板上有电源开关及保险，有相应的电压表指示，电源开关 控制着各套装置的工作电源及照明的工作电源。(4) 直流稳压电源，分为CMOS电路电源和TTL电路电源，其中CMOS 电源是可调的，有1.518V、1.530V两个，可根据需要进行调节。TTL电源 是固定5V，不可调。可调和固定的电源都有表头指示。(5) 频率计，有内显和外测功能，闸门时间 0.01s 1s、10s对应的是测频 分辨率分别为0.1kHz、1Hz、0.1Hz,实验中一般选1s。(6) 数字信号发生器，发出脉冲信号，有

10、CMOS信号和TTL信号，信号的频率根据使用要求选择按键，脉冲信号有幅值、频率调节旋钮，当旋钮拉出 时可调整幅值或频率，旋钮推入时，信号的幅值和频率固定，幅值大约4.5V。信号分为连续脉冲和单脉冲，有 CMOS、TTL和单脉冲的输出端口。(7) 逻辑状态测试，有3种状态：高电平、低电平和过渡状态。用于检测 CMOS、TTL电路输入、输出的逻辑状态。(8) 面包板，用于设计电路临时搭接电路时使用，优点是简单、方便，缺 点是元器件接触不良，易出故障，不可靠。(9) 固定插座实验区，有14、16、20脚固定插座，注意正确的插入方向， 拔出时用起拔器等工具，不能用手抠，否则芯片的管脚易折断。(10)

11、活动插座实验区，40脚，每个管脚都有LED指示灯，以判断此管 脚的高低电平。根据需要可以在固定和活动插座两个区上共同完成实验。(11) 逻辑输入区，利用每一路上的开关得到需要的高电平或低电平；逻 辑指示区，把逻辑输出引入指示区的某一路，如果是高电平，那么指示灯亮， 低电平时，指示灯不亮。2测试门电路的逻辑功能(1)根据74LS08的管脚图1-2，选择一组门电路(1、2、3管脚)，正确 连接电路，改变输入信号(输入信号从实验装置上的逻辑电平输出接入，利用 开关得到所需的高、低电平)，观察输出(把输出信号接到逻辑电平输入，灯亮 表示高电平，灯不亮表示低电平，但应注意指示灯是否正常)，记录数据。图:

12、1-2 74LS08 管脚图图:1-3 74LS32 管脚图(2)或门，根据74LS32的管脚图1-3,测试其逻辑功能，步骤同上步骤(1)(3)非门，根据74LS04的管脚图1-4,测试其逻辑功能，步骤同上步骤(1)Vcc 6A Y 5A 5Y 4A 4冋 冋 F3 而 向 F71 阖-1 1-1 -1JLJ U U U 13T EJ IA IY 2A 2Y 3A 3Y GND图:1-4 74LS04 管脚图rL&许 ArL J山0 LJ LJ LJ U1A图:1-5 74LS00 管脚图2A 2B 2Y GNDVcc4B4A4Y3B3A3YHl丽FlHI向PlFl(4)依次测试与非门(的测逻

13、辑功能，步骤同上步骤74LS00)、或非门(74LS02)、异或门(74LS86)(1) 。注意事项1 注意实验装置及仪器的操作规程；2测试芯片功能前应熟悉芯片的管脚功能实验二组合逻辑电路的设计与测试实验目的1 掌握组合逻辑电路的设计与功能测试2 熟悉全加器的逻辑功能实验原理1 以三人表决器为例讲述组合逻辑电路的设计和实现方法(1)根据题意列出真值表1表示不三个输入(0表示同意，1表示不同意)，一个输出(0表示通过, 通过)，根据题意两人以上同意即可通过，那么得到下面的真值表：ABCY00000010010001111000101111011111(2) 根据真值表写出逻辑表达式Y ABC A

14、BC ABC ABCC(A B) ABC(A B) A(化成常用的与非形式)=_B) AB(3) 根据逻辑表达式画出逻辑电路图（4）选择芯片上节课我们已经验证了常用的集成门电路的逻辑功能，异或门是74LS86（1片），与非门是74LS00，74LS00上集成了 4个与非门，所以选1片即可。（5）根据逻辑电路图和相应芯片的管脚图，连接线路，然后测试其逻辑功 能。2.全加、半加的概念只有两个同位位相加，得到的和为半加和，得到的进位为半加进位。两个同位位和低进位相加，得到的和为全加和，得到的进位为全加进位。3 .用74LS283四位全加器集成芯片测试一位全加器的逻辑功能根据74LS283的管脚图，集

15、成了 4个全加器，第一个全加器（最低位）有 两个同位端（A1，B1），低进位端（CO）,没有进位输出端（C1），第二、第三 个全加器只要同位端，都没有低进位端，也没有进位输出端，第四个全加器（最 高位）有同位端，没有低进位端，但是有进位输出端（C4）。要测试一位全加器的逻辑功能，需要找到三个输入端和两个输出端。如果 用第一个全加器来测试的话，需设计出一个进位输出端，实现方法如下：把A2、 A3、A4均接低电平，B2、B3、B4均接高电平，那么利用四位全加器的功能， C4就可以表示C1 o实验内容1. 三人表决器的设计与功能测试2. 半加器的设计与功能测试3. 全加器（1位）的逻辑功能测试（74

16、LS283）注意事项1. 注意使用的芯片各管脚功能2. 理解用全加器集成芯片283测试一位全加器的逻辑功能的外部线路设计实验三编码-译码-显示电路实验目的1 熟悉编码器和译码器的逻辑功能2 熟悉七段译码器、LED数码管3熟悉编码-译码-显示电路的逻辑功能实验原理及相关理论1 编码器及其特点什么是编码器？用文字、符号、数字表示特定对象的过程叫做编码。在数 字电路中，用二进制数进行编码，可以用 n位二进制数对2n个信号进行编码, 这是二进制编码器。编码器分为一般编码器和优先编码器。一般编码器的特点：在某一时刻只能对一个信号进行编码，并且不允许两 个或两个以上的信号同时存在。优先编码器的特点：允许几

17、个信号同时存在，但在某一时刻只对优先级别 最高的信号进行编码，对优先级别低的不予理睬。优先编码器更具有实际意义, 因为我们在实际应用中的信号是有轻重缓急之分的。2 常用的两种优先编码器74LS148 （8线-3线编码）和74LS147 （10线-4线编码器）以下介绍的各图不是芯片的管脚图，为示意图。-YPO02 Y Yo in4I.SI4NO0一10O0.1100一12O0-11 7LO-TM OLUn ?An 00一 oO-ST74LS148有8个输入端，3个输出端，输出为842二进制代码。I7信号优 先级别最高，10的优先级别最低。St为选通输入端，St = 0时允许编码。Ys、 Yex为

18、级联时使用，用两片74LS148可以构成16线-4线的编码器。我们以一个编码的例子说明74LS148的编码功能，如果11信号有效（低电平），1217均为咼电平（如果有低电平不能对I1编码，优先级别咼的编码） 那么对I1信号进行编码，输出为110,因为输入信号和输出信号都是反变量。-YlOno一门 004：.S| 二-74LS147的编码功能和148基本一样，如果I1信号有效，那么输出为1110, 因为输入、输出信号都是反变量。需要注意的是， 147的I0信号没有使用，当 I119信号都无效时，对I0信号进行编码。NC （没有和内部连接）。3 译码器的概念什么译码？译码是编码的逆过程，把代码状态

19、的特定含义“翻译”出来的 过程叫做译码，完成译码操作的电路叫做译码器。4 介绍3线-8线和4线-10线译码器录OC vo0 vo0Yo0-II 1 3SfiSI nrlo-IHA： Al At74LS138有三个输入端，为8421代码，8个输出端（低电平有效）。Ss、色 和Sl为控制端，当S仁1，S2和S3=0时，允许译码。两片138级联可以构成4 线-16线译码器。举一个译码的例子说明138的译码功能，如果输入代码是001，那么Y1信 号有效，为低电平，其它输出均为高电平，这就是138的译码功能。74LS42是4线-10线译码器，如果输入是0001代码，那么输出信号Y1有 效，为低电平，其它

20、均为高电平。ILSJ20 YA 00 YAA.t A; Ai 久o5.驱动器及LED显示器件LED数码管是常用的显示器件，价格较便宜。下面是数码管的外型:每一段都是一个发光二极管，相应的字段亮起来可以显示字型 管分为共阴极数码管和共阳极数码管，它们的内部结构是这样的：LED数码各个发光二极管的负极一起接入电源的负极就构成了共阴极数码管。那么 如果要想让某一位点亮，需要接入高电平，因此共阴极数码管是高电平驱动有 效。把发光二极管的正极一起接入电源的正极就构成了共阳极数码管。那么如 果要想让某一位点亮，需要接入低电平，因此共阳极数码管是低电平驱动有效。 实验中用的是共阴极数码管。译码/驱动器CC4

21、511，具有译码和驱动功能。输入为 8421码，输出为能驱动显示某字型的一组高低电平，LP、BT、LE为控制端a b c 1 e f g milC45111111111LPBTI.F A BCD仍以举例来说明CC4511的译码和驱动功能，如果输入为 0001代码，那么 输出端，b、c为高电平，其它均为低电平，那么数码管应该显示“1”字型，这就是CC4511的译码驱动功能。实验内容1 测试编码器的逻辑功能按照74LS148和74LS147的管脚图连接线路，测试其逻辑功能。2 测试译码器的逻辑功能按照74LS138和74LS42的管脚图连接线路，测试其逻辑功能。3验证编码-译码-显示电路的逻辑功能

22、实验中的编码-译码-显示线路，由74LS147编码器、CC4511译码/驱动器 和LED数码管组成。需说明一下，我们的实验台上 CC4511和数码管之间的连 接已经完成了，只需要接入+5V的电源，那么我们的编码-译码-显示电路只需 要把147编码器接入电路。注意，147的输出是低电平有效，而CC4511的输入 是高电平有效，两个逻辑不一致，因此，147和CC4511之间应引入一个非门， 注意低位和低位对应。注意事项1 .注意编码器和译码器的控制端2 注意输入信号的顺序接入实验四 触发器的测试及研究实验目的1 熟悉触发器的工作原理2 验证触发器的逻辑功能实验原理及相关理论1 触发器及其分类触发器

23、是一种具有记忆功能的存储器件。 按照电路结构和工作特点的不同， 触发器分为基本RS触发器、同步触发器、主从触发器和边沿触发器。从基本 RS触发器到边沿触发器，它们的功能不断地在完善，抗干扰能力不断在增强。 下面我们来一一了解它们。2 基本RS触发器_这是由与非门构成的基本 RS触发器，两个输入S、R，两个输出Q、Q , 它们的状态是互补的，如果Q是1，Q应该是0。根据与非门的特点，有一个 输入低电平，输出就是高电平，那么 S、R端都是0时，两个输出都是1，这 是不允许的，也是我们不希望出现的，会出现竞态现象。我们来看一下它正常工作时的逻辑功能：(1) S = 0，R = 1时，输出为1态；(2

24、) S = 1，R = 0时，输出为0态；(3) S二1, R二1时，输出保持原来的状态。(这就是触发器的记忆功能) 那么触发器电路的输出和输入信号有关，还和原来的输出状态有关，这是组合逻辑电路有区别的地方。组合逻辑电路，它的输出只和输入有关。我们来看一下基本RS触发器的工作特点：它的输出直接受输入的影响， 有什么输入会产生相应的输出，那么有干扰信号进来，也对输出产生影响，所 以它的抗干扰性能很差。另外，由于输入直接影响输出，不便于控制多个触发器同步工作，因为我们的输入信号常常不是同步的 基于这些缺点，出现了同步触发器。3. 同步触发器这是由基本RS触发器构成的同步RS触发器，它的特点呢是引入

25、了一个时 钟信号，在CP=O期间，3门、4门被封锁，输入信号不能进来，输出无变化； 当CP= 1时，3门、4门被打开，输入信号有效，输出根据输入而变化。由于有了时钟信号的控制，可以实现多个触发器同步工作了，性能上提高 了。同时，CP=O期间不接收信号，抗干扰能力也有所提高，但由于CP= 1期间输出受输入信号的直接控制，它的抗干扰能力有待于进一步提高。还有，RS触发器存在RS之间的约束问题，限制了它的使用。RS之间的约束问题可以用同步 D触发器解决，在S、R输入之间加上一个 非门，就是同步D触发器了。但是它的抗干扰能力和基本 RS触发器一样。基于这些缺点又出现了主从触发器。4. 主从触发器这是由

26、同步RS触发器构成的主从RS触发器，来看看它是如何工作的。在CP= 1期间，3门、4门被封锁，从触发器输出不变，7门、8门被打开， 主触发器接收信号；当CP的下降沿到来时，7门、8门被封锁，接收信号被锁 存，同时3门、4门被打开，接收信号被送入从触发器，从而输出会产生相应 的变化。由于CP= 1期间只接收信号，在CP下降沿来的时候信号被送入从触发器 对输出产生影响，那么只要在 CP下降沿来的时候，输入信号稳定，输出就是 可靠的，所以它的抗干扰能力较强。但是，主从RS触发器仍存在RS之间的约束问题。解决RS之间的约束问 题可以用主从JK触发器，只需要在主从RS触发器电路上做些改动，把输出Q 引入

27、8门，把输出端Q引入7门，就变成主从JK触发器了。主从JK触发器解决了 RS之间的约束问题，但新的问题又产生了，主从JK 触发器存在一次变化问题。什么是一次变化问题？我们来回忆一下：假如CP=0时，Q 0，Q 1，这时CP从0跳变到1, 3门和4门被封锁，输出保持 不变，7门和8门打开，主触发器接收输入信号，8门被Q 0封锁，信号只能 从7门进，这时如果主触发器的输出从 0跳变到1的话，就不会再变化了，除 非等到下次CP=1期间。如果这是干扰信号的话，当CP下降沿到来时就被送入 从触发器，从而影响输出的变化。因此，它的抗干扰能力需要进一步提高。基于这些缺点，出现了边沿触发器。5. 边沿触发器边

28、沿触发器的电路结构形式较多，我们以同步 D触发器级联构成的为例来 介绍。这是同步D触发器级联构成的边沿D触发器，在CP=1期间，3门和4门 被封锁，输出保持不变，7门和8门打开接收信号，主触发器的输出跟随 D的 变化，但不锁存；当CP下降沿到来时，7门和8门被封锁，信号被锁存，同时 3门和4门打开，信号从主触发器送入从触发器，从而输出跟随信号变化。因此，只要在下降沿时刻输入信号保持稳定，触发器的输出就是可靠的，其它时刻的干扰信号不会影响输出，它的抗干扰能力强。边沿D触发器是单端输入情况下性能较好的触发器。边沿 D触发器仅有置1和置0功能，在某些情 况下，使用有些不便。在边沿 D触发器电路的基础

29、上，经过简单改造可以变成 边沿JK触发器。边沿JK触发器的工作原理和边沿D触发器一样，在CP=1期间接收信号 在CP下降沿来时，信号被锁存并送入从触发器，从而产生相应的输出。边沿 JK触发器具有置1、置0、保持、翻转四种功能，功能比较全。它是输入信号 为双输入时较好的触发器。实验内容1 测试基本RS触发器的逻辑功能；（由两片74LS00组成）2 测试边沿D触发器的逻辑功能；（74LS74）3 测试边沿JK触发器的逻辑功能。（74LS112）注意事项1 实验都在固定插座区做，注意芯片插入和拔出时的正确方法。CP端2 脉冲信号线的使用，黑线接电源工作地线，红线接触发器的实验五时序电路的测试与研究实

30、验目的1 熟悉时序电路分析设计及测试方法;2训练复杂电路的实验技能实验原理及相关理论1 边沿触发器的逻辑功能边沿D触发器：包含有异步RS触发器，当异步置位端起作用时，输出受 异步置位端的控制，和输入信号 D无关，当异步置位端无效时，输出跟随 D的 变化，当然应满足上升沿的要求，边沿 D触发器有置1、置0功能。边沿JK触发器：包含有异步RS触发器，异步置位端起作用时，输出受异 步置位端的控制，当异步置位端无效时， 输出根据J、K信号变化，也应满足下 降沿的要求，边沿JK触发器有置1、置0、保持、翻转功能，翻转功能是在J=1 和K=1的情况下下降沿到来时实现的。2 异步二进制加计数器这是由4个边沿

31、JK触发器构成的异步二进制加计数器，利用了边沿 JK触 发器的翻转功能。74LS112上集成了 2个边沿JK触发器，所以用了 2片112。 74LS112是TTL电路，输入端悬空时为“ 1”态，那么J、K端都是1态，异步 置位端S、R也是1态，当输出需要清零时，R端接0,正常工作时，R端接1 或悬空。最前面触发器的输出是最低位，最后面的输出是最高位，丫 QaQbQzQ1。 前一位的输出是后一位的 CP时钟信号，最前面触发器的 CP端接的是1Hz的 TTL连续脉冲信号，1Hz的TTL连续脉冲信号用我们实验装置上的信号发生器产生，可选择10Hz频率的量程，然后把调频旋钮拉出，逆时针调至1Hz我们来

32、看一下它的时序图。这个电路有自启动能力，我们来看一下 Q4Q3Q2Q1的状态图:实现了从0000到1111的16种状态的加计数。在加计数电路的基础做些简 单的改动,可以变成减计数器，我们理论课上已推导出减计数的方程 丫 证2，只需要把输出从Q端引出即可。3.移位寄存器2咚*丫 QQ2Q3Q4，前一位的输出接后一位的输入，CP接1Hz的脉冲信号，R 为异步置位端，R= 0时，Q1Q4清零，正常工作时，R=1, CP上升沿时输出 跟随D变化。这个电路没有自启动能力，当输出为 0000或1111时，进入死循 环。因此电路工作需要人工触发。我们可以把4Q和1D之间断开，那么1D悬空，为1态，CP端输入

33、一个 脉冲，当CP上升沿时，1Q为1态，这时把4Q和1D之间重新连接，我们来 看一下电路的输出状态图。Q1Q2Q3Q4的状态图为：0000 1000 0100 * 0010 * 00010000到1000这个过程就是触发过程，触发后，“ 1”信号依次右移实现了 移位寄存器的功能。同理，我们可以把4Q和1D之间断开，从CP端输入2个或3个脉冲信号, 然后使其闭合，那么可以看到 2个“1”或是3个“1”信号依次右移的现象。实验内容1 异步二进制加计数器的测试（74LS112）2 异步二进制减计数器的测试（74LS112）3 移位寄存器的测试（74LS175）注意事项这次实验需要考虑的因素比较多，比

34、如连续脉冲信号的引入，输入端需要接高电平时的悬空，导线较多注意它们的可靠性，人工触发的方法等等。所以,在实验中需要细心和耐心，才能把线路调试通过。实验六555时基电路研究及应用 实验目的1 熟悉555时基电路工作原理和功能测试方法2.了解555时基电路的应用实验原理及相关理论1. 555时基电路及其应用555时基电路外围配上一些阻容元件，可以构成各种脉冲电路，可以为各 种时序电路提供时钟信号。2. 555时基电路工作原理555时基电路由分压器、两个电压比较器，基本 RS触发器和三极管、缓冲 器组成。分压器是由3个5k Q的电阻构成，这也是“ 555”的得名，由于3个 电阻相等，+5V的电压被平

35、均分成了 3份。电压比较器有两个输入端，“ +”是 同相输入端，“-”是反相输入端，当“ +”端电压大于“-”端电压时，输出为 高电平，反之输出为低电平。基本 RS触发器、三极管和缓冲器不再讲了，我 们应该比较熟悉。缓冲器时为了提高负载能力也起了隔离作用，减少负载对555 电路的影响。我们来看一下555时基电路的工作原理：两个输入端有以下四种情况，分析一下输出是什么情况。THTRUUD2Vcc1Vcc高电平截至332Vcc】Vcc高电平截至332Vcc】Vcc保持保持332Vcc】Vcc低电平导通33这是555时基电路的功能，我们可按照这个图来测试555电路的功能实验内容1. 555时基电路的功能测试IkLED这是测试555时基电路功能的电路，两个输入端的电压用可变电阻引入， 可变电路和一些其它元器件都用准备的线路板上的元件，上面标注的有参数， 电压用万用表测量。输出端接有 LED指示灯，