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文档简介
第10章可编程逻辑器件10.2
可编程阵列逻辑（PAL）10.2.1PAL的基本结构10.2.2PAL的输出结构10.2.1、PAL的基本结构编程前的内部结构编程后的内部结构
采用熔丝工艺制造的一次性可编程逻辑器件。可编程与阵列固定或阵列专用输出结构10.2.2
PAL的输出结构
这是一种简单的与-或结构,又称为基本组合逻辑结构,它的输出由输入决定,仅适用于设计组合逻辑电路。
或门输出接一个同相缓冲器时，输出为高电平有效；若接反相缓冲器，则输出为低电平有效。
一、
专用输出结构
输出电路由一个三态门和一个互补反馈缓冲器构成。三态门的使能信号由与阵列中的第一个与项提供。当使能信号为高电平时，I/O
端为输出端，同时输出信号也经反馈缓冲器反馈到与阵列输入端，因此可实现时序逻辑设计。当使能信号为低电平时，三态门为高阻态，此时
I/O
端为输入端，外部输入信号通过反馈缓冲器加至与阵列输入端。同一个PLA器件中的不同输出端的三态门是异步工作的，故称为异步I/O
输出。
二
异步I/O输出结构异步I/O
输出结构
三、
寄存器输出结构
在CP
上升沿作用下，或门输出信号存入D
触发器中，Q端信号通过反馈缓冲器反馈到与阵列输入端，可方便地构成同步时序逻辑电路。输出三态门的使能端由外部信号OE统一控制，在OE有效时，三态输出缓冲器开通，D
触发器Q
端的信号通过它反相后送到I/O
端为输出，可实现同步输出方式。寄存器输出结构异或-寄存器输出结构
四、
异或-寄存器输出结构
异或-寄存器输出结构是把一组与门分为两个或项，经异或门后在CP
上升沿作用下存入D
触发器，再经三态门输出，同时由
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