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文档简介
第十一章触发器和时序逻辑电路11.1基本RS触发器的输入波形如题11.1图所示,试画出Q端和−Q答案:略。11.2同步RS触发器的时钟信号、R和S波形如题11.2图所示,试画出Q端的波形。设初始状态为1。答案:略。11.3CP、J和K端的波形如题11.3图所,试出端的输出波形(发器为主从J触发)。答案:略。11.4D触发器(上升沿触发)波形如题11.4图所,试画出端的形(设初态为0)。答案:略。11.5由D触发器和非门组成的电路如题11.5图所示,试画出端的波形(设初为1)。答案:略。11.6电路和波形如题11.6图所示,试画出Q1端和Q答案:略。11.7电路和波形如题11.7图所示,画出Q1端和Q2答案:略。11.8电路如题11.8图所示,画出各触发器的状态波形。答案:略。11.9电路如题11.9图所示,画出输出端4、B的波形(设初态为0)。答案:略。11.10电路如题11.10图所示试分析其逻辑功能。(要求写出驱动方程和状态方程、列出状态表、画出状态转换图和波形图)。答案:略。11.11电路如题11.11图所示,试分析其逻辑功能。(要求写出驱动方程和状态方程、列出状态表、画出状态转换图和波形图)。答案:略。11.12电路如题11.12图所示,试分析该电路功能为几进制计数器,并要求画出状态图。答案:略。11.13电路如题11.13图所示,试分析该电路功能为几进制计数器?答案:略。11.14电路如题11.14图所示,试分析路功能。答案:略。11.1574LS194需要经过几个CP移位脉冲,才能够实现串行/并行输出?答案:串行输出模式:在串行输出模式下,数据逐位进行移位,每个CP脉冲移出一位数据。为了实现串行输出,您需要应用4个CP脉冲(与数据位数相等),以将所有数据逐位移出。并行输出模式:在并行输出模式下,数据并行加载到寄存器中,然后您需要应用1个CP脉冲以锁存并并行输出数据。这意味着您需要总共5个CP脉冲来实现并行输出:1个CP脉冲用于并行加载数据,然后再应用4个CP脉冲将数据逐位移出(如果您希望在加载后继续移出数据)。所以,实现串行输出需要4个CP脉冲。实现并行输出需要5个CP脉冲(1个用于加载,4个用于移出)。11.16用74LS194构成如题11.16图所示的电路,先并行输入数据,使22=0001画出状态图,并说明电路功能。答案:略。11.17试分别用清零法和置数法,利用74LS160接成八进制计数器。答案:略。11.18试用74LS290接成六十进制计数器。答案:略。11.19用555定时器连接的电路如题11.19图(a)所示,试根据如题11.19图(b)所输入波形确定输出波形。答案:略。11.20分析如题11.20图所示的过电压监测电路
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