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文档简介
第3章
组合电路的VHDL设计
3.1多路选择器及其VHDL描述
条件语句
数据类型
进程语句和顺序语句
端口语句和端口信号名
端口模式
关键字
标识符
3.2半加器及其VHDL描述
实体表达与实体名
结构体表达
标准逻辑位数据类型STD_LOGIC
赋值符号和逻辑操作符
设计库和标准程序包
文件取名和存盘
规范的程序书写格式
VHDL描述
四选一多路选择器及CASE语句表述方式
VHDL描述
VHDL描述
CASE语句
3.3.2CASE语句
CASE语句
IEEE库预定义标准逻辑位与矢量
其他预定义标准数据类型
信号定义和数据对象
并置操作符
四选一多路选择器的VHDL不同描述方式
WHEN_ELSE条件信号赋值语句
选择信号赋值语句
全加器及其VHDL表述
全加器设计及例化语句应用
3.4全加器及其VHDL表述
全加器设计及例化语句应用
VHDL例化语句
8位加法器设计及算术操作符应用
3.4.38位加法器设计及算术操作符应用
统计位矢中含1个数的电路模块设计
FOR_LOOP循环语句用法
FOR_LOOP循环语句用法
移位相加型乘法器的VHDL表述方法
GENERIC参数定义语句
整数数据类型
省略赋值操作符
移位操作符
各类运算操作对数据类型的要求
3.5.8各类运算操作对数据类型的要求
3.5.8各类运算操作对数据类型的要求
各类运算操作对数据类型的要求
各类运算操作对数据类型的要求
各类运算操作对数据类型的要求
各类运算操作对数据类型的要求
各类运算操作对数据类型的要求
数据类型转换函数
数据类型转换函数
数据类型转换函数
数据类
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