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综合设计实例--简易数字频率计电子通信工程学院于玉亭2023/7/21综合设计实例

--简易数字频率计教学目的：熟练应用常用数字电路的VHDL设计；熟悉复杂数字电路的分析与设计过程；掌握自顶而下的顶层设计方法。重点2023/7/22

在电子技术中，频率是最基本的参数之一，许多测量方案和测量结果都与频率有十分密切的关系，因此频率的测量就显得更为重要。数字频率计是一种最基本的测量仪器，它广泛的应用于航天、测控、通讯、微波器件等领域。综合设计实例

--简易数字频率计2023/7/23综合设计实例

--简易数字频率计2023/7/24综合设计实例

--简易数字频率计

顶层设计2硬件验证测试4设计要求31编程及仿真332023/7/251、设计要求简易数字频率计的VHDL设计。要求：简易频率计四位十进制频率计，测量范围1-9999Hz，测量精度1Hz。四个七段数码管稳定显示测量结果。2023/7/26七段数码管驱动电路简易频率计计数器2、顶层设计记下1秒内出现的上升沿个数2023/7/27简易频率计工作时序图12、顶层设计2023/7/28时序控制电路计数器计数器简易频率计2、顶层设计七段数码管驱动电路七段数码管驱动电路提供计数使能和清零信号使能清零2023/7/29简易顺频率详计工菌作时钞序图22、顶惧层设廊计20缸23俱/6拼/2痰710七段数码管驱动电路计数器时序控制电路七段数码管驱动电路计数器时序控制电路简易频率计锁存器2、顶当层设研计使能清零锁存如器信脱号使能清零20舟23堡/6怪/2吸711简易脸频率樱计工挤作时价序图32、顶君层设撇计20辞23篮/6菠/2枯712七段数码管驱动电路计数器时序控制电路简易频率计锁存器2、顶悼层设惊计使能清零锁存器控制赌信号扫描道信号20牢23测/6津/2衣713七段数码管驱动电路计数器时序控制电路锁存器使能清零锁存控制信号扫描信号2、顶故层设极计计伤数仓器贼：记单录待母测信清号1秒内拆上升唉沿个等数锁旨存准器饼：把吸计数驰器的说最终愚结果乞存储呈下来七冈段王数猎码组管：泼显示都锁存辨器结市果时序突控制院电路薄：为桥计数结器提薄供使怀能和终清零胶时序慨，为锁闲存器腿提供科锁存榴时钟参，为七夏段数抽码管命显示巨提供获扫描网信号邻。20商23晓/6孟/2惜7143、编母程及基仿真设计碰各个字模块顶层饮实体落调用20逮23图/6桨/2姨7153、编倚程及安仿真顶层欲设计启文件20翁23氏/6贺/2桂7164、硬浮件验鞋证测做试1K润Hz待测炒信号1H唇z20保23部/6朋/2电7174、硬值件验献证测隆试硬件木测试膨结果20宵23贡/6鄙/2马718小结通过厉顶层胳设计中分析寺把简考易频励率计汉分为减时序验控制般电路贤、计伙数器宅、锁床存器穿、七攻段数稳码管臣驱动蝇电路比等四谜大模饺块构脖成。每个怠模块滚由基吩本的呜数字志电路扬构成路。顶层滚文件芽

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