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文档简介
绪论单元测试计算机的五大组成部分是()、()、()、输入设备和输出设备。
A:硬盘
B:运算器
C:存储器
D:控制器
答案:BCD数字逻辑课程是计算机专业的一门学习硬件电路的专业基础课。
A:错
B:对
答案:B计算机的运算器是能够完成算术和逻辑运算的部件,逻辑运算比如与运算。
A:错
B:对
答案:B第一章测试与二进制数1101011.011对应的十六进制数为()
A:6B.6
B:73.3
C:6B.3
D:53.3
答案:A与二进制数101.011等值的十进制数是()
A:5.375
B:5.175
C:5.675
D:3.625
答案:A(17)10对应的二进制数是()
A:10110
B:10001
C:10011
D:101111
答案:B数字电路中用“1”和“0”分别表示两种状态,二者通常无大小之分
A:错
B:对
答案:B格雷码具有任何相邻码只有一位码元不同的特性
A:对
B:错
答案:A以下代码中为无权码的为()
A:5421BCD码
B:格雷码
C:余三码
D:8421BCD码
答案:BC十进制数25用8421BCD码表示为(
)
A:00100101
B:10101
C:11010
D:11001
答案:ABCD码1001对应的余3BCD码是()
A:1100
B:1011
C:1010
D:1000
答案:A8421BCD码001001010100转换成十进制数为()
A:252
B:1124
C:254
D:1250
答案:C第二章测试在何种输入情况下,“或非”运算的结果是逻辑0
A:任一输入为1
B:全部输入是0
C:任一输入为0,其他输入为1
D:全部输入是1
答案:A一个两输入端的门电路,当输入为1和0时,输出不是1的门是()
A:与非门
B:或门
C:异或门
D:或非门
答案:D求一个逻辑函数F的对偶式,可将F中的(
)。
A:原变量换成反变量,反变量换成原变量
B:变量不变
C:“·”换成“+”,“+”换成“·”
D:常数中“0”换成“1”,“1”换成“0”
答案:BCD对于一个逻辑函数而言,任意两个最小项之积为()。
A:1
B:4
C:2
D:0
答案:D下列等式正确的是()
A:AB+AB´=A+B
B:A+AB+B=A+B
C:A(AB)´=A+B´
D:A(A+B+C)´=B´C´
答案:B用公式法化简逻辑函数Y=AB(A+B’C)最简与或式为()
A:A’B
B:BC
C:AC
D:AB
答案:D用公式法化简函数为最简与或式F=A+C+B’+A’BC’
A:1
B:A+B’
C:A
D:A+BC’
答案:A逻辑函数的表示方法中具有唯一性的是()
A:表达式
B:逻辑图
C:真值表
D:卡诺图
答案:C当变量A、B、C
取值为101时,下列三变量函数最小项中等于1的是
A:m1
B:m7
C:m3
D:m5
答案:D逻辑函数Y(A,B,C,D)=∑m(0,1,2,3,4,6,8,9,10,11,14)的最简与或式为()
A:B’+CD’+A’D’
B:B’+A’D’
C:B’+CD’
D:B’+CD’+AD
答案:A逻辑函数Y(A,B,C,D)=∑m(3,5,6,7,10)+∑d(0,1,4,8)的最简与或式为()
A:A’B’D’
B:A’+B’CD’
C:A’
D:A’+B’D’
答案:D函数Y=B’+A中,包含的最小项个数为
(
).
A:4
B:1
C:3
D:2
答案:C第三章测试将与非门当做反相器使用时各输入端连接的方法是(
)。
A:选一个输入端作为输入,其余的输入端悬空
B:各输入端并接作为输入
C:选一个输入端作为输入,其余的输入端接低电平
D:选一个输入端作为输入,其余的输入端接高电平
答案:BD三态输出门的输出端可以出现(
)3种状态。
A:高阻
B:低电平
C:高电平
D:低阻
答案:ABC按集成度可以把集成电路分为(
)
集成电路。
A:超大规模(VLSI)
B:小规模(SSI)
C:中规模(MSI)
D:大规模(LSI)
答案:ABCD基本逻辑门是
(
)。
A:异或门
B:非门
C:与门
D:或门
答案:BCD正逻辑关系是指(
)。
A:用L表示高电平,用H表示低电平
B:用0表示高电平,用1表示低电平
C:用A表示高电平,用B表示低电平
D:用1表示高电平,用0表示低电平
答案:D为实现数据传输的总线结构,要选用(
)门电路。
A:三态门
B:或非门
C:异或门
D:与非门
答案:A第四章测试下列电路中,不属于组合逻辑电路的有(
)。
A:数据选择器
B:寄存器
C:全加器
D:计数器
答案:BD组合逻辑电路在电路结构上的特点是(
)。
A:不含存储单元
B:可以有触发器
C:不含反馈电路
D:只含有门电路
答案:ACD对一个3线-8线译码器正确的叙述是(
)。
A:它有3个主要输入端
B:同一时间只有一个输出端是有效的
C:它有8个主要输入端
D:它是二进制译码器
答案:ABD组合逻辑电路的特点有(
)。
A:具有“记忆”功能
B:任何时刻的输出,与当时的输入状态组合及电路过去的状态有关
C:任何时刻的输出,仅与当时的输入状态组合有关,与电路过去的状态无关
D:不具有“记忆”功能
答案:CD输出高电平有效的4线—16线译码器的输入,ABCD=1010时,输出Y15~Y0=(
)。
A:0000010000000000
B:1010000000000000
C:0000000000100000
D:0000000000001010
答案:A4位二进制译码器,其输出端个数为()
A:10
B:8
C:16
D:4
答案:C4选1数据选择器的地址输入为A1、A0,数据输入为D0、D1、D2、D3,若用它实现逻辑函数F=A+B,且A、B作地址输入量,则要求数据输入端D0D1D2D3为(
)
A:0111
B:0001
C:1111
D:0000
答案:A一位数据比较器,若A、B为两个一位数码的表示变量,当A>B时输出Y=1,则输出Y的表达式为Y=(
)
A:A+B
B:A’B
C:A’B+AB’
D:AB’
答案:D对于普通编码器和优先编码器下面的说法正确的是()
A:普通编码器和优先编码器都只允许输入一个编码信号
B:普通编码器只允许输入一个编码信号,优先编码器允许输入多个编码信号
C:普通编码器允许输入多个编码信号,优先编码器只允许输入一个编码信号
D:普通编码器和优先编码器都允许输入多个编码信号
答案:B8线—3线优先编码器74HC148输入端I1’、I5’同时有效时输出二进制数为()。
A:101
B:010
C:001
D:100
答案:B当变量A,B,C取值为000和111时,输出Y为1,其他均为0.因此它是一种能够判断(
)。
A:输出信号是否为0
B:输入信号是否为0
C:输入信号是否一致
D:输出信号是否一致
答案:C全加器是指(
)。
A:不带进位两个同位的二进制数相加
B:两个同位的二进制数和来自低位的进位三者相加
C:两个同位的二进制数相加
D:两个同位的十进制数相加
答案:B将1999个“1”异或起来得到的结果为1
A:错
B:对
答案:B一个二进制编码器若需要对4个输入信号进行编码,则要采用4位二进制代码
A:错
B:对
答案:A第五章测试按逻辑功能来划分,触发器可以分为(
)。
A:RS触发器
B:T触发器
C:D触发器
D:JK触发器
答案:ABCD有一个与非门构成的SR锁存器,当输入为R’=0,S’=1时,则Q*为()
A:0
B:保持
C:1
D:不定
答案:A对触发器正确的叙述是(
)。
A:不同类型的触发器可以相互转换
B:它的Q端反映了它的状态
C:它是组合逻辑电路的基本组成单元
D:它是最简单的时序逻辑电路
答案:ABD当JK触发器处于翻转功能时,其输出的次态为(
)。
A:与原态相反
B:1
C:0
D:与原态相同
答案:A欲使D触发器按Q*=Q’工作,应使输入D=()
A:1
B:Q
C:0
D:Q’
答案:D钟控RS触发器的特征方程是(
)
A:Q=R’+Q
B:Q=R+S’Q
C:Q=S+R’Q
D:Q=S’+Q
答案:C对于JK触发器,输入J=0,K=1,CLK脉冲作用后,触发器的次态应为()。
A:Q’
B:0
C:Q
D:1
答案:B对于JK触发器,若J=K,则可完成(
)触发器的逻辑功能
A:RS
B:T’触发器
C:T
D:D
答案:C存储8位二进制信息要(
)个触发器。
A:3
B:2
C:4
D:8
答案:DRS触发器中,不允许的输入是()
A:RS=10
B:RS=01
C:RS=00
D:RS=11
答案:D第六章测试下图电路中,Y与CLK的频率之比为()
A:1:56
B:1:42
C:42:1
D:1:55
答案:A图示电路是()进制计数器。
A:7
B:12
C:9
D:6
答案:A下面属于时序电路的特点的是()
A:时序电路的输出不仅取决于当前的输入,还和原来的状态有关
B:时序电路的输出仅取决于当前的输入
C:时序电路通常由组合电路和触发器构成
D:时序电路由各种门电路构成,不具有记忆功能
答案:AC时序逻辑电路按触发器时钟端的连接方式不同可以分为(
)。
A:自启动时序逻辑
B:同步时序逻辑电路
C:非自启动时序逻辑
D:异步时序逻辑电路
答案:BD对计数器以下叙述正确的是(
)。
A:二进制计数器就是一个触发器
B:有同步和异步计数器
C:有加法,减法,加/减计数器之分
D:有十进制和二进制计数器
答案:BCD移位寄存器不具有的功能是()
A:译码功能
B:数据运算
C:数据存储
D:串并转换
答案:A可以用来暂时存放数据的器件叫(
)。
A:JK触发器
B:T触发器
C:D触发器
D:寄存器
答案:D3级触发器若构成环型计数器,其模值为(
)。
A:6
B:8
C:3
D:4
答案:C四位移位寄存器可以寄存四位数码,若将这些数码全部从串行输出端输出,需经过(
)个时钟周期。
A:6
B:3
C:4
D:5
答案:C若4位同步二进制减法计数器当前的状态是0111,下一个输入时钟脉冲后,其内容变为(
)。
A:1000
B:0011
C:0111
D:0110
答案:D(
)是时序逻辑电路的典型电路。
A:编码器
B:数值比较器
C:计数器
D:译码器
答案:C构成一个六进制的计数器至少需要
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