数字电子钟逻辑电路设计报告

1、-. z.数字电路课程设计设计报告 题 目：数字电子钟逻辑电路设计 班 级: 电子工程 姓 名: * 指导教师: * 2012年12月摘要在生活中的各种场合经常要用到电子钟，现代电子技术的飞跃开展，各类智能化产品相应而出，数字电路具有电路简单、可靠性高、本钱低等优点，本设计就以数字电路为核心设计数字电子钟逻辑电路。 数字钟是一个将周、 时、分、秒显示于人的视觉器官的计时装置。它的计时周期为 24 小时，显示满刻度为6日 23 时 59 分 59 秒，另外应有校时功能和、报时、整体清零等附加功能。其主干电路系统由秒信号发生器、时、分、秒计数器，译码器及显示器，校时电路，整体清零电路，整点报时电路

2、组成。关键词 分频 计数 译码 校时报时数字电子钟逻辑电路设计设计目的数字电子钟是一种用数字显示秒、分、时、日的计时装置，与传统的机械钟相比，它具有走时准确，显示直观、无机械传动装置等优点，因而得到了广泛的应用。小到人们日常生活中的电子手表，大到车站、码头、机场等公共场所的大型数显电子钟。通过设计与实验调试，了解数字电子钟逻辑电路设计的方法，进一步理解设计方案与设计理念，扩展设计思路与视野。数字电子钟的电路组成方框图如图1.1所示。图1.1 数字电子钟框图由图1.1可见，数字电子钟由以下几局部组成：石英晶体振荡器和分频器组成的秒脉冲发生器；校时电路；六十进制秒、分计数器，二十四进制或十二进制计

3、时计数器；秒、分、时的译码显示局部等。二、设计任务和要求用中、小规模集成电路设计一台能显示日、时、分、秒的数字电子钟，要求如下：由晶振电路产生1Hz标准秒信号。秒、分为0059六十进制计数器。3. 时为0023二十四进制计数器。4. 周显示从1日为七进制计数器。5. 可手动校时：能分别进展秒、分、时、日的校时。只要将开关置于手动位置，可分别对秒、分、时、日进展手动脉冲输入调整或连续脉冲输入的校正。6. 整点报时。整点报时电路要求在每个整点前呜叫五次低音500Hz，整点时再呜叫一次高音1000Hz。注：不能借助单片机或专用芯片！三、总体方案选择的论证实现数字电子钟显示时间的方案有多种，如：用继电

4、器改变运算放大器的反应网络；用模拟开关来控制运算放大器的反应网络；用数模转换器D/A的电阻网络来改变增益。方案比照：方案一：本次设计考虑到使实验器材尽量可以在市场上及时的买到以及节省不必要的实验器材，最终考虑使用方案二模拟开关来控制运算放大器的反应网络来实现实现程控放大器。方案框图如下：方案二：简要原理：用模拟开关来控制运算放大器的反应网络来设计程控放大器。通过对微动开关的闭合和断开，由CC4051模拟开关控制输出的电阻，作为三运放构成的数据放大器的电阻Rg，构成程控放大器，改变Rg的值可以对输入的信号进展相应的放大。优缺点：优点：该种方案的电路相对于其他两种方案的电路来说，电路构造较为简单，

5、原理容易理解，使用器件较少，而且使用起来也十分方便。缺点：如果电路器件选择不当，可能造成电路无法到达设计的要求，即增益无法到达60dB或者当增益为40dB时，3dB带宽40kHz。所选方案的理由：电路简单，使用器件少，可在实验室内操作，焊接起来较 为方便，调试较为简单，符合课程设计的原则。使用方案框图：4、单元电路的设计1、单元电路的设计根据设计任务和要求，对照数字电子钟的框图，可以分以下几局部进展模块化设计。秒脉冲信号电路的设计：如上图所示，使用晶体振荡器发出的脉冲进过整形分频并通过Q14端输出后此时输出2Hz信号再次经D触发器分频来获得1Hz的秒脉冲信号。(2.电子钟主体计数电路设计：秒分

6、时日计数单元输出均为8421BCD码，采用了74LS161来实现计数单元的计数功能，74LS161可以进展置数和清零。A、秒、分60进制电路设计秒、分60进制计数器都是显示00-59数字信号，如上图所示，从左到右依次为低位、高位片，低位为0-9十进制计数器，高位为0-5六进制计数器。秒分计数器的低位计数单元为10进制计数器，无需进展进制转换，当Q3Q2Q1Q0变成1001时，通过与非门把它的送数端置0，则计数器跳过1010状态，下一时刻又从0000开场，如此重复。秒分计数器的高位计数单元为6进制计数器，当Q3Q2Q1Q0变成0110时，通过与非门把它的清零端置0，计数器被置0，跳过了01101

7、111状态，又从0000状态开场，如此重复。低位和高位计数器级联便可以实现60进制计数器的功能，秒计数器低位的Q3取非后为高位输出时钟信号，而高位的Q2取非后为分计数器的低位输出时钟信号。同理，分计数器低位Q3取非为高位提供时钟信号，高位Q2取非后提供应时计数器时钟信号。B、时24进制电路设计时24进制计数器显示00-23数字信号，如上图所示，从左到右依次为低位、高位片，低位为0-9十进制计数器，高位为0-3四进制计数器。 时计数器的低位计数单元为10进制计数器，无需进展进制转换，当Q3Q2Q1Q0变成1001时，通过与非门把它的送数端置0，则计数器跳过1010状态，下一时刻又从0000开场，

8、如此重复。时计数器的高位计数单元为4进制计数器，当Q3Q2Q1Q0变成0100时，通过与非门把它的清零端置0，计数器被置0，跳过了01011010状态，又从0000状态开场，如此重复低位和高位计数器级联便可以实现24进制计数器的功能，分计数器低位的Q3取非后为高位输出时钟信号，而高位的Q1取非后为日计数器输出时钟信号。但是，此时的级联并不能实现00-23的输出，相反，它是40进制，此时需要将低位的Q2和高位的Q1进展与非，同时将高位和低位清零，从而实现24进制。B、日7进制电路设计日7进制计数器显示0-6数字信号，如上图所示。日计数器需要进展10进制到7进制的进制转换，当Q3Q2Q1Q0变成0

9、110时，通过与非门把它的送数端置0，则计数器跳过0111-1010状态，下一时刻又从0000开场，如此重复，从而实现7进制的转换。3、译码显示电路设计 本设计使用CD4511共阴极数码驱动芯片对数码管进展驱动，根据数码管驱动功能表：设计了如下的译码驱动电路：A、上图为时分秒电路译码显示。B、上图为日显示译码局部电路。只需要将CD4511的D0-3端与对应的计数器Q0-3端口连接即可。4、校时电路设计 在数字电子钟开机时，由于时分秒日均为任意值，为了显示正确，就需要进展调整，将时间显示校正为正确的时间。并且此次设计要求要对时分秒日4局部可进展单独校正，由于电路输入秒脉冲信号为1Hz，校正速度较

10、慢，所以引入了更高频率的脉冲信号进入电路中只需要引入CD4060的不同输出端输出信号即可，进展手动校正。上图为日计数局部手动校正电路，时分秒局部同理。5、整点报时电路设计要求: 当计数到整点前6秒时，电路开场准备报时。如上图所示，当分计时到59时，将分触发器QH左置1，而等到秒计数器到54时，将秒触发器Q1右置1，然后通过Q1和QH相与之后再和1S标准信号相与而去控制低音喇叭鸣叫，直到59秒时产生一个复位信号，使Q1清零，停顿低音鸣叫，同时59秒信号取反与QH相与后控制高音喇叭鸣叫。当计时到分，秒从59：59-00：00时，鸣叫完毕，完成整点报时。附：鸣叫电路设计鸣叫电路由上下两种频率通过或门

11、去驱动一个三极管，从而带动喇叭鸣叫。1Hz和500Hz从晶振分频器近似获得，CD4060分频器的输出端Q5和Q6的输出频率分别为1024Hz和512Hz。电路设计如下列图所示：2、绘出总体电路图(详见附录一)四、电路的组装与调试1、使用主要仪器、仪表。应列知名称、型号、生产厂家和生产日期等；数字电路实验箱数字万用表2、实物调试过程：七、所用元器件的编号列表序号符号与编号名称数量规格说明1无万用电路板22Y32768Hz晶振13U4060CD40601集成电路4U7474HC741集成电路5U(1)-U(7)74HC1617集成电路6U01-U06CD45117集成电路7YF11-YF4174H

12、C002集成电路8F174HC042集成电路9YF1-374LS201集成电路10C1,C220P电容211R20M欧电阻112U2,U3，U4两位LED共阴显示器30.56英寸，18个引脚的13U1单位LED共阴显示器10.56英寸，10个引脚的14无16脚管座15DIP封装15无14脚管座5DIP封装16S1-S7一常开一常闭按键7不带自锁的17无导线假设干18无面包板319无硬导线假设干20B蜂鸣器121Q三极管8050122R1电阻1k123Y1-Y574LS082集成电路24H74LS321集成电路附一：CD4060功能概述。CD4060由一振荡器和14级二进制串行计数器位组成，振荡

13、器的构造可以是RC或晶振电路，CR为高电平时，计数器清零且振荡器使用无效。所有的计数器位均为主从触发器。在CP1(和CP0)的下降沿计数器以二进制进展计数。在时钟脉冲线上使用斯密特触发器对时钟上升和下降时间无限制。电气参数。Remended Operating Conditions 建议操作条件：Supply Voltage电源电压(VDD) +3V to +15V Input Voltage输入电压 (VIN) 0V to VDD Operating Temperature Range工作温度*围 (TA) -40 to +85管脚图。附二：74HC74功能概述：74HC74是一个高速硅栅C

14、MOS器件 ，其引脚与低功耗肖特基TTL兼容 输入通道。 该74HC74是双正边沿触发，D型 触发器与D输入，时钟CP的输入个人资料， 集SD和复位RD的投入;也互补 Q和Q输出。 设定和复位是异步积极投入低并能独立工作的时钟输入。信息 输入的数据传送到Q输出的 低到高的时钟脉冲过渡。 D的投入必须是稳定的一个设定时间之前低到高时钟转换为可预知的操作。施密特触发器的时钟输入操作，使电路高度耐慢时钟上升和下降时间电气参数管脚图附三： 74HC161功能概述。74HC161是常用的四位二进制可预置的同步加法计数器，他可以灵活的运用在各种数字电路，以及单片机系统种实现分频器等很多重要的功能。一片74HC161可以组成16进制以下的任意进制分频器。电气参数。管脚图。附四：CD4511功能概述。CD4511是一个用于驱动共阴极 LED 数码管显示器的 BCD 码七段码译码器，特点：具有BCD转换、消隐和锁存控制、七段译码及驱动功能的CMOS电路能提供较大的拉电流。可直接驱动LED显示器。电气参数。管脚图。附五： 74HC00功能概述。电气参数。管脚图。附六： 74HC04功能概述。电气参数。管脚图。附七： 74HC08功能概述电气参数管脚图附八： 74HC32功能概述电气参数管脚图附九： 74HC20功能概述电气参数管脚图七、设计收获体会：通过本实验的关于程控放大器工作原理分析及其设计