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文档简介

1、可编程逻辑器件 时序逻辑电路1实验目的 （1）了解时序逻辑电路的设计方法 （2）掌握集成计数器的级联方法 （3）掌握Quartus II软件中使用文本输入法和原理图输入法进行电路设计和仿真2预习要求（1）熟悉中规模集成芯片74161的引脚排列和逻辑功能（2）熟悉可编程时序逻辑设计的基本方法3实验内容 利用VHDL语言编程实现60进制计数器的时序逻辑功能，进行软件仿真和硬件测试。4报告要求1）VHDL描述74161的程序2）仿真波形5附录：Quartus II使用1、建VHDL文本文件，保存的同时新建一个工程，该工程名要和文件中的实体名相一致。2、Start compilation开始编译3、在

2、file下新建波形文件用于仿真。Insert/insert node or bus/node find/list把端口全部导入波形图中，保存波形文件。点击Start simulation,得结果。思考输入的不同进制如何切换？64、管脚锁定。输入输出端口配上实验板上FPGA的引脚，这是下载程序到实验板上的关键。芯片选择：EP3C16Q240C8思考：在做仿真时，Quartus提供了哪二种仿真？这二种仿真的区别，以及如何调用这二种仿真？7试验箱LED电路图8管脚锁定部件名称LED1LED2LED3LED4引脚名称Pin_237Pin_238Pin_239Pin_240部件名称LED5LED6LED7LED8引脚名称Pin_4Pin_5Pin_6Pin_9部件名称CLK1CLK2CLK3CLK4引脚名称Pin_31Pin_33Pin_210Pin_212CLK1,CLK2: 50MH

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