串行通信电路的设计

1、串行通信电路I串行通信电路的设计1 串行通信电路1.1 设计目的（1）掌握串行通信电路的构成、原理与设计方法；（2）熟悉 QuartusII 的仿真方法。1.2 基本要求（1）发方实现 8bit 码字的并串转换，使用单一电缆发送信号，收方实现串并转换后输出；（2）并行输出端的 8bit 寄存器；（3）收方数据是否已准备好指示输出端。1.3 发挥部分（1）加密通信；（2）串行发/收端口 FIFO 缓存；（3）发/收方奇偶校验位生成/检测；（4）其他。2 设计过程及论文的基本要求2.1 设计过程的基本要求：（1）基本部分必须完成，发挥部分可以在已给的范围或自己寻找资料的范围内任选；（2）符合要求的

2、设计报告一份，其中包括逻辑电路图、实际接线图各一份；（3）设计题目必须仿真通过，设计过程的资料草稿上交；（4）成绩的组成：考勤、每天任务的完成工作量、答辩情况、报告；2.2 课程设计论文的基本要求：（1）蓝黑色或黑色钢笔或碳素笔书写，不允许用圆珠笔。项目齐全、字迹工整，有条件的可以打印。（2）装订顺序：封面、任务书、成绩评定表、中文摘要、关键词、目录、正文（正文的具体要求按老师讲课要求） 、总结及致谢、参考文献、附录（逻辑电路图与实际接线图） 。中文摘要中文摘要串行通信电路是为了实现数据传输的方便而设计的一种电路，将八位数据通过八位加法器使要传送的数据同时加上一个数，而这个数是通过两片计数器组

3、成的时钟电路实现的，并且此时钟电路不断的对输入数据进行加法运算，实现数据的加密计算。并行变串行是通过数据选择器使八位的加密数据通过 74151 实现数据的串行传送，从而实现电路的功能。串行数据变并行数据，将串行数据送到移位寄存器中，控制移位串行通信电路II寄存器的时钟脉冲，使数据能够从移位寄存器的八个输出端口输出，但一定要控制好当移位寄存器有时钟脉冲作用时，所选出的数据恰好是加密后的八位并行数据，为后面的解码部分做准备。解密电路是利用时钟电路和加法器。不过，是将加法器的 CIN端置高电平，实现的是减法运算，还有就是时钟电路输出的要是加密时钟输出数据的反码，这样才能实现数据的解密。另外，数据解密

4、是解密时钟电路的 CP 脉冲一定要和加密时钟脉冲的 CP 脉冲一致，才能确保电路的正确性。数据输出电路的设计是将解密电路解密后的数据，送到寄存器中。控制寄存器的脉冲实现数据的输出。数字电子技术的迅速发展，为人们的文化、物质生活提供了优越的条件，空调、电子计算机等，都是典型的技术应用实例。计算机的普及，为大学生提供很好的学习平台。经过对数字电子技术基础一学期的学习，掌握了一些理论上的知识。而课程设计正好帮我们好好的整理和实践了这些知识。目录目录课程设计任务书课程设计任务书 .I I数字电子技术数字电子技术 课程设计成绩评定表课程设计成绩评定表 .IIIIII中文摘要中文摘要 .IVIV串行通信电

5、路III1 1 设计任务描述设计任务描述 .1 11.1 设计题目：串行通信电路 .11.2 设计要求： .11.2.1 设计目的：.11.2.2 基本要求：.11.2.3 发挥部分：.12 2 设计思路设计思路 .2 23 3 设计方框图设计方框图 .3 34 4 各部分电路设计及调试各部分电路设计及调试 .4 44.1 并行数据加密 .44.2 加密数据并行变串行模块.44.3 串行变并行电路设计.54.4 解密电路.64.5 数据输出电路 .75 5 串行通信电路过程分析串行通信电路过程分析 .8 85.1 串行通信电路的总电路图 .85.2 电路图的工作过程分析 .85.2.1 并行数

6、据加密工作过程分析.85.2.2 数据变换为串行数据电路工作过程分析.95.2.3 串行变并行电路的工作过程分析.95.2.4 解密电路电路的工作过程分析.105.25 输出电路的工作过程分析 .106 6 元器件清单元器件清单 .12127 7 主要元器件介绍主要元器件介绍 .1313小结小结 .1616致谢致谢 .1717参考文献参考文献 .1818附录附录 A A 串行通信总电路串行通信总电路 .1919串行通信电路11 设计任务描述设计任务描述1.1 设计题目：设计题目：串行通信电路串行通信电路1.2 设计要求：设计要求：1.2.1 设计目的：设计目的：（1）掌握串行通信电路的构成、原

7、理与设计方法；（2）熟悉 QuartusII 的仿真方法。1.2.2 基本要求：基本要求：（1）发方实现 8bit 码字的并串转换，使用单一电缆发送信号，收方实现串并转换后输出（2）并行输出端的 8bit 寄存器；（3）收方数据是否已准备好指示输出端。1.2.3 发挥部分：发挥部分：（1）加密通信。串行通信电路22 设计思路设计思路根据此次课程设计的目的，串行通信电路是将 8bit 的并行数据通过加密等过程，进行串行输送，在进行解码和串行数据变并行数据，最后输出。我的设计思路就是：（1）加密模块：将八位数据通过八位加法器使要传送的数据同时加上一个数，而这个数是通过两片计数器组成的时钟电路实现的

8、，并且此时钟电路不断的对输入数据进行加法运算，实现数据的加密计算。 （2）并行变串行：并行变串行是通过数据选择器使八位的加密数据通过 74151 实现数据的串行传送，从而实现电路的功能。 （3）串行数据变并行数据的电路设计思路是，将串行数据送到移位寄存器中，控制移位寄存器的时钟脉冲，使数据能够从移位寄存器的八个输出端口输出，但一定要控制好当移位寄存器有时钟脉冲作用时，所选出的数据恰好是加密后的八位并行数据，为后面的解码部分做准备。 （4）解密模块：解密电路是利用时钟电路和加法器。不过，是将加法器的 CIN 端置高电平，实现的是减法运算，还有就是时钟电路输出的要是加密时钟输出数据的反码，这样才能

9、实现数据的解密。另外，数据解密是解密时钟电路的 CP 脉冲一定要和加密时钟脉冲的 CP 脉冲一致，才能确保电路的正确性。 （5）数据输出电路的设计是将解密电路解密后的数据，送到寄存器中。控制寄存器的脉冲实现数据的输出。以上为串行通信电路的设计思路。串行通信电路33 设计方框图设计方框图数据输入加密后的并行数据加密的串行数据并行数据输出数据加密电路数据选择器数据分配器解密电路串行通信电路44 各部分电路设计及各部分电路设计及调试调试4.1 并行数据加密并行数据加密数据加密模块设计如图 4.1 所示：图 4.1 数据加密模块设计电路 数据加密模块的设计思路是：利用八位加法器和两片 74161 组成

10、的多位计数器，不断的在输入数据上加数，进而达到对输入数据进行加密的效果，使并行数据能够加密后输出。4.4.2 2 加密数据并行变串行模块加密数据并行变串行模块并行变串行模块设计如图 4.2 所示：串行通信电路5图 4.2 并行变串行模块设计电路 并行变串行电路设计主要利用了 74151 数据分配器和 74161 计数器完成。数据分配器将八位加法器加密过的八位数据，依次分配，进而达到串行传输的目的。具体过程是将 74161 设置重置端，当计数器计数到七的时候，重置端有效，将并行数据按DO,D1,D2,D3,D4,D5,D6,D7 的顺序串行从 Y 输出。4.34.3 串行变并行电路设计串行变并行

11、电路设计串行数据变并行数据的电路设计思路是，将串行数据送到移位寄存器中，控制移位寄存器的时钟脉冲，使数据能够从移位寄存器的八个输出端口输出，但一定要控制好当移位寄存器有时钟脉冲作用时，所选出的数据恰好是加密后的八位并行数据，为后面的解码部分做准备。 串行变并行电路设计如图 4.3 所示串行通信电路6图 4.3 串行变并行数据电路设计图4.4 解密电路解密电路解密电路如图 4.4 所示图 4.4 解密电路图串行通信电路7解密电路是利用时钟电路和加法器。不过，是将加法器的 CIN 端置高电平，实现的是减法运算，还有就是时钟电路输出的要是加密时钟输出数据的反码，这样才能实现数据的解密。另外，数据解密

12、是解密时钟电路的 CP 脉冲一定要和加密时钟脉冲的CP 脉冲一致，才能确保电路的正确性。4.5 数据输出电路数据输出电路数据输出电路的设计是将解密电路解密后的数据，送到寄存器中。控制寄存器的脉冲实现数据的输出。输出电路的电路图，如图 4.5 所示。图 4.5 数据输出电路串行通信电路85 串行通信电路过程分析串行通信电路过程分析5.15.1 串行通信电路串行通信电路的总电路图的总电路图图 5.1 串行通信电路总电路图5.25.2 电路图的工作过程分析电路图的工作过程分析本次设计的电路是串行通信电路，该电路实现的是将八位数据变为串行数据进行传输，最后变回并行数据输出。其中实现了时钟加密通信。.5

13、.2.1 并行数据加密工作过程分析并行数据加密工作过程分析首先，输入八位数据，假设为 10101010，然后两片 74161 组成的时钟电路对输入的八位数据进行加密。仿真结果如下：串行通信电路9图 5.2.1 数据加密仿真结果 此仿真结果是利用时钟脉冲将八位的输入数据加密后的数据结果。5.2.25.2.2 数据变换为串行数据电路工作过程分析数据变换为串行数据电路工作过程分析八位数据加密后由数据选择器变换为串行的数据，此过程电路的仿真结果如下：图 5.2.2 变换为串行数据电路仿真结果5.2.3 串行变并行电路的工作过程分析串行变并行电路的工作过程分析这部分模块可以说是整个电路的核心所在，此部分

14、电路是将串行数据又变回了并行数据，此模块实现的方法是利用移位寄存器的原理实现的，为后面的解密做好基础。次模块的仿真结果如下：串行通信电路10图 5.2.3 串行变并行数据输出仿真图5.2.4 解密电路电路的工作过程分析解密电路电路的工作过程分析解密电路是根据数据分配器输出的八位数据分配器，时钟电路和加法器组成的解密电路实现。此模块的仿真结果如图：图 5.2.4 解密电路仿真结果图5.25 输出电路的工作过程分析输出电路的工作过程分析输出电路所实现的是数据的输出，和加密前的数据完全相同。实现此功能利用了寄存器。仿真结果如图所示。串行通信电路11图 5.2.5 输入与输出结果图串行通信电路126

15、6 元器件清单元器件清单序号元器件名称型号数量1数据选择器741511 片2计数器741615 片3移位寄存器741641 片4寄存器743741 片5八位全加器8ffadd2 片6非门NOT9 个7二输入与非门Nand22 个串行通信电路137 7 主要元器件介绍主要元器件介绍7.1 数据选择器 741517.1.1 引脚图7.1.2 功能表表 7.1.2 74HC151 的功能表输 入输 出使能选 择 210 HLLLLLLLL L L LL L HL H LL H HH L LH L HH H LH H HL HD0 0D1 1D2 2D3 3D4 4D5 5D6 6D7 77.2 计数

16、器 741617.2.1 引脚图串行通信电路147.2.2 功能表表 7.2.2 74LVC161 的功能表输入输出清零预置使能CEP CET时钟CP预置数据输入3 2 1 03 2 1 0进位TCLHHHHLHHH L LH H 32 1 0 L L L L 3210保持保持计数L#L#7.3 移位寄存器 741647.3.1 引脚图7.3.2 功能表串行通信电路15表 7.3.2 74164 的功能表7.4 寄存器 743747.4.1 引脚图7.4.2 功能表表 7.4.2 74374 的功能表串行通信电路16小结小结本次我们组课程设计的题目是串行通信电路，这次课程设计我们查阅了许多的相

17、关文献和书籍。因为刚看到这个题目的时候，大家都不了解。前期都处于迷茫状态。此次课设是一周的时间，第一天，老师对每个题目都做了解释及其具体的要求，使逻辑电路的轮廓逐渐清晰起来。知道了从何处下手。大家都知道，课程设计是用我们课程知识综合应用的实践训练；是我们迈向社会，从事职业工作前一个必不少的过程。所以我很珍惜这次机会，在老师讲完的时候，我们组就有了一个模块的思路。我组成员都很积极，想大显自己的能力。我们今天认真的进行课程设计，学会脚踏实地迈开实践这一步，就是为明天能稳健地在社会大潮中奔跑打下坚实的基础。在这次的课程设计中，不仅检验了我所学习的知识，也培养了我如何去把握一件事情，如何去做一件事情，

18、又如何完成一件事情。在设计过程中，与同学分工设计，和同学们相互探讨，相互学习，相互监督。学会了合作，学会了运筹帷幄，学会了宽容，学会了理解，也学会了做人与处世。这一周内， 我感触最深的当属查阅大量的设计资料了。无论是课本上的，还是网上的都浏览了不少相关的设计思路，从中也借鉴了别人的思想，开阔了自己的思路。在设计程序之前，设计者必学对所用的知识内部有一个深刻的理解，知道具体应用的是哪一部分的知识。更要有一个清晰的思路和一个完整的结构框图。在设计逻辑电路时，不能妄想一次就将整个电路图设计好。 反复修改、不断改进是整个设计过程的必经之路。要养成文件管理的好习惯，因为每个模块可能仿真的次数很多，如果不

19、整理好文件，最后可能一团糟。一个逻辑图的完美与否不仅仅是实现其应有的功能， 而应该让人一看就能明白你的设计结构。在设计课程过程中遇到问题是很正常的，但我们应该将每次遇到的问题分析清楚，并及时解决，以免下次再碰到同样的问题。通过这次训练，我能够更好的综合运用所学知识、独立分析和解决实际问题。培养了自己的创新意识和创新能力，并获得了科学研究的基础训练和培养了团队协作精神。在这个过程中，我也学到了很多知识。因为每个同学喜好不一样，有的人喜欢研究，有的人喜欢大量查阅资料。所以从他们那里学的东西也多了。比如说，在设计的时候，我有个模块一直想不透。恰好一个同学提供了一个想法，在这个基础上，最后我设计出了更完整的逻辑电路图。团队合作精神真的很重要。我组成员各有优点，他们融会贯通的能力很好，也使我这方面的能力得到了很大提高。在与老师交流、请教之间，课设很快就结束了。一周的时间虽然短暂，但在这一星期的课程设计中收获很多。将以前的知识运用到实践中，大大提升了自己的动手能力。在设计与仿真的过程中，对某些元件的功能及特点有了很好的了解，这