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文档简介

1、EDA上机实验报告 姓名： 学号： 班级： 专业： 集成电路工程类 学院： 半加器设计实验1、 实验目的： 练习半加器的VHDL程序设计以及功能仿真。2、实验任务：参考半加器电路原理图以及真值表，编写VHDL程序，完成Quartus II设计文本输入，分别按照4.1节的流程对半加器进行功能仿真，并生成RTL电路图。3、真值表如下：ABSOCO00000110101011014、程序编写要求：（1） 使用一个异或门（XOR）和一个与门（AND）；（2）使用两个与门，一个或门（OR）和一个非门（NOT）。5、实验步骤:(1) 兴建一个文件夹，取名为h_adder。(2) 输入源程序。打开Quart

2、us II,选择>New命令。在窗口中Design Files栏中选着文件的语言类型，这里选择VHDL File选项。(3) 文件存盘。选择>Save As命令，找到已设立的文件夹，存盘文件名应该与实体名一致。(4) 创建工程，打开并建立新工程管理窗口。选择>New Project Wizard命令。(5) 将设立文件夹加入工程。(6) 选择目标芯片，并进行工具设置。(7) 编译。选择Processing->Start compilation命令，启动全程编译，若编译成功者可进行仿真测试。(8) 打开波形编辑器。选择>New命令，在New窗口中选择Vector W

3、avefore File选项。(9) 设置仿真区域，并进行文件存盘。(10) 将工程的端口信号节点选入波形编辑器中。选择View->Utility Windows->Node Finder命令Filter下拉列表框中选择“Pins:all”，单击List按钮。将节点拖到波形编辑器中窗口。(11) 设置激励信号波形，进行波形文件存盘。(12) 启动仿真器。选择Processing->Start Simulation命令，启动仿真。(13) 观察仿真结果。(14) 综合所生成的电路图。选择Tools->Netlist Viewers命令，在出现的下拉菜单中有3个选项，选择RTL Viewer。一、使用一个异或门（XOR）和一个与门（AND）； 仿真波形图如下：（a=2.0nm)综合所生成的电路图如下：二、使用两个与门，一个或门（OR）和一个非门（NOT） 仿真波形图如下：(a=1.5nm)综合生成的电路图如下：五、实验心得 通过本次实验的学习，并在老师和同学帮助下，我学会了一些VHDL程序的编写方法，并完成Quartus II设计文本输入，基本掌握会对半加器进行功能仿真，并生成RTL电路图。但是自己觉得还远远不够，以后要加倍努力学习，熟悉使用这个软件，达到自己灵活运用的目的

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