第4章 存储系统机制及存储器接口(书)

1、LOGO 嵌入式系统原理及接口技术嵌入式系统原理及接口技术 v存储器是嵌入式系统中的主要硬件部件，用于存存储器是嵌入式系统中的主要硬件部件，用于存 储指令码及相关的数据。储指令码及相关的数据。 v目前有许多嵌入式目前有许多嵌入式CPU芯片内部集成有一定容量芯片内部集成有一定容量 的易失性及易失性的存储器。但也有需要扩展外的易失性及易失性的存储器。但也有需要扩展外 部存储器芯片的。部存储器芯片的。 v总线是把微处理器与存储器、总线是把微处理器与存储器、I/O端口及设备相端口及设备相 连接的信息通道，但总线并不仅仅指的是一束信连接的信息通道，但总线并不仅仅指的是一束信 号线，而应包含相应的通信协议

2、和规则。号线，而应包含相应的通信协议和规则。 v在嵌入式系统中，按照使用场合的不同，我们可在嵌入式系统中，按照使用场合的不同，我们可 以把总线分成：以把总线分成： v（1）片上总线）片上总线 v（2）板级总线）板级总线 v（3）系统级总线）系统级总线 v片上总线即是微处理器芯片内部的总线，典型的片上总线即是微处理器芯片内部的总线，典型的 如如ARM公司提出的公司提出的AMBA总线。总线。 vAMBA是是Advanced Microcontroller Bus Architecture的缩写，是一种开放的，用于高的缩写，是一种开放的，用于高 性能嵌入式系统中的总线规范。性能嵌入式系统中的总线规范

3、。 vAMBA总线规范总线规范2.0版本中包含了版本中包含了4个部分个部分:AHB、 ASB、APB和和Test Methodology。其中：。其中： AHB是是Advanced High Performace Bus的缩写，用于芯片的缩写，用于芯片 内高性能系统模块连接的总线，支持突发模式数据传输和事务处理。内高性能系统模块连接的总线，支持突发模式数据传输和事务处理。 ASB是是Advanced System Bus的缩写，也是用于芯片内高性的缩写，也是用于芯片内高性 能系统模块的连接，支持突发模式数据传输。这是早期的系统总线格能系统模块的连接，支持突发模式数据传输。这是早期的系统总线格

4、式，现在由式，现在由AHB取代。取代。 v APB是是Advanced PeriPheral Bus的缩写，是用于芯片内较的缩写，是用于芯片内较 低性能的低性能的I/O部件或模块的连接，一般是作为部件或模块的连接，一般是作为ARM系列微处理器芯系列微处理器芯 片中二级总线用。片中二级总线用。 v Test Methodology是是AMBA总线规范中所制定的测试方法。总线规范中所制定的测试方法。 v板级总线是指板卡中芯片与芯片之间、或者板卡板级总线是指板卡中芯片与芯片之间、或者板卡 与板卡之间的连接总线。典型的如与板卡之间的连接总线。典型的如PC-104总线、总线、 PCI总线等。总线等。 v

5、但是，嵌入式系统由于受到应用条件的约束，特但是，嵌入式系统由于受到应用条件的约束，特 别是体积方面的约束，因此，在构建板级目标系别是体积方面的约束，因此，在构建板级目标系 统时，往往并未采用标准化的总线，而是直接完统时，往往并未采用标准化的总线，而是直接完 成芯片与芯片引脚间的连接。成芯片与芯片引脚间的连接。 v嵌入式系统的板级目标系统硬件平台设计时，主嵌入式系统的板级目标系统硬件平台设计时，主 要完成的任务是把微处理器芯片与其它芯片进行要完成的任务是把微处理器芯片与其它芯片进行 有机的连接。有机的连接。 v嵌入式系统的板级目标系统硬件嵌入式系统的板级目标系统硬件 平台设计时，主要完成的任务是

6、平台设计时，主要完成的任务是 把微处理器芯片与其它芯片进行把微处理器芯片与其它芯片进行 有机的连接。有机的连接。 vS3C2440芯片芯片FBGA封装中的封装中的 289条引脚中，按功能分成以条引脚中，按功能分成以 下几类：下几类： v（1）地址类信号引脚：）地址类信号引脚： v ADDR0ADDR26和和nGCS0nGCS7 v（2）数据类信号引脚：）数据类信号引脚： v DATA0DATA31 v（3）控制类信号引脚）控制类信号引脚 又可以分成几个子类：又可以分成几个子类： 1、总线控制信号、总线控制信号 OM1、OM0：这：这2根信号线是根信号线是S3C2440的模式选择信号引脚，用的模

7、式选择信号引脚，用 来确定芯片的模式以及数据线的宽度。来确定芯片的模式以及数据线的宽度。nWE（输出引脚）：写使能（输出引脚）：写使能 信号引脚，用来指示当前总线周期为写周期。信号引脚，用来指示当前总线周期为写周期。 nOE：读使能信号引脚，用来指示当前总线周期为读周期。：读使能信号引脚，用来指示当前总线周期为读周期。 nWAIT（输入引脚）：等待信号引脚，用来请求延长当前周期。（输入引脚）：等待信号引脚，用来请求延长当前周期。 nXBREQ（输入引脚）：总线请求。（输入引脚）：总线请求。 nXBACK（输出引脚）：总线应答。（输出引脚）：总线应答。 2、NAND Flash控制信号控制信号

8、3 、SDRAM控制信号控制信号 v（4）I/O部件接口引脚部件接口引脚 这类功能的引脚有许多，主要是完成相应的接口部件功能，例如：这类功能的引脚有许多，主要是完成相应的接口部件功能，例如： UART的串口通信引脚、的串口通信引脚、LCD显示器接口引脚、摄像头接口引脚等。显示器接口引脚、摄像头接口引脚等。 v（5）其它功能类引脚）其它功能类引脚 其它功能类引脚主要包括：其它功能类引脚主要包括：JTAG调试接口引脚、调试接口引脚、 复位引脚、时钟电路引脚、以及电源引脚等。复位引脚、时钟电路引脚、以及电源引脚等。 v其它板级总线标准：其它板级总线标准： v（1）PC-104总线总线 PC-104总

9、线是专门为控制领域的应用而定义的嵌入式总线是专门为控制领域的应用而定义的嵌入式 系统总线，它支持采用堆栈结构的总线形式，通过系统总线，它支持采用堆栈结构的总线形式，通过PC- 104总线，可以把各板卡叠加在一起，从而构建小型的、总线，可以把各板卡叠加在一起，从而构建小型的、 高可靠性的嵌入式系统。高可靠性的嵌入式系统。 v（2）STD总线总线 STD总线也是在工业控制领域被使用的一总线也是在工业控制领域被使用的一 种嵌入式系统板级总线种嵌入式系统板级总线 v（3）PCI总线总线 PCI总线是总线是PC机中被广泛使用的板级总线标准。在有些机中被广泛使用的板级总线标准。在有些 嵌入式系统中，也会采

10、用嵌入式系统中，也会采用PCI总线作为其板级总线。总线作为其板级总线。 v一、存储系统的组织结构一、存储系统的组织结构 v在复杂的嵌入式系统中，存储系统的组织结构按在复杂的嵌入式系统中，存储系统的组织结构按 作用可以划分为作用可以划分为4级：寄存器、级：寄存器、cache（缓存（缓存 区）、主存储器和辅助存储器。如下图所示。区）、主存储器和辅助存储器。如下图所示。 v注：对于简单的嵌入注：对于简单的嵌入 式系统来说，没有必式系统来说，没有必 要把存储器系统设计要把存储器系统设计 成成4级，最简单的嵌入级，最简单的嵌入 式系统只需要寄存器式系统只需要寄存器 和主存储器即可。和主存储器即可。 v寄

11、存器是包含在微处理器核内部的，是微处理器寄存器是包含在微处理器核内部的，是微处理器 核的重要组成部分，它用来作指令执行时的数据核的重要组成部分，它用来作指令执行时的数据 存放单元。存放单元。 vCache是高速缓存，通常又分成数据缓存和指令是高速缓存，通常又分成数据缓存和指令 缓存缓存2种。种。 v主存储器是程序执行代码及数据的存放区，通常主存储器是程序执行代码及数据的存放区，通常 存放指令代码的存储器是非易失性的存储器。存放指令代码的存储器是非易失性的存储器。 v辅助存储器通常用来存储大容量数据，或者作为辅助存储器通常用来存储大容量数据，或者作为 程序代码的备份存储空间，由程序代码的备份存储

12、空间，由NAND Flash类类 型的非易失性存储器芯片来承担。型的非易失性存储器芯片来承担。 v二、高速缓存机制二、高速缓存机制 v高速缓存（高速缓存（cache）机制是为了提高嵌入式系统）机制是为了提高嵌入式系统 中存储系统的整体性能。它作为微处理器体系结中存储系统的整体性能。它作为微处理器体系结 构的一部分，对软件设计者来说是透明的。构的一部分，对软件设计者来说是透明的。 v高速缓存是一种小型、快速的存储器，但价格较高速缓存是一种小型、快速的存储器，但价格较 贵，在系统中它的容量不可能设计得很大，通常贵，在系统中它的容量不可能设计得很大，通常 为几十为几十K存储单元或几存储单元或几M存储

13、单元。因而，所需存储单元。因而，所需 访问的代码或数据很大时，不能全部放入高速缓访问的代码或数据很大时，不能全部放入高速缓 存中，高速缓存中只保留了主存储器中部分代码存中，高速缓存中只保留了主存储器中部分代码 或数据的拷贝。或数据的拷贝。 v高速缓存控制器是微处理器用于控制访问高速缓高速缓存控制器是微处理器用于控制访问高速缓 存及主存系统的桥梁，它处于微处理器和高速缓存及主存系统的桥梁，它处于微处理器和高速缓 存及主存系统之间，如下图所示。存及主存系统之间，如下图所示。 v三、存储管理单元三、存储管理单元 v在复杂的嵌入式系统设计时，越来越多的会选用在复杂的嵌入式系统设计时，越来越多的会选用

14、带有存储管理单元（带有存储管理单元（MMU）的微处理器芯片。）的微处理器芯片。 vMMU完成的主要功能有：完成的主要功能有： （1）将主存地址从虚拟存储空间映射到物理存储）将主存地址从虚拟存储空间映射到物理存储 空间。空间。 （2）存储器访问权限控制。）存储器访问权限控制。 （3）设置虚拟存储空间的缓冲特性等。）设置虚拟存储空间的缓冲特性等。 存储器接口设计方法 v在构建嵌入式系统的目标硬件平台时，有些微处在构建嵌入式系统的目标硬件平台时，有些微处 理器芯片内部没有集成存储器或者集成的存储器理器芯片内部没有集成存储器或者集成的存储器 容量不足，那么，就需要外接存储器芯片来构建容量不足，那么，就

15、需要外接存储器芯片来构建 所需容量的存储空间。所需容量的存储空间。 v下面讨论需要在微处理器下面讨论需要在微处理器 芯片外部设计主存储器接芯片外部设计主存储器接 口电路的问题，并讨论辅口电路的问题，并讨论辅 助存储器的接口电路设计助存储器的接口电路设计 问题。问题。 v一、存储器芯片分类一、存储器芯片分类 v存储器根据其存取方式分成两大类：随机存储器存储器根据其存取方式分成两大类：随机存储器 （RAM）类和只读存储器（）类和只读存储器（ROM）类。）类。 v（1）随机存储器（具有易失性的特点）随机存储器（具有易失性的特点） 随机存储器又分为两大类：随机存储器又分为两大类： *静态随机存储器（静

16、态随机存储器（SRAM） *动态随机存储器（动态随机存储器（DRAM vSRAM（静态随机存储器）通俗的说，是在上电（静态随机存储器）通俗的说，是在上电 的情况下，其存储内容不会丢失的存储器。它们的情况下，其存储内容不会丢失的存储器。它们 通常是以双稳态触发器为基础，数据一经写入，通常是以双稳态触发器为基础，数据一经写入， 只要不掉电，数据就一直保存着。只要不掉电，数据就一直保存着。 vSRAM芯片内部的存储容量一般不大，通常约在芯片内部的存储容量一般不大，通常约在 几几K几百几百K范围内。典型的如：范围内。典型的如：HM62256芯芯 片，其容量为片，其容量为32KB。 vHM62256芯片

17、引脚：地址线芯片引脚：地址线15根，数据线根，数据线8根，根， 控制信号线控制信号线3根（读、写、片选），电源线及地根（读、写、片选），电源线及地 线线2根。根。 v流行的流行的DRAM类别：类别： SDRAM (Synchronous Dynamic Random Access Memory的缩写的缩写, 即同步动态随机存储器即同步动态随机存储器)。 v动态存储器中信息是存放在电容上的，需要定时刷动态存储器中信息是存放在电容上的，需要定时刷 新，需要有行选通新，需要有行选通RAS、列选通信号、列选通信号CAS，且地址，且地址 信号线是复用的。信号线是复用的。 vSDRAM在内部结构及使用上与

18、标准在内部结构及使用上与标准DRAM有很大有很大 不同。引起不同的基本出发点就是希望不同。引起不同的基本出发点就是希望SDRAM的的 速度更快一些，满足微处理器对主存速度的要求。速度更快一些，满足微处理器对主存速度的要求。 vSDRAM的容量经常用的容量经常用XX存储单元存储单元X体体每个存每个存 储单元的位数来表示。储单元的位数来表示。 v如：如：HY57V561620是一款是一款SDRAM芯片。其芯片。其 容量为：容量为： 4M 4Bank 16b （即（即32MB）。）。 v其典型的引脚图如：其典型的引脚图如： v 其中：其中： v A0A12是地址线，行地址和列地址复是地址线，行地址和

19、列地址复 用用A0A8。行地址为。行地址为RA0RA12，列，列 地址为地址为CA0CA8。 v DQ0DQ15是数据线。是数据线。 v BA0、BA1是块（是块（Bank）选择线。）选择线。 v nRAS：行地址选通信号线。：行地址选通信号线。 v nCAS：列地址选通信号线。：列地址选通信号线。 v nCS：片选信号引线。：片选信号引线。 v（2）只读存储器（具有非易失性的特点）只读存储器（具有非易失性的特点） v只读存储器（只读存储器（ROM）是指那种其内部存储单元）是指那种其内部存储单元 中的数据不会随失电而丢失的存储器。在嵌入式中的数据不会随失电而丢失的存储器。在嵌入式 系统中，只读

20、存储器中通常存储程序代码和常数。系统中，只读存储器中通常存储程序代码和常数。 v只读存储器通常又分成只读存储器通常又分成EPROM、EEPROM和和 闪存（闪存（Flash）。）。Flash又有又有NOR Flash和和 NAND Flash两大类。两大类。 vEPROM类型的芯片目前基本处于淘汰地位，只类型的芯片目前基本处于淘汰地位，只 有在一些低端嵌入式系统还在使用。有在一些低端嵌入式系统还在使用。 Flash是目是目 前嵌入式系统中使用的主流非易失性存储器。前嵌入式系统中使用的主流非易失性存储器。 v几种几种ROM型芯片外形图。型芯片外形图。 EPROM型芯片外形图EEPROM型芯片外形

21、图 v二、存储器接口设计方法二、存储器接口设计方法 v（1）SROM型存储器接口设计方法型存储器接口设计方法 vSROM型存储器，是型存储器，是SRAM型存储器、型存储器、EPROM型型 存储器、存储器、NOR Flash型存储器的统称。型存储器的统称。 v上述上述3类存储器芯片与微处理器之间的接口电路设计类存储器芯片与微处理器之间的接口电路设计 方法是相似的。方法是相似的。 vSROM型存储器接口的信号线一般有：型存储器接口的信号线一般有： v（1）片选信号线）片选信号线CE。 v（2）读）读/写控制信号线。写控制信号线。 v（3）若干根地址线。）若干根地址线。 v（4）若干根数据线。）若干

22、根数据线。 v 接口电路原理框图如右图所示。接口电路原理框图如右图所示。 v （2）DRAM型存储器接口设计方法型存储器接口设计方法 v 微处理器与这类型存储器芯片接口的信号线，除了有与微处理器与这类型存储器芯片接口的信号线，除了有与 SROM型存储器芯片相同的信号线外，还有型存储器芯片相同的信号线外，还有RAS（行地（行地 址选择）信号线和址选择）信号线和CAS（列地址选择）信号线。（列地址选择）信号线。 v DRAM的地址信号分成行地的地址信号分成行地 址和列地址两部分，因此，址和列地址两部分，因此， 其地址引脚有些是复用的，其地址引脚有些是复用的， 在设计时要注意。在设计时要注意。 v

23、另外，地址分配时还需提供另外，地址分配时还需提供 行地址选通信号（行地址选通信号（RAS）和）和 列地址选通信号（列地址选通信号（CAS），）， 并且还需存储块的地址。并且还需存储块的地址。 v（3）NAND Flash型存储器接口设计方法型存储器接口设计方法 v近年来，由于近年来，由于NAND Flash存储信息的非易失存储信息的非易失 性且其数据存储密度大、价格适中，因此，在许性且其数据存储密度大、价格适中，因此，在许 多嵌入式系统中均设计有多嵌入式系统中均设计有NAND Flash存储器，存储器， 作为系统辅助存储器，可用来存储系统的应用程作为系统辅助存储器，可用来存储系统的应用程 序文

24、件。序文件。 v不同厂家生产的不同厂家生产的NAND Flash类型的存储器芯类型的存储器芯 片，其接口没有统一的标准。片，其接口没有统一的标准。 vNAND Flash存储器芯片的引脚分为三类：数存储器芯片的引脚分为三类：数 据引脚、控制引脚和状态引脚。其中数据引脚高据引脚、控制引脚和状态引脚。其中数据引脚高 度复用，既用作地址总线，又用作数据总线和命度复用，既用作地址总线，又用作数据总线和命 令输入信号线。令输入信号线。 v一个典型的支持一个典型的支持NAND Flash芯片连接的接口芯片连接的接口 内部结构如下图所示。内部结构如下图所示。 v 引脚说明：引脚说明： v I/O0I/O7：

25、8个个I/O数据引脚，用来地址、数据和数据引脚，用来地址、数据和 命令传输。命令传输。 v CLE和和ALE：分别是命令锁存使能引脚和地址锁存使能引：分别是命令锁存使能引脚和地址锁存使能引 脚，用来选择脚，用来选择I/O端口输入的信号是命令还是地址。端口输入的信号是命令还是地址。 v nCE：片选信号。：片选信号。 v nRE：读使能信号。：读使能信号。 v nWE：写使能信号。：写使能信号。 v R/nB：表示设备的状态，当数据写入、编程和随机读取：表示设备的状态，当数据写入、编程和随机读取 时，时，R/nB处于高电平，表明芯片正忙，否则输出低电平。处于高电平，表明芯片正忙，否则输出低电平。 S3C2440存储系统 vS3C2440芯片内部没有集成主存储区，因此，芯片内部没有集成主存储区，因此， 若以若以S3C2440芯片为核心来开发嵌入式系统时，芯片为核心来开