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1、4位全加器的设计实验报告班级:通信12-2班学号:12090216 姓名:韦建萍一、实验目的熟悉利用Quartus II的原理图输入方法设计简单组合电路,掌握层次化设计的方法,并通过一个4位全加器的设计,掌握利用EDA软件进行原理图输入方式的电子线路设计的详细流程。二、实验原理一个4位全加器可以由4个一位全加器构成, 加法器间的进位可以串行方式实现,即将低位加法器的进位输出 cout与相邻的高位加法器的最低进位输入信号cin相接。加法器举例说明:设 M = 1101,N = 1110,CIN=0,则M; 1101+N: 11101、2、半加器(设其名为 h_adder )的电路:h adder
2、u1h adderCOticoutCObirTsososum)1ii2、实验内容和步骤1、完成半加器和全加器的设计,包括原理图输入、编译、综合、适配、仿真;半加器电路原理设计图如图:半加器电路仿真图如图:Bl h.UaM| 咅 LMMnFiri 普| V)b.btaiT全加器电路原理设计图如图:lOd*1全加器电路仿真图如图:2、建立一个更高层次的原理图设计,利用以上获得的1位全加器构成4位全加器,并完成编译、综合、适配、仿真。4位全加器电路原理图如图:4位全加器仿真图如图:四、仿真分析及心得体会仿真分析:四位全加器 SO为和位,CO为进位,当a0=1, b0=1时,S0=0, C0=1,就是和位为零,进位进1。以此类推,当 a仁1,b仁0, C0=1时,和位 S0=0,进位C0=1。实验体会:通过这次实验让我学会了如何掌握利用EDA软件进行原理图输入方式的电子线路设计的详细流程,利用Qu
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