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文档简介

第五章时序逻辑电路

5.4序列信号发生器主讲人：黄丽亚5.4

序列信号发生器

序列信号：周期性重复出现的一串数码，也称为序列码。例：1011010110……循环长度：一个周期内数码的个数称为序列长度。序列信号发生器：产生序列信号的电路。结构类型：移存型序列信号发生器计数型序列信号发生器图5.4.1反馈移存型序列信号发生器的结构图组合逻辑QnQn-1Q1…FFnFFn-1FF1…CPf…移存型序列信号发生器任意一个Q引出就可以作为序列信号输出端。移存型序列码发生器的设计

设计方法类似移存型计数器的设计。模长为序列码的循环长度，状态编码符合序列码的变化规律。例：设计产生序列码101000,101000，……的反馈移存型序列码发生器。解：（1）M=6，至少需要3个触发器来实现。（2）列状态转移表：

模数状态转移路线Q1Q2Q3010100000001010101M=4×解：需增加一个触发器,取n=4，列状态转移表0101100010Q3100010100001000011模数状态转移路线Q1Q2Q4M=6√例：设计产生序列码101000,101000，……的反馈移存型序列码发生器。0101100010Q3100010100001000011模数状态转移路线Q1Q2Q4M=6√③求激励函数Q4Q3Q2Q1

0ØØ110ØØØØ11ØØ00011Ø0Ø0010110100D1D1=Q3Q2Q1+Q4Q2=Q3Q2Q1Q4Q2(3)作逻辑图图5.4.4例5.4.1的逻辑图D1=Q3Q2Q1+Q4Q2=Q3Q2Q1Q4Q2f1fm组合逻辑模M计数器…QnQn-1Q1…图5.4.2计数型序列码发生器的结构图计数型序列码发生器计数型序列码发生器的设计设计步骤：先设计模值为序列长度的计数器再设计组合电路实现序列信号。其输入为计数器各触发器的输出Qi，输出为序列信号F。例：设计产生序列码F=11110101,11110101……的计数型序列码发生器解：方法一：用小规模器件实现Q1JC1<

Q1KQ1JC1<

Q1KQ1JC1<

Q1KQ3Q2Q1CP111111（1）设计M=8的计数器。本解采用n=3的异步二进制加法计数器组合逻辑电路F（2）设计组合电路Q3Q2Q1F00000101001110010111011111110101真值表：用卡诺图化简得到：F=

Q3+Q1

方法二、用中规模器件MSI实现,如：74161和74151。例：设计产生序列码F=11110101,11110101……的计数型序列码发生器消除冒险方法：（1）当计数状态发生改变时，只有一个码元发生改变，可以消除功能冒险。即编码采用格雷码，如扭环型计数器产生的编码状

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