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文档简介

§2.4CMOS门电路2.4.1

CMOS门电路的结构和原理2.4.3CMOS门电路的静态特性2.4.5CMOS漏极开路（OD）门2.4.4CMOS门电路的动态特性2.4.6CMOS三态门2.4.7CMOS传输门2.4.2晶体管级CMOS逻辑电路设计1.CMOS反相器漏极相连做输出端柵极相连做输入端2.4.1CMOS门电路的结构和原理

如果将0V定义为逻辑0，VDD定义为逻辑1，将实现逻辑“非”功能。（1）当vI=0V时，vGSN=0V，VTN截止，∣vGSP∣=VDD

，VTP导通，vO≈VDD，门电路输出高电平；（2）当vI=VDD时，VGSN=VDD

，VTN导通，∣VGSP∣=0V，VTP截止，vO≈0V，门电路输出低电平。2.4.1CMOS门电路的结构和原理2.4.1CMOS门电路的结构和原理CMOS反相器的开关模型2.CMOS与非门00通通止止12.4.1CMOS门电路的结构和原理止止100通通3.CMOS或非门2.4.1CMOS门电路的结构和原理5.带缓冲器的门电路2.4.1CMOS门电路的结构和原理

当A=B=1时，输出电阻为VTN1和VTN2的导通电阻串联，其值为2RON。当A=B=0时，输出电阻为VTP1和VTP2的导通电阻并联，其值为RON/2。当A=1、B=0时，输出电阻为VTP2的导通电阻，其值为RON。当A=0、B=1时，输出电阻为VTP1的导通电阻，其值为RON。5.带缓冲器的门电路2.4.1CMOS门电路的结构和原理缓冲器（buffer)是具有一个输入和一个输出的门电路，分正相缓冲器和反相缓冲器

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