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文档简介

第10章

可编程逻辑器件

10.1概述10.2可编程阵列逻辑（PAL）10.3通用阵列逻辑（GAL）

10.4现场可编程门阵列（FPGA）10.5在系统可编程逻辑器件（ISP-PLD）本章小结可编程阵列逻辑（PAL）现场可编程门阵列（FPGA）通用阵列逻辑（GAL）使用方便灵活，可随时对系统逻辑功能进行修改理解通用阵列逻辑的电路结构和现场可编程门阵列的结构特点，了解在系统可编程逻辑器件的结构特点。概述可编程逻辑器件（PLD）集成度高，可通过编程工具和软件支撑开发数字系统。不仅可实现组合逻辑功能，而且还可实现时序逻辑功能。较复杂的数字系统可方便的用PLD实现。用PLD设计方便灵活，便于修改，可重复使用，开发周期短，成本低、功耗低、体积小、系统元件连线少，提高了系统工作的可靠性可编程逻辑器件类型可编程逻辑器件特点本章重点开发周期短,可重复使用系统可靠性高在系统可编程器件（ISP-PLD）PLD器件中连接的习惯画法固定连接可编程连接断开连接PLD中与门和或门的习惯画法(a)(b)YCABCBAACBYYYCBA≥1AC10.1.1PLD中与门、或门和器件连接的习惯画法PLD的基本结构图输入电路与阵列输出电路或阵列输入项乘积项或项输入输出输入电路输入电路10.1.2可编程逻辑器件的基本结构

输入缓冲电路用以产生输入变量的原变量和反变量，并提供足够的驱动能力。

输入缓冲电路

(a)一般画法(b)PLD中的习惯画法(a)(b)AAAAAA由多个多输入与门组成，用以产生输入变量的各乘积项。例如

CABCCABBAW7=ABCABCW0=与阵列PLD的基本结构图输入电路与阵列输出电路或阵列输入项乘积项或项输入输出10.1.2可编程逻辑器件的基本结构由多个多输入与门组成，用以产生输入变量的各个乘积项。PLD的基本结构图输入电路与阵列输出电路或阵列输入项乘积项或项输入输出CABCCABBAW7=ABCABCW0=●●●●●●BCABC与阵列的

PLD

习惯画法10.1.2可编程逻辑器件的基本结构由图可得

Y1=ABC+ABC+ABCY2=ABC+ABCY3=ABC+ABC例如

ABC●●●Y3Y2Y1●●●●●●●●●●●●●与阵列或阵列PLD的基本结构图输入电路与阵列输出电路或阵列输入项乘积项或项输入输出由多个多输入或门组成，用以产生或项，即将输入的某些乘积项相加。10.1.2可编程逻辑器件的基本结构

由PLD结构可知，从输出端可得到输入变量的乘积项之和，因此可实现任何组合逻辑函数。再配以触发器，就可实现时序逻辑函数。PLD的基本结构图输入电路与阵列输出电路或阵列输入项

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