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文档简介

阶段6、计数译码显示电路

实验目的实验电路与工作原理

实验内容和要求

注意事项掌握40161的逻辑功能及使用方法掌握译码显示电路的构成及使用方40161的逻辑功能及使用方法译码显示电路的构成4位二进制同步加计数器表CD40161功能表

CD40161的逻辑功能清零使能数据输入置数进位置数ET=CTT&ETPCO=Q3Q2Q1Q0ETCP操作状态0xxx清除10x预置110保持111计数CD40161的时序波形图构成任意进制计数器的方法利用同步预置清零利用异步清零优点：清零可靠输出没有毛刺构成多位计数器的级联方法串行进位（异步）优点：简单；缺点：速度较慢六十进制计数器构成多位计数器的级联方法六十进制计数器并行进位（同步）优点：速度较快；缺点：较复杂CD4511七段显示译码器TopViewDisplay灯测试灭灯锁存与74LS48管脚基本兼容A3A0A1A2真值表灯测试灭灯译码输出保持锁存共阴七段显示器译码张显示绘电路公共狗限流稍电阻简易嚷数字予钟的差设计一、呆数字床钟的葬功能鞠要求①准滥确计油时，需以数祥字形吸式显徐示时废、分纯的时雷间：②小秤时的其计时汪要求清为“12翻1’’，分细钟的膏计时铸为60进位燥；③校匙正时葱间。二、流数字侧钟电浑路系巨统的候组成学框图1、时乏、分云计数提器的璃设计分计帜数器符是模蛾为60的计郑数器挣，其宗计数独规律窃为00劳-0归1…-5桂8-千59坐-0物0…，选CD丹40联16脾1作六瞎、十考进制搭计数培器，腾再将劫它们拳级联贯组成升模数拜为60的计挪数器但。并行虾进位悦（同窗步）时计册数器拖有12和24进制咏两种关方式疫，可调任选挑一个锦。1、当驻数字激钟运瓜行到12时59分59秒时长，分棒的个魔位计隙数器斗再输境入一浓个时笑钟脉绝冲时示，数愤字钟著应自狠动显究示为01时00分00秒。2、当暂数字颤钟运役行到23时59分59秒时写，分轧的个尾位计巧数器邻再输猛入一缴个时土钟脉偿冲时管，数不字钟辟应自秧动显萌示为00时00分00秒2、时侧计数座器对校逮时电毅路的狱要求纪是，隆在小父时校炎正时断不影询响分居的正夕常计驰数；雪在分刻校正机时不塌影响偿小时架的正突常计遥数。3、校朝时电吊路的炸设计校时奴是数沿字钟星应具直备的询基本逼功能更。注意凉事项1．电很源（VDD=＋蜂5V屠、VSS=地）核对贞无误葛，再摘接入曾！2．输美出端狐切忌每短路柔、线拼与！3．多塘余输历入端——不能掠悬空4．电路诞图一苍定要搏标上贸芯片武引脚总号!5．芯进片管蒙脚图CD隙40恼16多1神MC取14枪16帮1MC

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