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文档简介
第一章测试运算器的主要功能是执行()。
A:算术运算
B:加减乘除运算
C:逻辑运算
D:算术运算和逻辑运算
答案:D冯·诺依曼结构计算机中数据采用二进制编码表示,其主要原因是()。
A:便于用逻辑门电路实现算术运算
B:制造两个稳态的物理器件较容易
C:二进制的运算规则简单
答案:ABC下列软件中,不属于系统软件的是()。
A:编译软件
B:操作系统
C:C语言源程序
D:数据库管理系统
答案:CMIPS描述()。
A:计算机的可靠性
B:计算机的可扩充性
C:计算机的整数运算速度
D:计算机的可运行性
答案:C下列选项中,能缩短程序执行时间的是()。Ⅰ提高CPU的时钟频率Ⅱ优化数据通路结构Ⅲ对程序进行编译优化
A:仅Ⅱ和Ⅲ
B:Ⅰ、Ⅱ和Ⅲ
C:仅Ⅰ和ⅡⅢ
D:仅Ⅰ和Ⅲ
答案:B第二章测试88H可表示成多种形式,以下选项中错误的表示是()。
A:压缩型BCD码数88
B:无符号十进制数136
C:带符号十进制数-120
D:8位二进制数-8的补码
答案:D某计算机以两个字节存储短整数,若某短整数在内存中的机器码为FFFFH,则此短整数的真值不可能是()。
A:-1
B:1
C:0
D:-7FFFH
答案:B十进制-61的8位二进制原码是()。
A:00101111
B:10101111
C:10111101
D:00111101
答案:C当运算结果的最高位为1时,标志位()。
A:OF=1
B:SF=1
C:ZF=1
D:CF=1
答案:B若x=103,y=-25,则下列表达式采用8位定点补码运算实现时,会发生溢出的是()。
A:-x+y
B:x+y
C:-x-y
D:x-y
答案:D整数x的机器数为11011000,分别对x进行逻辑右移1位和算术右移1位操作,得到的机器数分别为()。
A:11101100、11101100
B:11101100、01101100
C:01101100、01101100
D:01101100、11101100
答案:D下列有关浮点数加减运算的叙述中,正确的是()。①对阶操作不会引起阶码上溢或下溢②右规和尾数舍入都可能引起阶码上溢③左规时可能引起阶码下溢④尾数溢出时结果不一定溢出
A:仅①、③、④
B:①、②、③、④
C:仅②③
D:仅①、②、④
答案:B浮点数进行左规时,()。
A:尾数左移1位,阶码加+1
B:阶码左移1位,尾数加-1
C:尾数左移1位,阶码加-1
D:阶码左移1位,尾数加+1
答案:C某机字长32位,其中1位表示符号位。若用定点小数移码表示,则最大数为()。
A:(2^31-1)/2^31
B:(2^31+1)/2^31
C:(2^30-1)/2^30
D:1
答案:Afloat型数据通常用IEEE754单精度浮点数格式表示。如编译器将float型变量x分配在一个32位浮点寄存器FR1中,且x=+8.25,则FR1的内容()。
A:41040000H
B:C1840000H
C:C2420000H
D:C1C1C20000H
答案:A下列压缩BCD码,不合法的是()。
A:00000100B
B:01111001B
C:11010110B
D:10000101B
答案:C通用计算机内部关于运算的特点有()。
A:机器内部不表示小数点,所以定点有符号小数和整数的乘除法运算过程完全相同
B:运算不仅有值结果,还有标记结果
C:加减运算器既能完成无符号数运算,也能完成有符号数运算
D:乘积用双倍字长表示
答案:BCD下列有关浮点数加减运算的叙述中,正确的是()。
A:左规时可能引起阶码下溢
B:对阶操作可能引起阶码溢出
C:尾数溢出时结果可能溢出
D:右规和尾数舍入均可能引起阶码上溢
答案:ACD定点小数表示中,移码不能表示-1()
A:对
B:错
答案:B某计算机以1个字节存储数据,若机器码为80H,则对应真值不可能是80。()
A:错
B:对
答案:A浮点数的表示范围主要取决于的阶码位数,精度取决于尾数的位数。()
A:对
B:错
答案:A在串行定点小数除法器中,为避免产生溢出,被除数的绝对值一定要小于除数的绝对值。()
A:错
B:对
答案:B在定点补码加减运算中,被加数的符号和加数的符号都参加运算。()
A:对
B:错
答案:A显示分辨率指的是()。
A:显示器所能分辨的颜色个数
B:显示器所能显示的列数
C:显示器所能显示的行数
D:显示器所能显示的像素个数
答案:D图像分辨率指的是()。
A:图像所包含的像素个数
B:图像所包含的明暗程度
C:图像所包含的颜色数
D:单位英寸中所包含的像素个数
答案:D像素指的是()。
A:数字图像的一小块
B:数字图像的一个小部分区域
C:数字图像的表示方法
D:表示数字图像的最小单位
答案:D数码图片的宽高比通常是()。
A:3:4
B:1:1
C:0.084027778
D:4:3
答案:D第三章测试EPROM是指。()
A:只读存储器
B:电可改写只读存储器
C:可编程的只读存储器
D:可擦除可编程只读存储器
答案:D下列关于闪存(FlashMemory)的叙述中,错误的是。()
A:掉电后信息不丢失,是一种非易失性存储器
B:存储元由MOS管组成,是一种半导体存储器
C:采用随机访问方式,可替代计算机中的外部存储器
D:信息可读可写,并且读、写速度一样快
答案:D存储字长是指。()
A:存储单元的个数
B:存放在一个存储单元中的二进制代码组合
C:机器指令的位数
D:存放在一个存储单元中的二进制代码位数
答案:D计算机的存储器采用分级方式是为了。()
A:操作方便
B:解决容量、价格、速度三者之间的矛盾
C:保存大量数据方便
D:减少主机箱的体积
答案:B在Cache和主存构成的两级存储体系中,Cache的存取时间是100ns,主存的存取时间是1000ns,如果希望有效(平均)存取时间不超过Cache存取时间的115%,则Cache的命中率至少应为()。
A:98%
B:99%
C:90%
D:95%
答案:B关于静态存储器、动态存储器,下列叙述中正确的是()。
A:通常静态存储器依靠电容上暂存电荷来存储信息,电容上有电荷为1,无电荷为0
B:静态存储器速度较快,但集成度稍低,动态存储器速度稍慢,但集成度高
C:静态存储器速度较慢,但集成度稍高,动态存储器速度稍快,但集成度低
D:动态存储器依靠双稳态电路的两个稳定状态来分别存储0和1
答案:B动态存储器DRAM的刷新原则是。()
A:各DRAM芯片同时刷新,片内逐行刷新
B:各DRAM芯片同时刷新,片内逐字刷
C:各DRAM芯片轮流刷新
D:各DRAM芯片同时刷新,片内逐位刷新
答案:A某计算机字长32位,存储器容量4MB,若按字编址,它的寻址范围是。()
A:1MB
B:1M
C:4M
D:4MB
答案:B假定用若干个2K×4位芯片组成一个8K×8位存储器,则地址0B1FH所在芯片的最小地址是()。
A:0700H
B:0600H
C:0000H
D:0800H
答案:D一个16K×32位的静态RAM存储器,其地址线和数据线的总和是。()
A:39
B:36
C:48
D:46
答案:D组成2M×8位的内存,可以使用()。
A:2M×4位芯片进行字扩展
B:1M×4位芯片进行字扩展
C:2M×4位芯片进行位扩展
D:1M×8为芯片进行位扩展
答案:C一个四体并行交叉存储器,每个模块的容量是32K×16位,存取周期为200ns。在200ns内,存储器能向CPU提供()二进制信息。()
A:32位
B:64位
C:256位
D:128位
答案:B某32位计算机的cache容量为16KB,cache块的大小为16B,若主存与cache的地址映射采用直接映射方式,则主存地址为1234E8F8H的单元装入的cache地址为。()
A:10100011111000B
B:01001000110100B
C:11010011101000B
D:00010001001101B
答案:A有效容量为128KB的Cache,每块16字节,采用8路组相联。字节地址为1234567H的单元调入该Cache,则其Tag应为()
A:12345H
B:048DH
C:2468H
D:1234H
答案:B随机存储器(RAM)是在存储器中任何存储单元的内容都能随机存取,且存取时间与存储单元的物理位置无关()
A:对
B:错
答案:ACPU访问存储器的时间是由存储器的容量决定的,存储器容量越大,访问存储器所需的时间越长。()
A:对
B:错
答案:BCache的地址映射中,直接映射的地址变换速度快,硬件容易实现,但命中率略低。()
A:对
B:错
答案:A双端口存储器之所以能进行高速读/写操作是因为了采用流水技术。()
A:错
B:对
答案:A某机器字长32位,一个组相联映射的Cache共有64行,每组4行;主存共有8192块,每块32字。按字节编址,则主存地址共20位,Cache组地址为4位。()
A:错
B:对
答案:B第四章测试在一地址指令格式中,下面论述正确的是()
A:可能有一个操作数,也可能有两个操作数
B:仅能有一个操作数,它由地址码提供
C:一定有两个操作数,另一个是隐含的
D:如果有两个操作数,另一个操作数是本身
答案:A某寄存器采用16位单字长指令,采用定长操作码,地址码为5位,现定义60条二地址指令,则最多定义单地址指令条数为()。
A:32
B:128
C:256
D:4
答案:D假设指令字长为16位,操作数的地址码为6位,指令有零地址、一地址、二地址三种格式。采用扩展操作码技术,若二地址指令8种,零地址指令有64种,则一地址指令最多有()种。()
A:255
B:342
C:511
D:512
答案:C所谓寻址方式是指确定本条指令的数据地址以及下一条将要执行的指令地址的方法,一般分为()。()
A:直接寻址和间接寻址
B:数据寻址和间接寻址
C:指令寻址和间接寻址
D:指令寻址和数据寻址
答案:D指令系统中采用不同寻址方式的目的主要是()
A:提供扩展操作码的可能并降低指令译码难度
B:可以直接访问外存
C:实现存储程序和程序控制
D:缩短指令长度,扩大寻址空间,提高编程灵活性
答案:D用于对某个寄存器中操作数进行寻址的方式称为()
A:直接寻址
B:寄存器间接寻址
C:间接寻址
D:寄存器直接寻址
答案:D直接、间接、立即3种寻址方式中指令的执行速度,由快到慢的排序是()
A:立即、间接、直接
B:立即、直接、间接
C:直接、立即、间接
D:直接、间接、立即
答案:B某机器字长16位,主存按字节编址,转移指令采用相对寻址,由两个字节组成,第一字节为操作码字段,第二字节为相对位移量字段。假定取指令时,每取一个字节PC自动加1。若某转移指令所在主存地址为2000H,相对位移量字段的内容为06H,则该转移指令成功转以后的目标地址是()
A:2006H
B:2009H
C:2007H
D:2008H
答案:D下列关于CISC/RISC的叙述中,错误的是()
A:CISC比RISC的机器能更好的支持高级语言。
B:RISC机器指令比CISC机器指令简单
C:RISC的寻址方式比CISC少
D:RISC中通用寄存器比CISC多
答案:ACISC是()的简称
A:复杂指令计算机
B:大规模集成电路
C:超大规模集成电路
D:精简指令系统计算机
答案:A便于实现数组处理()
A:相对寻址
B:间接寻址
C:变址寻址
D:基址寻址
答案:C在设计指令格式时应该考虑的因素包括()。()
A:数据总线宽度
B:指令格式
C:数据类型
D:寻址方式
答案:BCD以下寻址方式中,属于数据寻址的是()。()
A:顺序寻址
B:立即寻址
C:直接寻址
D:指令寻址
答案:BC机器中常见的操作数类型有()。()
A:地址
B:逻辑数据
C:数字
D:字符
答案:ABCD指令系统是表征一台计算机性能的重要因素,它的格式和功能不仅直接影响到机器的硬件结构而且也影响到系统软件。()
A:对
B:错
答案:A形成指令地址的方法,称为指令寻址,指令寻址有顺序寻址和跳跃寻址两种。()
A:错
B:对
答案:B第五章测试在CPU中,跟踪后继指令地址的寄存器是()。
A:状态条件寄存器
B:地址寄存器
C:指令寄存器
D:程序计数器
答案:D下列不是CPU控制器部件的选项是()。
A:指令译码器
B:指令寄存器
C:移位寄存器
D:程序计数器
答案:C硬布线控制器指的是()。
A:组合逻辑控制器
B:微程序控制器
C:可编程逻辑部件控制器
D:一种新型控制器
答案:A指令周期是指()。
A:CPU执行一条指令的时间
B:时钟周期时间
C:CPU从主存取出一条指令的时间。
D:CPU从主存取出一条指令和执行这条指令的时间
答案:D在CPU处理的程序中,构成控制序列的最小单位是()。
A:微程序
B:微操作
C:微指令
D:机器指令
答案:B微程序控制器中,机器指令与微指令的关系是()。
A:一段机器指令组成的程序可由一条微指令来执行
B:每一条机器指令由一段用微指令编成的微程序来解释执行
C:一条微指令由若干条机器指令组成
D:每一条机器指令由一条微指令执行
答案:B水平微指令与垂直微指令相比()。
A:两者都是一次只能完成一个操作
B:两者都能一次完成多次操作
C:前者一次只能完成一个操作
D:后者一次只能完成一个操作
答案:D在CPU控制器的设计中,以硬连线方式构成的控制器称为()。
A:运算器
B:微程序控制器
C:组合逻辑控制器
D:程序控制器
答案:C微指令中,不是操作控制字段的编码方式的是()。
A:混合表示法
B:程序控制器
C:编码表示
D:直接表示法
答案:B流水CPU中的主要相关不包括()相关。
A:资源
B:控制
C:数据
D:程序
答案:DCPU中,存放下一条指令地址的寄存器是()。
A:DR
B:IR
C:AR
D:PC
答案:D状态寄存器中的各个状态标志位是依据()来设置标志位。
A:CPU已经执行的指令
B:累加器中的数据
C:ALU上一次的运算结果
D:CPU将要执行的指令
答案:CCPU内通用寄存器的位数取决于()。
A:机器字长
B:CPU的引脚数
C:存储器容量
D:指令长度
答案:A微程序存放在()中。
A:外存
B:指令寄存器
C:内存
D:控制存储器
答案:D垂直型微指令的特点是()。
A:控制信号经过编码产生
B:采用微操作码
C:微指令格式垂直表示
D:采用微指令码
答案:B在流水线的技术指标不包括()。
A:效率
B:加速比
C:响应比
D:吞吐率
答案:C下列叙述中正确的是()。
A:微程序控制器比硬连线控制器更加灵活
B:微处理器的程序称为微程序
C:指令就是微指令
D:控制器产生的所有控制信号称为微指令
答案:A流水线运行时,若各阶段的执行时间不相等,每个阶段的执行时间应取()。
A:各阶段执行时间平均值
B:各阶段执行时间之和
C:各阶段执行时间最大值
D:各阶段执行时间最小值
答案:C下列关于冯·诺依曼结构计算机基本思想的叙述中,错误的是()。
A:指令和数据都用二进制表示,形式上无差别
B:程序执行前,指令和数据需预先存放在存储器中
C:指令按地址访问,数据都在指令中直接给出
D:程序的功能都通过中央处理器执行指令实现
答案:C微指令操作控制字段的每一位代表个控制信号,这种微程序的控制方式叫做()。
A:直接编码
B:字段间接编码
C:混合编码
D:字段直接编码
答案:A第六章测试接口是连接()间电路的总称。
A:CPU与外设
B:CPU与存储器
C:外设与存储器
D:CPU与打印机
答案:A系统总线中地址线的功能是()。
A:用于指定主存和I/O设备接口电路的地址
B:用于选择主存单元地址
C:用于选择进行信息传输的设备
D:用于选择外存地址
答案:A在串行异步数据传送时,如果格式规定8位数据位,1位奇偶校验位,1位停止位,则1帧异步数据总共有()位。
A:10
B:9
C:11
D:8
答案:C从信息流的传送效率来看,工作效率最低的是()。
A:多总线系统
B:三总线系统
C:单总线系统
D:双总线系统
答案:C集中式总线控制方式中,对电路故障最敏感的方式是()。
A:链式查询
B:独立请求
C:计数器定时查询
D:分布式控制方式
答案:A在计数器定时查询方式下,若计数从0开始,则()。
A:设备号大的优先权高
B:每个设备使用总线的机会相等
C:CPU分配总线
D:设备号小的优先权高
答案:D同步通信比异步通信具有较高的传输频率,是因为()。
A:总线长度较短
B:不需要应答信号
C:各部件存取时间比较接近
D:用一个公共时钟信号进行同步
答案:D总线中地址线的作用是()。
A:由设备向主机提供地址;
B:只用于选择存储器单元;
C:只用于选择I/O设备
D:用于选择指定存储器单元和I/O设备接口电路的地址。
答案:D在系统总线中,与地址总线的位数有关的是()。
A:存储字长
B:存储器带宽
C:机器字长
D:存储单元个数
答案:DCPU内通用寄存器的位数取决于()。
A:机器字长
B:指令长度
C:存储器容量
D:CPU的引脚数
答案:A第七章测试外围设备指的是()。
A:除主机外的设备
B:硬盘
C:A/D转换器
D:磁带
答案:A显示分辨率指的是()。
A:显示器所能分辨的颜色个数
B:显示器所能显示的列数
C:显示器所能显示的行数
D:显示器所能显示的像素个数
答案:D图像分辨率指的是()。
A:图像所包含的像素个数
B:图像所包含的明暗程度
C:单位英寸中所包含的像素个数
D:图像所包含的颜色数
答案:C像素指的是()。
A:表示数字图像的最小单位
B:数字图像的一个小部分区域
C:数字图像的一小块
D:数字图像的表示方法
答案:A数码图片的宽高比通常是()。
A:1:1
B:0.084027778
C:3:4
D:4:3
答案:D第八章测试接口是()。
A:包括控制器和运算器
B:计算机主机与外部设备之间的桥梁
C:直接存取程序和数据
D:有半导体器件构成
答案:B并行接口是指()
A:仅接口与系统总线之间采取并行传送
B:仅接口与外围设备之间采取并行传送
C:接口的两侧均采取并行传送
D:接口内部只能并行传送
答案:CI/O接口中数据缓冲器的作用是()
A:用来暂存外设的状态
B:用来暂存CPU发出的命令
C:用来暂存外设和CPU之间传送的数据
答案:C在()方式下,主机和外设不能同时工作()
A:程序查询
B:DMA
C:通道
D:中断
答案:A在程序查询方式的输入输出系统中,假设不考虑处理时间,每一次查询操作需要100个时钟周期,CPU的时钟频率为50MHz。CPU必须每秒对鼠标进行60次查询,则CPU对鼠标查询所花时间占用CPU时间的比率为()
A:0.012%
B:0.024%
C:0.006%
D:0.01%
答案:A下列事件中,属于外部中断事件的是()
A:仅II、IIID.I、II和III
B:仅I、IIB.仅I、III
C:访存时缺页II.定时器到时III.网络数据包到达
答案:A外部中断包括不可屏蔽中断(NMI)和可屏蔽中断。下列关于外部中断的叙述中,错误的是()
A:CPU处于关中断状态时,也能响应NMI请求
B:不可屏蔽中断的优先级比可屏蔽中断的优先级高
C:一旦可屏蔽中断请求信号有效,CPU将立即响应
D:可通过中断屏蔽字改变可屏蔽中断的处理优先级
答案:C中断允许触发器是用来()
A:CPU是否正在进行中断处理
B:CPU是否响应了中断
C:表示外设是否提出了中断请求
D:开放和关闭可屏蔽硬中断
答案:D下列关于外部I/O中断的叙述中,正确的是()
A:CPU只有在处于中断允许状态时,才能响应外部设备的中断请求
B:中断控制器按所接收中断请求的先后次序进行中断优先级排队
C:C
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