EDA课程设计八路彩灯控制器

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EDA课程设计

设计题目：基于VHDL的8路彩灯控制器设计

一、课程设计的目的

1．熟悉QuartusⅡ软件的使用方法,使用VHDL文本输入设计法进行任务设计。2．加强自己实际动手能力,独立解决问题的能力。3．通过课程设计对所学的知识进行更新及稳定.

二、课程设计的基本要求

本次课程设计是设计一个8路彩灯控制器，能够控制8路彩灯依照两种节拍，三种花型循环变化。设计完成后，通过仿真验证与设计要求进行对比，检验设计是否正确。

三、课程设计的内容

编写硬件描述语言VHDL程序，设计一个两种节拍、三种花型循环变化的8路彩灯控制器，两种节拍分别为0.25s和0.5s。三种花型分别是：

（1）8路彩灯分成两半，从左至右顺次渐渐点亮，全亮后则全灭。（2）从中间到两边对称地渐渐点亮，全亮后仍由中间向两边逐次熄灭。（3）8路彩灯从左至右按次序依次点亮，全亮后逆次序依次熄灭。

四、试验环境

PC机一台；软件QuartusⅡ6.0

五、课程设计具体步骤及仿真结果1、系统总体设计框架结构

分频模块：把时钟脉冲二分频，得到另一个时钟脉冲，让这两种时钟脉冲来交替控制花型的速度。

二选一模块：选择两种频率中的一个控制彩灯的花型。

8路彩灯的三种花型控制模块：整个系统的枢纽，显示彩灯亮的状况。

2、系统硬件单元电路设计

1.分频模块设计试验程序：libraryieee;useieee.std_logic_1164.all;entityfenpin2isport(clk:instd_logic;clkk:outstd_logic);endfenpin2;

architecturebehavoffenpin2isbegin

process(clk)

variableclkk1:std_logic:='0';begin

ifclk'eventandclk='1'thenclkk1:=notclkk1;endif;

clkknull;endcase;endif;

endprocess;end;

RTL电路图：

波形图：

4.综合程序libraryieee;

useieee.std_logic_1164.all;

entityfenpin2isport(clk:instd_logic;clkk:outstd_logic);endfenpin2;

architecturebehavoffenpin2isbegin

process(clk)

variableclkk1:std_logic:='0';begin

ifclk'eventandclk='1'thenendif;

clkknull;endcase;endif;

endprocess;end;libraryieee;

useieee.std_logic_1164.all;useieee.std_logic_unsigned.all;entitybalucaidengisport(clk,s,rst:instd_logic;

q:outstd_logic_vector(7downto0));end;

architectureoneofbalucaidengis

signalh0,h1:std_logic;componentfenpin2port(clk:instd_logic;clkk:outstd_logic);endcomponent;componentmux21port(a,b,s:instd_logic;y:outstd_logic);endcomponent;componentcolor8port(clk,rst:instd_logic;

q:outstd_logic_vector(7downto0));endcomponent;begin

u1:fenpin2portmap(clk=>clk，clkk=>h0);u2:mux21portmap(a=