数电复习笔记

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1.2.3.4.

第四章组合辑电路进行逻辑抽象，确定输入输出变量列出真值表写出逻辑表达式，化简画出逻辑电路图编码器将输入的每一个高低平信号编成一个对应的二进制代码普通编器（只允许输入一个编码信息）真值表输

入

输出I010000000

I101000000

I200100000

I300010000

I400001000

I500000100

I600000010

I700000001

Y200001111

Y100110011

Y001010101逻辑式II245

7III13

7I05电路图

优先编器（允许输入两个以上的编码信号，只对优先权最高的一个进行编码）8线-3线优先编码器74HC148真值表输

入

输出I

'0

'1

'2

'3

'4

'5

'6

'7

2

'

1

'

0

'

Y

S

'

Y

'EX1000000000

X1XXXXXXX0

X1XXXXXX01

X1XXXXX011

X1XXXX0111

X1XXX01111

X1XX011111

X1X0111111

X101111111

1100001111

1100110011

1101010101

1011111111

1100000000逻辑式Y

'III'27654Y1

7

I6

I''I'I'543245YYY

''I'II'I'07653461246''I'''S76543210''''I'''EX765432107

I6

I5

I4

I3

I2

I1

I'0电路图

EXEXEXEXS’为选通输入端，S’=0,编码正常工作Ys’=0,路工作，但无编码输入Y路工作，有编码输入（输入输出均以低电平作为有效信号）用两片74LS148接成线4线优先编码器（优先权通过选通输入端控制，若选1片为高优先权，则1片“无编码信号输入”Ys’为2片的选通输入信号S’，Y’为第四位输出编码）

电路图电路图译码器将每个输入的二进制代码译成对应的高低电平信号或另一个代码-线译码器真值表输

入

输

出S1

S

'2

'3

A2A1A0

Y

7

'

Y

6

'

Y

5

'

Y

4

'

Y

3

'

Y

2

'

Y

1

'

Y

0

'X

X

XX

XX

XX

表达式'

''Am201...

A'0

)'mAAA'20

用两片74HC138接成线-16线译码器在芯片级联时，低位地址复用（指仍是单个芯片时的功效），高位地址片选（指由这个地址确定哪一个芯片工作）二—进制译码器显示译码器：七段字符显示器P187例题数据选择双四选一据选择器74HC153真值表S1’A1

A0

Y110000

X0011

X0101

0D10D11D12D13表达式•[D('A')('A)DAA')D(AA)]10111112131

电路图用两个“四选一”据选择器接成“选一”数据选择器利用S’作为第三个地址输入端，片选AAA0

)A''1

)A2

A

)A'

A)3A'')DAA'A)AA04210510P190例题

)A)107

加法器半器真值表输入

输

出ABSCO0000011010101101表达式BCOAB逻辑图及符号全器真值表输入

输出ABCISCO0000000110010100110110010101011100111111

表达式S'CIA''COAB''CI'CI'逻辑图及符号串行进位加法器超前进位加法器P197题数值比较一位数值比较器(ABA'Y()

AB

'(A则()

A(A0或Y()

)

'

多位数值比较器四位数值较器(A)

'BB)'AB)A'33223211B)(AA)A'332110(A)

B)'()(AB)33210

(A)

(A)

(A)

)

用两片74LS85组成一个位数值比较器将两个数的高四位接到2片上，低四位接到1片上，同时将1片的Y

(A)

()

(A

接到2片的

I

II(A((A)

上竞争冒险现象竞争：门电路两个输入信号同时向相反的逻辑电平跳变的现象竞争-险：由于竞争而在电路输出端可能产生的尖峰脉冲的现象冒险的两种形式：A+A’A•A’

第五章发器或非门SR锁存器S=1，R=0，Q=1S=0，R=1，Q=0S=0，R=0，保持前一状态S=1，R=1，(Q=0)与非门SR锁存器S’=0，’=1Q=1S’=1，’=0Q=0S’=1，’=1保持前一状态S’=0，’=0(Q=1)

电平触SR触发CLK=0时，输出状态保持CLK=1时的状态不变CLK=1时，变成SR锁存器，Q由S,R决定带异步位，复位端电平触SR触发器SDQ=1(置RD’=0Q=0(置0)电平触D触发器（型锁存）（S=D,R=D’）CLK=0时，输出状态保持CLK=1时的状态不变CLK=1时，变成SR锁存器，S=D,R=D’,Q=D

主从SR触发器CLK=1，触发器正常工作，主触发器变成SR锁器得到Qm主触发器不工作，Qm保持CLK=1的状态从触发器的QQ从1变（）处变化，变成对应时刻的，Qm’的值在一个CLK的化周期里Q状态只改变一次主从JK触器CLK=1时，，K=0置1置0保持前一状态不变，K=1时Qm翻转CLK=0时，Qm的输出状态保持CLK=1时的状态从触发器QQ处变化，变成对应时刻Qm,Qm在一个CLK的化周期里Q状态只改变一次

多输入JK触发器J=J1J2K=K1K2边沿触器（上升沿触发）CLK=0时，保持原来的状态不变CLK由0变到1Q=D,Q仅取决于处D的值带异步位，复位端边沿触器S=1Q=1(置1)R=1，Q=0(0)

特征方程触发器按逻辑功能的分类状态转换图SR触发器Q*=S+R’Q,JK触发器Q*=JQ’+K’QT触发器（T=1翻转T=0保持）’Q

D触发器Q*=D附：逻辑符号中增加SD,RD输入端是指带异步置位，复位端功能S=1，Q=1置1)R=1，Q=0(0)

第六章序逻电同步时序电路：存储电路中所有触发器的时钟使用统一的clk,状态变化发生在同一时刻异步时序电路：没有统一的clk,触发器状态的变化有先有后Mealy（米利型）型：输出不仅取决于存储电路的状态，而且还决定于电路当前的输入Moore（穆尔型）型：输出仅决定于存储电路的状态，与电路当前的输入无关同步时序电路的分析方法逻辑方组：驱动方。状态程。输出方状态转表状态转图时序图波形图）逻辑图例题1.写驱动方程

Q)12

K1KQ23K32

)2.代入JK触发器的特征方程Q*=JQ’+K’Q,得状态方程*QQ)1JQ221213*JQ33.写输出方程3

4.根据逻辑方程组列出状态转化表30

20

10

0

*Q**301

0

或

CLK0

0

3

0

2

0

1

Y00

0

1

0

1

0

0

1

0

0

1

02

0

1

0

00

1

0

0

1

1

0

3

0

1

1

00

1

1

10

0

0

4

1

0

0

01111

0011

0101

1100

0100

1000

0011

56701

11010

01010

10010

010105.画出状态转化图6.画出时序图（波形图）

7.判断能否自启动自启动CLK作用下，无效状态能自动地进入到有效循环中，则称电路能自启动，否则称不能自启动这是一个同步七进制加法计数器，能自启动寄存器，移寄存器计数器同步计数器按计数器中触发器是否同时翻转异步计数器二进制（2^n进制）计数器按计数器容量4位集成二进制加法计数器

十进制计数器N制计数器74LS160：十进制计数器，异步清0同步置数74LS161：十六进制计数器，异步清0同步置数74LS162：十进制计数器，同步清0同步置数74LS163：十六进制计数器，同步清同步置数CLKX

RD0X

XX

工作状态置异步）XX

1111

0111

X0X1

X101

预置数（同步）保持（包括）保持（C=0）计数

同步置零法同步置零法任意进制计数器的构成方法，用已有的N进制芯片，组成进制计数器1.N>M计数循环过程中设法跳过N－个状态置零法器立即被置0不受CLK的控制（由SM状态译出置零信号）RD出现低电平后要等下一个CLK信号到达时才能将触发器置0（由SM-1状态译出置零信号）置数法状态译出置数信号从Si状态译出例：将十进制的74160接成六进制计数器置零法：置数法：

2.N<MM=N1×串行进位方式：以低位片的进位输出信号作为高位片的时钟输入信号并行进位方式：以低位片的进位信号作为高位片的工作状态控制信号例：用两片同步十进制计数器接成百进制计数器并行进方式串行进方式M为整体置零方式：首先将两片N进制计数器按最简单的方式接成一个大于M进制的计数器，然后在计数器记为M状态时使RD=0将两片计数器同时置零

整体置数方式：首先将两片N进制计数器按最简单的方式接成一个大于M进制的计数器，然后在某一状态下使LD′，将两片计数器同时置数成适当的状态，获得M进制计数器例：用两片74LS160接成二十九进制计数器整体置方式整体置方式同步时序逻辑电路的设计方法

例：设计一个串行数据检测器，要求在连续输入三个或三个以上“1”时输出为1，其余情况下输出为01)逻辑抽象取输入数据作为输入变量，用X表示；检测结果为输出变量，用表示。例如：输入X10输出0000000010001102)画状态转换图设电路没有输入1以前的状态为S0,入一个1状态为S1连续输入两个1后的状态为连续输入3个或3个以上1