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文档简介

组合逻辑电路的特点组合逻辑电路的分析

由给出的逻辑图找到其对应的逻辑表达式,列出它的真值表,说明该电路的用途.(1)

电路中每个门的输出标以不同的符号.(2)

先求每个门输出的逻辑表达式.(3)

迭代各逻辑表达式,并进行化简,直到求出电路输出的逻辑表达式,使其仅是电路输入变量的函数.(4)

填写真值表.组合逻辑电路的设计

步骤例子竞争与险象竞争：当一个门的两个或两个以上的输入发生改变时,由于这些输入信号是经过不同路径产生的（不同路径的传输延时不同）,使得各输入信号状态改变的时刻有先有后,这种时差引起的现象称为竞争。竞争的结果导致险象发生，并造成错误的后果,则这种竞争就称为“临界竞争”;若竞争的结果不导致险象发生或虽有险象发生,但不影响系统的工作,则称这种竞争为”非临界竞争”。组合电路的险象是过渡性现象，它们仅在电路的输入信号状态改变时,在电路的输出端出现毛刺,而不会破坏信号的稳态值.引起险象的具体原因可分：函数险象(功能险象)：当多个输入发生变化时逻辑险象：电路设计不合理会出现逻辑险象常见的组合逻辑电路

编码器和优先编码器

编码器功能：将其输入信号转换成对应的数码信号.用输出的数码信号表示相应的输入信号互斥输入的编码器优先编码器译码器

译码是编码的逆过程。译码器功能：将给定的输入码进行翻译,变换成对应的输出信号二进制译码器

数字显示译码器

多路选择器输入：地址线有N根；数据线有2N根；输出：一根信号线功能：将地址线选中的那根数据线上的信号送到输出端输出。（将地址线上的二进制数的转换成十进制数，十进制数就是数据线所对应的脚标，则该数据线被选中。）

数值比较器一位二进制数的比较

两位二进制数的比较

加法器半加器只考虑加数本身，不考虑低位的进位。全加器

不仅考虑加数本身，还考虑低位向本位的进位。Cn-1加法器逐位进位加法器超前进位加法器Gn：进位产生函数Pn：进位传递函数中规模集成组合逻辑电路及应用

中规模集成译码器

74139：2线-4线译码器74154中规模集成多路选择器

重点和难点重点：１、掌握组合逻辑电路的分析方法和设计方法。２、熟悉编码器、译码器、多路选择器和一位数值比较器的逻辑功能、工作原理和应用。３、掌握全加器的设计。难点：组合逻辑电路中的竞争和冒险。主教材重点例题：１、P125２、

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