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文档简介

1、实验2 8-3二进制编码器的设计与实现一、实验目的通过本实验熟悉开发环境 Simuli nk的使用，能够使用基本的逻辑门电路设计 并实现8-3二进制编码器。二、实验内容1. 熟悉Simulink环境；2. 使用基本的逻辑门电路设计并实现 8-3二进制编码器。三、实验步骤编码器是指用选定的一组0、1序列来标识特定对象的过程，执行编码功能的 电路成为编码器，编码器的结构框图如图 2.1所示。lln I i图2.1编码器结构框图设编码器有n个输入端X 0 , X 1 ,X n-1,有m个输出端丫 0 , 丫 1 ,丫 m-1。为了不使输出发生混乱而产生错误，规定在任何规定的时间内，n个输入端中只有一

2、个出现，其余n-1个输入均不得出现。为使输入与输出建立对应的关系，即一个被编码的对象具有一个特定的代码，输出的位数应满足：2log m n 昌模型分析3位二进制编码器，也称8-3二进制编码器，其输入端有8个，输出端有3 个，其真值表如表2.1所示。表2.1 8-3二进制编码器真值表X 7X 5X 4X 3X 2X 1X 0Y 2Y 1Y 0根据真值表2.1，可以直接写出逻辑表达式:(2-1)245612360135Y X X X X Y X X X XY X X X X=+?=+?二+?7772.模型搭建根据以上分析结果及式2.-1，可知需要选用以下几种模块：Pulse Gen erator

3、Logical Operator Scope现根据式2-1在新建文件“Ex2.mdl中划出逻辑电路图，如图2.2所示图2.2 Ex2.mdl逻辑电路图其中，“Pulse Generato模块参数设置情况如表 2.2所示，“Logical Operato模”块参数设置情况均如图2.3所示，“ Scope模块的参数设置情况如表2.3所示。表2.2“ Pulse Gen era模块参数设置 模块名称Pulse typeApplitudePeriodPulse widthPhase delaySample time1 0 1 1 1 1 1 2 1 1 3 1 1 4 1 1 5 1 1 6 1 1图 2.3“Logical OperatO模块参数设置表2.3“Scop模块参数设置模块名称Number of axesY-minY-max3. 执行仿真仿真结果如图2.4和图2.5所示。图2.4所示为编码器输入波形的示波器结果，图2.5所示为编码器输出波形的示波器结果图

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