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文档简介

1、实验六MSI组合逻辑电路的逻辑功能测试、实验目的熟悉中规模全加器、译码器、数据选择器组件的逻辑功能、外形及外引线排列。二、实验仪器与器材1. XST-5B数字电路实验装置、实验模板2. 集成电路:74LS283、74LS138、74LS153、74LS1513. 导线若干、+5V电源三、预习要求预习半加器、全加器、译码器、数据选择器的逻辑功能。四、实验内容与步骤1 .全加器的逻辑功能测试表6-1是全加器的真值表，其中A , Bi表示两个加数，Gj表示来自低位的进位，S , C表示相加后得到的和及进位。Ci =(ABi)为 ij + AsBi将全加器的输入端A , Bi , Cy分别接逻辑电平，

2、输出S , Ci接状态显示灯（LED ,按表6-1所列A , Bi , Gx的状态，测试Si, Ci的相应状态，将测试结果与表6-1进行比较。AiBiCi JSiCi0000000110010100110110010101011100111111表6-1全加器真值表2.译码器逻辑功能测试表6-2是3线/8线译码器74LS138的真值表。按表中给定的输入状态。测试输出，将测得的结果与表6-2进行比较。输入输出Ei百可A B C丫0丫1丫2Y3丫4Y5丫6Y70XXXXX1 1 1 1 1 1 1 11 0 1XXX1 1 1 1 1 1 1 111XXXX1 1 1 1 1 1 1 11 0 0

3、0 0 00 1 1 1 1 1 1 11 0 00 0 11 0 1 1 1 1 1 11 0 00 1 01 1 0 1 1 1 1 11 0 00 1 11 1 1 0 1 1 1 11 0 01 0 01 1 1 1 0 1 1 11 0 01 0 11 1 1 1 1 0 1 11 0 01 1 01 1 1 1 1 1 0 11 0 01 1 11 1 1 1 1 1 1 0表6-23.数据选择器逻辑功能测试表6-3是4选1数据选择器74LS153的功能表，按表中给定的输入状态。测试输出，将测得的结果与表 6-3进行比较。选通端选择端数据端输出端SSoD3D2D1D0XXXXXXX0XXX1XX0XXX1XX0XXX1XX0XXX1XXX表6-3八选一数据选择器74LS151功能测试（自己根据管脚排列和测试结 果写出功能表及函数表达式）五、实验报

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